首頁　 資訊　 商機 　 下載　 拆解 　 高校　 招聘 　 雜志　 會展　 EETV　 百科 　 問答　 電路圖　 工程師手冊 　 Datasheet　 100例 　 活動中心　 E周刊閱讀 　 樣片申請
EEPW首頁 >> 主題列表 >> fpga+dsp

基于OMAP的設計匯總，包括示波器、監(jiān)護儀、人機接口等

  • 　　德州儀器 (TI) 公司的開放式多媒體應用平臺OMAP(Open Multimedia Application Platform)是一種為滿足移動多媒體信息處理及無線通信應用開發(fā)出來的高性能、高集成度嵌入式處理器。本文介紹基于OMAP經(jīng)典設計匯總，供大家參考。 　　OMAP5912雙核通信及其數(shù)字音頻系統(tǒng)實現(xiàn) 　　OMAP平臺因其特有的雙核結構，廣泛應用于實時多媒體影音數(shù)據(jù)處理、語音識別系統(tǒng)、網(wǎng)絡通信等領域。筆者以OMAP5912平臺的數(shù)字音頻系統(tǒng)為例介紹雙核通信的具體應用，希望能對使用OMAP的
  • 關鍵字： OMAP  示波器  DSP  

基于OMAP的無線傳感網(wǎng)節(jié)點處理器的設計與實現(xiàn)

  • 　　無線傳感網(wǎng)絡是計算技術、通信技術和傳感器技術相結合的產(chǎn)物。傳感網(wǎng)應用場合非常廣泛，節(jié)點也可以搭載不同類型的傳感器。當節(jié)點自身搭載的傳感器為震動、磁傳感器時，采集到的數(shù)據(jù)量較小，處理簡單，目前的傳感網(wǎng)節(jié)點(如Mica節(jié)點)就可以滿足需要。但當節(jié)點集成圖像傳感器、紅外傳感器等大數(shù)據(jù)量傳感器對傳感數(shù)據(jù)網(wǎng)絡的實時要求相當高時，現(xiàn)有的節(jié)點受處理及存儲能力的限制無法滿足要求。 　　本文主要分析在設計較高處理及存儲能力傳感節(jié)點時，如何滿足傳感網(wǎng)節(jié)點低功耗和高處理能力間的平衡關系，并介紹基于OMAP處理器的節(jié)點處理
  • 關鍵字： OMAP  DSP  

FPGA時序約束的6種方法

  • 　　對自己的設計的實現(xiàn)方式越了解，對自己的設計的時序要求越了解，對目標器件的資源分布和結構越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設計的時序約束目標就會越清晰，相應地，設計的時序收斂過程就會更可控。 　　下文總結了幾種進行時序約束的方法。按照從易到難的順序排列如下： 　　0.核心頻率約束 　　這是最基本的，所以標號為0. 　　1.核心頻率約束+時序例外約束 　　時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時序約束
  • 關鍵字： FPGA  時序約束  

從硬件角度討論FPGA開發(fā)框架

  • 　　FPGA采用了邏輯單元陣列概念，內(nèi)部包括可配置邏輯模塊、輸出輸入模塊和內(nèi)部連線三個部分。每一塊FPGA芯片都是由有限多個帶有可編程連接的預定義源組成來實現(xiàn)一種可重構數(shù)字電路。 　　長久以來新型FPGA的功能和性能已經(jīng)為它們贏得系統(tǒng)中的核心位置，成為許多產(chǎn)品的主要數(shù)據(jù)處理引擎。 　　鑒于FPGA在如此多應用中的重要地位，采取正式且注重方法的開發(fā)流程來處理FPGA設計比以往更加重要。該流程旨在避免開發(fā)周期后期因發(fā)現(xiàn)設計缺陷而不得不進行費時費錢的設計修改，而且該缺陷還可能對項目進度計劃、成本和質(zhì)量造成災
  • 關鍵字： FPGA  

【從零開始走進FPGA】美好開始——我流啊流啊流

  • 　　按照基于Windows的語言(C、C++、C#)等編程語言的初學入門教程，第一個歷程應該是“Hello World!”的例程。但由于硬件上的驅(qū)動難易程度，此例程將在在后續(xù)章程中推出。硬件工程師學習開發(fā)板的第一個例程：流水燈，一切美好的開始。 　　本章將會在設計代碼的同時，講解Quartus II 軟件的使用，后續(xù)章節(jié)中只講軟件的思想，以及解決方案，不再做過多的累贅描述。 　　一、Step By Step 建立第一個工程 　　(1)建立第一個工程，F(xiàn)ile-New-New
  • 關鍵字： FPGA  Quartus II  

基于FPGA的跨時鐘域信號處理——MCU

  • 　　說到異步時鐘域的信號處理，想必是一個FPGA設計中很關鍵的技術，也是令很多工程師對FPGA望而卻步的原因。但是異步信號的處理真的有那么神秘嗎?那么就讓特權同學和你一起慢慢解開這些所謂的難點問題，不過請注意，今后的這些關于異步信號處理的文章里將會重點從工程實踐的角度出發(fā)，以一些特權同學遇到過的典型案例的設計為依托，從代碼的角度來剖析一些特權同學認為經(jīng)典的跨時鐘域信號處理的方式。這些文章都是即興而寫，可能不會做太多的分類或者歸納，也有一些特例，希望網(wǎng)友自己把握。 　　另外，關于異步時鐘域的話題，推薦大家
  • 關鍵字： FPGA  MCU  

跨越鴻溝：同步世界中的異步信號

  • 　　只有最初級的邏輯電路才使用單一的時鐘。大多數(shù)與數(shù)據(jù)傳輸相關的應用都有與生俱來的挑戰(zhàn)，即跨越多個時鐘域的數(shù)據(jù)移動，例如磁盤控制器、CDROM/DVD 控制器、調(diào)制解調(diào)器、網(wǎng)卡以及網(wǎng)絡處理器等。當信號從一個時鐘域傳送到另一個時鐘域時，出現(xiàn)在新時鐘域的信號是異步信號。 　　在現(xiàn)代 IC、ASIC 以及 FPGA 設計中，許多軟件程序可以幫助工程師建立幾百萬門的電路，但這些程序都無法解決信號同步問題。設計者需要了解可靠的設計技巧，以減少電路在跨時鐘域通信時的故障風險。 　　基礎 　　從事多時鐘設計的第一
  • 關鍵字： FPGA   異步信號  FIFO   

零基礎學FPGA（十）初入江湖之i2c通信

  • 　　相信學過單片機的同學對I2C總線都不陌生吧，今天我們來學習怎么用verilog語言來實現(xiàn)它，并在FPGA學習版上顯示。 　　i2c總線在近年來微電子通信控制領域廣泛采用的一種新型的總線標準，他是同步通信的一種特殊方式，具有接口少，控制簡單，器件封裝形式小，通信速率高等優(yōu)點。在主從通信中，可以有多個i2c總線器件同時接到i2c總線上，所有與i2c兼容的器件都有標準的接口，通過地址來識別通信對象，使他們可以經(jīng)由i2c總線互相直接通信。 　　i2c總線由兩條線控制，一條時鐘線SCL，一條數(shù)據(jù)線SDA，這
  • 關鍵字： FPGA  i2c  verilog  

智能醫(yī)療成風口 IC設計企業(yè)如何站位？

  • 　　市場研究機構ICInsights最新報告稱，中國IC設計企業(yè)在2014年全球前五十無晶圓廠IC供應商排行榜上占據(jù)9個席位。這9家廠商包括海思、展訊、大唐微、南瑞智芯、華大、中興、瑞芯微、銳迪科、全志。而2009年只有1家企業(yè)入圍，這表明中國無晶圓廠IC產(chǎn)業(yè)確實成長顯著。 　　然而，上述9家入圍企業(yè)中，有5家都聚焦于目前最熱門的智能手機市場。當然，這些年智能手機終端產(chǎn)業(yè)確實增長迅速，也為中國IC設計提供了發(fā)展空間和機遇。但我國擁有的是全球最大的信息消費市場，每年進口集成電路產(chǎn)品超過2000億美元，對I
  • 關鍵字： 海思  展訊  FPGA  

FPGA時序約束的6種方法

  • 　　對自己的設計的實現(xiàn)方式越了解，對自己的設計的時序要求越了解，對目標器件的資源分布和結構越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設計的時序約束目標就會越清晰，相應地，設計的時序收斂過程就會更可控。 　　下文總結了幾種進行時序約束的方法。按照從易到難的順序排列如下： 　　0.核心頻率約束 　　這是最基本的，所以標號為0. 　　1.核心頻率約束+時序例外約束 　　時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時序約束
  • 關鍵字： FPGA  時序約束  

零基礎學FPGA（九）牛刀小試——串行口通信電路設計

  • 　　以前在學單片機的時候，覺得串口通信其實很簡單，只要一個指令數(shù)據(jù)就能輕易的接收或者發(fā)送。前幾天試著用FPGA實現(xiàn)，發(fā)現(xiàn)里面的學問還不少，并沒有想象的那么簡單。當然代碼肯定是參考別人的，不過我還是認真研究了整段代碼的，下面的程序就是我在看懂了別人代碼后自己敲的，花了也不少時間，理解的也差不多，下面我就在這里給那些和我一樣的初學者介紹一下吧，解釋的不對的地方還望各位大神指正，大家好一起學習~ 　　1、頂層模塊 　　寫程序都一樣，不能多有的程序都寫在一個模塊里，那樣看起來很麻煩，出了錯誤也不好維護，對于一
  • 關鍵字： FPGA  狀態(tài)機  

【從零開始走進FPGA】路在何方——Verilog快速入門

  • 　　一、關于HDL 　　1. HDL簡介 　　HDL ： Hardware Discription Language 硬件描述語言，即描述FPGA/CPLD內(nèi)部邏輯門的工作狀態(tài)，來實現(xiàn)一定電路。 　　隨著EDA技術的發(fā)展，使用硬件語言設計PLD/FPGA成為一種趨勢。目前硬件描述語言有VHDL、Verilog、Superlog、System C、Cynlib C++、C Level等。 各種語言有各種優(yōu)勢，根據(jù)業(yè)界應用而定。 　　2. VHDL和Verilog區(qū)別 　　在業(yè)界，VHDL和Veri
  • 關鍵字： FPGA  Verilog  

不同的verilog代碼風格看RTL視圖之一

  • 　　剛開始玩CPLD/FPGA開發(fā)板的時候使用的一塊基于EPM240T100的板子，alter的這塊芯片雖說功耗小體積小，但是資源還是很小的，你寫點稍微復雜的程序，如果不注意coding style，很容易就溢出了。當時做一個三位數(shù)的解碼基本就讓我苦死了，對coding style的重要性也算是有一個比較深刻的認識了。 　　后來因為一直在玩xilinx的spartan3 xc3s400，這塊芯片資源相當豐富，甚至于我在它里面緩存了一幀640*480*3/8BYTE的數(shù)據(jù)都沒有問題(VGA顯示用)。而最近
  • 關鍵字： FPGA  verilog  RTL  

解讀verilog代碼的一點經(jīng)驗

  • 　　學習FPGA其實也不算久，開始的時候參考別人的代碼并不多，大多是自己寫的，那時候做時序邏輯多一些。參加了中嵌的培訓班，一個多月的時間在熟悉ISE軟件的使用以及verilog語法方面下了苦功，也參考了不少書，算是為自己打下了比較好的基礎。因為那時候培訓的方向是軟件無線電方面的，所以做了很多有關的模塊程序，之前的日志里也發(fā)表了很多，關鍵是一個興趣，感覺仿真后看到自己的一個個算法思想得到實現(xiàn)真有成就感。后來停了一段時間，因為實在沒有比較有意思的活干了。 　　直到前段時間開始使用SP306的開發(fā)板，然后會參
  • 關鍵字： FPGA  verilog  

Proteus幫你輕松入門DSP（3）--SCI操作實驗

  • 　　一、概述 　　SCI(serial communication interface)即串行通信接口，是一個雙線異步串行口，一般用作UART。TMS320F2802X的內(nèi)部具有一個SCIA模塊，每個SCI模塊都各有一個接收器和發(fā)送器。SCI的接收器和發(fā)送器各有一個4級深度的FIFO(first in first out 先入先出)隊列，它們都有自己獨立的使能位和中斷位，可以在半雙工通信中進行獨立操作，或者在全雙工通信中進行操作。TMS320F2802X的SCI模塊具有以下特點： 　　1. 和普通I/
  • 關鍵字： Proteus  DSP  SCI  
共9896條 159/660 |‹ « 157 158 159 160 161 162 163 164 165 166 » ›|

fpga+dsp介紹

您好，目前還沒有人創(chuàng)建詞條fpga+dsp!
歡迎您創(chuàng)建該詞條，闡述對fpga+dsp的理解，并與今后在此搜索fpga+dsp的朋友們分享。    創(chuàng)建詞條

熱門主題

樹莓派    linux   
關于我們 - 廣告服務 - 企業(yè)會員服務 - 網(wǎng)站地圖 - 聯(lián)系我們 - 征稿 - 友情鏈接 - 手機EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權所有 北京東曉國際技術信息咨詢有限公司
備案 京ICP備12027778號-2 北京市公安局備案：1101082052    京公網(wǎng)安備11010802012473