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fpga+dsp 文章 最新資訊

一種跳頻MSK信號檢測算法及FPGA 實現(xiàn)

  • 本文提出了一種FPGA 可實現(xiàn)的跳頻MSK 信號實時截獲和識別的設(shè)計方案，經(jīng)過試驗證明，可以對寬帶跳頻信號進行實時的截獲，并能夠?qū)ζ渲械腗SK 目標信號完成準確識別，可應(yīng)用于針對特定目標的通信偵察系統(tǒng)，具有較高的應(yīng)用價值。
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基于DSP的中文語音合成系統(tǒng)設(shè)計

  • 基于DSP的中文語音合成系統(tǒng)設(shè)計,引言　　本文介紹的就是一種基于DSP的中文語音合成系統(tǒng)的實現(xiàn)方法。隨著語音信號處理技術(shù)的不斷發(fā)展與成熟，語音合成正逐步成為信息技術(shù)中人機接口的關(guān)鍵技術(shù)。DSP芯片，即數(shù)字信號處理器，是專門為快速實現(xiàn)各種信號
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基于DSP/BIOS的外設(shè)驅(qū)動開發(fā)模型及DSP視頻驅(qū)動程序

  • 基于DSP/BIOS的外設(shè)驅(qū)動開發(fā)模型及DSP視頻驅(qū)動程序,引言隨著時代的發(fā)展，DSP技術(shù)在遠程監(jiān)控、可視電話、工業(yè)檢測等視頻處理領(lǐng)域得到了廣泛的應(yīng)用，對于不同的視頻處理系統(tǒng)，會使用不同的視頻設(shè)備，所以有必要為視頻沒備設(shè)計驅(qū)動程序，為高層應(yīng)用程序提供統(tǒng)一的接口來操
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DSP芯片外圍電路典型設(shè)計(數(shù)字信號處理器芯片TMS320F

  • DSP芯片外圍電路典型設(shè)計(數(shù)字信號處理器芯片TMS320F,DSP芯片外圍電路典型設(shè)計(數(shù)字信號處理器芯片TMS320F206) :引 言

    DSP(數(shù)字信號處理器)芯片是一種能夠?qū)崟r快速地實現(xiàn)各種數(shù)字信號處理算法控制的微處理器，已經(jīng)在通信與信息系統(tǒng)、信號與處理、自動控制、雷達、航
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東方迪碼推出的一款便攜式ADI DSP仿真開發(fā)工具

  • 　　北京東方迪碼科技有限公司推出一款便攜式ADI DSP仿真開發(fā)工具DM-TOOLS-USB ICE5.0，能夠支持ADI Blackfin全系列DSP處理器。該產(chǎn)品以其超強的性能、超低的價格、ADI原廠的技術(shù)，徹底改變了ADI 高性能開發(fā)工具價格昂貴的歷史，立志成為ADI Blackfin處理器用戶的首選工具。 　　【功能參數(shù)】 JTAG TCLK頻率5MHz 僅支持ADI Blackfin處理器 USB 2.0接口使下載速率高達255 KB/s 兼容1.8
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基于DSP的中頻電源測試系統(tǒng)設(shè)計

  • 目前，115V／400 Hz電源廣泛應(yīng)用于航空、航天等軍用設(shè)備中，軍用設(shè)備一般對頻率精度要求較高，因此必須對其進行測試，使其滿足軍用標準。本設(shè)計利用數(shù)字信號處理器(DSP)對數(shù)字信號強大的處理能力，對交流電壓與頻率進
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基于數(shù)據(jù)采集系統(tǒng)中的DSP控制回路設(shè)計

  • 基于數(shù)據(jù)采集系統(tǒng)中的DSP控制回路設(shè)計,　1 引 言　　隨著信息技術(shù)的飛速發(fā)展，數(shù)字信號處理器(DSP)得到了廣泛的應(yīng)用，基于A／D，DSP，D／A的數(shù)據(jù)采集模式已經(jīng)被大多數(shù)人所接受。在現(xiàn)代生物信號采集方案中，人們不僅要求系統(tǒng)有高速的數(shù)據(jù)處理能力，而且還要
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基于CORDIC 2FSK調(diào)制器的FPGA設(shè)計

  • 摘要：頻移鍵控(FSK)是用不同頻率的載波來傳遞數(shù)字信號，并用數(shù)字基帶信號控制載波信號的頻率。提出一種基于流...
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DSP在六自由度電磁跟蹤系統(tǒng)中的應(yīng)用

  • 　摘 要：針對目前電磁跟蹤系統(tǒng)跟蹤速度慢，計算參數(shù)精度低的現(xiàn)況，文中介紹了一種采用DSP系統(tǒng)來完 成對感應(yīng)天線接收到的模擬信號采集處理的方案。該方案實現(xiàn)了單通道128 kHz的采樣率和12位的數(shù)據(jù)精度，解 決了系統(tǒng)中
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FPGA如何改變嵌入設(shè)計格局

  • FPGA如何改變嵌入設(shè)計格局,由于經(jīng)濟下滑損及開發(fā)預(yù)算減少，嵌入系統(tǒng)設(shè)計者正在轉(zhuǎn)向FPGA(現(xiàn)場可編程門陣列)技術(shù)，以縮減開發(fā)周期、對抗設(shè)備老化以及簡化產(chǎn)品升級。通過采用數(shù)量龐大且不斷增加的FPGA開發(fā)工具、可重用邏輯單元以及市售商用模塊，
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QDR SRAM與Spartan3 FPGA的接口設(shè)計

  • QDR SRAM與Spartan3 FPGA的接口設(shè)計,為了滿足當(dāng)前系統(tǒng)和處理器的生產(chǎn)量需求，更新的靜態(tài)存儲器應(yīng)運而生。QDR SRAM就是由Cypress、Renesas、IDT、NEC和Samsung為高性能的網(wǎng)絡(luò)系統(tǒng)應(yīng)用而共同開發(fā)的一種具有創(chuàng)新體系結(jié)構(gòu)的同步靜態(tài)存儲器?！　? QDR SRAM的
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采用集成 DSP 與微處理器內(nèi)核的嵌入式應(yīng)用

  • 采用集成 DSP 與微處理器內(nèi)核的嵌入式應(yīng)用,由于DSP 架構(gòu)是專門設(shè)計用于執(zhí)行信號處理算法的，因此信號處理算法在 DSP 上的 運行效率很高；而手機中的控制軟件則負責(zé)執(zhí)行狀態(tài)機，即控制用戶界面、鍵盤及其它非信號處理功能。
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CPLD的DSP多SPI端口通信設(shè)計

  • CPLD的DSP多SPI端口通信設(shè)計,本文介紹一種采用運動控制專用DSP芯片DSP56F801設(shè)計的超聲波電機運動控制裝置。由于該超聲波電機需要采用兩相四路對稱PWM信號來實現(xiàn)驅(qū)動控制，而DSP芯片無法直接產(chǎn)生所需PWM信號，采用軟件方法又會占用大量的DSP計算
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基于DSP/BIOS 的TI DSP 應(yīng)用程序框架設(shè)計

  • 基于DSP/BIOS 的TI DSP 應(yīng)用程序框架設(shè)計,　　摘要：本文介紹了基于DSP/BIOS 實時內(nèi)核的TI DSP 應(yīng)用程序參考框架RF5。另外，面對目前越來越多的多處理器系統(tǒng)設(shè)計以及典型的GPP-DSP 架構(gòu)，本文提出了一種改進的DSP應(yīng)用程序框架ERF5 以最大化地支持這種架構(gòu)。E
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FPGA設(shè)計中仿真技術(shù)解決故障的方法

  • 　摘要：本文針對FPGA實際開發(fā)過程中，出現(xiàn)故障后定位困難、反復(fù)修改代碼編譯時間過長、上板后故障解決無法確認的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案?？梢源蟠蟮墓?jié)約開發(fā)時間，提高
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