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rtl-to-gdsii
西門(mén)子發(fā)布Tessent RTL Pro強(qiáng)化可測(cè)試性設(shè)計(jì)能力
EDA/PCB
西門(mén)子
Tessent RTL Pro
可測(cè)試性設(shè)計(jì)
|
2023-10-19
Cadence推出Joules RTL Design Studio，將RTL生產(chǎn)力和結(jié)果質(zhì)量提升到新的高度
EDA/PCB
Cadence
RTL
|
2023-07-17
Cadence擴(kuò)展JasperGold平臺(tái)用于高級(jí)形式化RTL簽核
EDA/PCB
Cadence
RTL
|
2017-06-05
如何通過(guò)RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計(jì)
嵌入式系統(tǒng)
RTL
SDC
FPGA
|
2017-06-04
Mentor Graphics Catapult 平臺(tái)將設(shè)計(jì)啟動(dòng)到驗(yàn)證收斂的
EDA/PCB
Mentor
RTL
|
2016-06-12
數(shù)字電路設(shè)計(jì)入門(mén)之?dāng)?shù)字設(shè)計(jì)的任務(wù)和兩項(xiàng)基本功
嵌入式系統(tǒng)
Verilog
RTL
|
2016-04-20
FPGA入門(mén)者必讀寶典：詳述開(kāi)發(fā)流程每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)
嵌入式系統(tǒng)
FPGA
RTL
|
2015-08-27
精確估算SoC設(shè)計(jì)動(dòng)態(tài)功率的新方法
嵌入式系統(tǒng)
SoC
RTL
|
2015-08-05
精確估算SoC設(shè)計(jì)動(dòng)態(tài)功率的新方法
嵌入式系統(tǒng)
SoC
RTL
|
2015-08-01
不同的verilog代碼風(fēng)格看RTL視圖之三
嵌入式系統(tǒng)
verilog
RTL
|
2015-02-06
不同的verilog代碼風(fēng)格看RTL視圖之二
嵌入式系統(tǒng)
verilog
RTL
|
2015-01-26
不同的verilog代碼風(fēng)格看RTL視圖之一
嵌入式系統(tǒng)
FPGA
verilog
RTL
|
2015-01-21
淺淡邏輯設(shè)計(jì)的學(xué)習(xí)(一)
嵌入式系統(tǒng)
邏輯設(shè)計(jì)
IC
RTL
|
2014-11-08
解析FPGA低功耗設(shè)計(jì)
嵌入式系統(tǒng)
FPGA
低功耗
RTL
|
2014-10-31
Excellicon工具被燦芯半導(dǎo)體采用，用以縮短時(shí)序收斂過(guò)程加快產(chǎn)品交付
工控自動(dòng)化
Excellicon
燦芯
RTL
|
2014-04-02
Synopsys IC Compiler II改變?cè)O(shè)計(jì)游戲規(guī)則后端物理設(shè)計(jì)吞吐量提高10倍
EDA/PCB
Synopsys
IC
RTL
|
2014-03-25
Cadence宣布并購(gòu)Forte Design Systems
網(wǎng)絡(luò)與存儲(chǔ)
Cadence
SystemC
RTL
|
2014-02-10
如何調(diào)試數(shù)字硬件設(shè)計(jì)
嵌入式系統(tǒng)
數(shù)字硬件
RTL
參數(shù)測(cè)試
JTAG
|
2014-01-27
工程師設(shè)計(jì)手冊(cè)：集成“硬”IP模塊的幾點(diǎn)建議
電源與新能源
IP模塊
工程師經(jīng)驗(yàn)談
GDSII
|
2013-10-05
基于時(shí)序邏輯等效性檢查方法的RTL驗(yàn)證
EDA/PCB
RTL
時(shí)序邏輯
等效
檢查方法
|
2013-04-16
用RTL測(cè)試平臺(tái)驗(yàn)證事務(wù)級(jí)IP模型
測(cè)試測(cè)量
RTL
測(cè)試平臺(tái)
模型
|
2012-05-21
Cadence推出新一代Encounter RTL-to-GDSII流程
EDA/PCB
Cadence
RTL-to-GDSII
|
2012-03-06
基于RTL綜合策略的狀態(tài)機(jī)優(yōu)化方案
模擬技術(shù)
RTL
策略
方案
|
2012-01-04
在FPGA設(shè)計(jì)中使用Precision RTL 綜合實(shí)例
嵌入式系統(tǒng)
綜合
實(shí)例
RTL
Precision
設(shè)計(jì)
使用
FPGA
|
2010-06-24
Synopsys綜合和布局及布線生產(chǎn)效率提升兩倍
EDA/PCB
Synopsys
RTL
32納米
|
2010-04-08
Design Compiler 2010將綜合和布局及布線的生產(chǎn)效率提高2倍
EDA/PCB
Synopsys
Galaxy
RTL
|
2010-04-07
中芯國(guó)際和新思科技攜手推出Reference Flow 4.0
EDA/PCB
中芯國(guó)際
65納米
Galaxy
RTL-to-GDSII參考設(shè)計(jì)流程4.0
|
2009-06-24
利用現(xiàn)成FPGA開(kāi)發(fā)板進(jìn)行ASIC原型開(kāi)發(fā)
嵌入式系統(tǒng)
FPGA
ASIC
NRE
RTL
|
2009-04-17
Magma 最新版Talus Design面世
EDA/PCB
Magma
RTL
DFT
Talus
|
2009-04-15
采用高級(jí)節(jié)點(diǎn)ICs實(shí)現(xiàn)從概念到推向消費(fèi)者的最快途徑(08-100)
EDA/PCB
Cadence
ICs
GDSII
|
2009-02-25
Cadence推出C-to-Silicon Compiler拓展系統(tǒng)級(jí)產(chǎn)品
EDA/PCB
Cadence
RTL
SoC
IP
|
2008-07-16
CADENCE與Common Platform及ARM合作提供45納米R(shí)TL-to-GDSII參考流程
EDA/PCB
CADENCE
Common Platform
ARM
RTL-to-GDSII
低功耗
|
2008-06-16
提高DFT設(shè)計(jì)測(cè)試覆蓋率的有效方法
測(cè)試測(cè)量
寄存器
邏輯
存儲(chǔ)器
RTL
接口
掃描
模擬
|
2008-05-26
新型高精度時(shí)鐘芯片RTL-4553
嵌入式系統(tǒng)
時(shí)鐘芯片
RTL-4553
高精度
MCU和嵌入式微處理器
|
2007-08-21
8位單片機(jī)與以太網(wǎng)控制器RTL8029接口的VHDL設(shè)計(jì)
工控自動(dòng)化
VHDL
RTL
8位單片機(jī)
|
2006-06-21
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