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rtl-to-gdsii
Using GDSII layout data in Son...
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Using
GDSII
layout
Sonnet
analysis
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zhuanjifen
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Using GDSII layout data in Son...
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Using
GDSII
layout
Sonnet
analysis
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zhuanjifen
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Writing TestbenchesFunctional Verification of HDL Models
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hdl
rtl
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wangderfvl
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Synopsys-RTL_coding
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Synopsys
RTL
coding
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Jason_Zhang
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新型高精度時鐘芯片RTL-4553
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時鐘芯片
RTL-4553
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xilinxue
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ASIC設(shè)計驗證
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SYNPLICITY
FPGA
ASIC
設(shè)計驗證
Certify
SOC
RTL
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foolish_girl
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Verilog邏輯仿真(3)
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Verilog
任務(wù)
函數(shù)
綜合
RTL
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foolish_girl
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用多片F(xiàn)PGA進行ASIC設(shè)計驗證的分區(qū)和綜合技術(shù)
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SYNPLICITY
FPGA
ASIC
設(shè)計驗證
Certify
SOC
RTL
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foolish_girl
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從ESL到GDSII的流暢SoC設(shè)計
積分：0分
ESL
GDSII
SoC
SPIRIT
配置系統(tǒng)級
系統(tǒng)模型
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foolish_girl
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pcit32_verilog_lattice代碼
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Lattice
32-Bit
PCI
ispMACH
RTL
HDL
MACH
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tvro_china
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基于FPGA的全數(shù)字Costas環(huán)的設(shè)計與實現(xiàn)
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Costas環(huán)
載波恢復(fù)
FPGA
RTL
DDS
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sylar
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跨時鐘域設(shè)計經(jīng)典
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Multi-Asynchronous Clock Desings
ASIC
MTBF
SDF
RTL
FIFO
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Jason_Zhang
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夏宇聞著作《從算法設(shè)計到硬線邏輯的實現(xiàn)》虛擬器件和虛擬接口模型
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虛擬器件
虛擬接口模型
大型數(shù)字系統(tǒng)
宏單元
Cores
RTL
Verilog HDL
VHDL
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tvro_china
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FPGACPLD數(shù)字電路設(shè)計經(jīng)驗分享
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FPGA
CPLD
數(shù)字電路
時序設(shè)計
時延路徑
RTL
建立時間
保持時間
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FPGACPLD數(shù)字電路設(shè)計經(jīng)驗分享
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FPGA
CPLD
數(shù)字電路
RTL
時延路徑
時序模型
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Lattice Designing a 33MHz, 32-Bit PCI Target
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Lattice
PCI
ispMACH Devices
RTL
HDL
MACH
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FFT_report
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FFT
VHDL
RTL
HDL
IEEE
DFT
ROM
RAM
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an360 設(shè)計仿真模型for the POS-PHY Level 4 MegaCore
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Altera
Updating Simulation Models
POS-PHY
PLL
LVDS
RTL
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FPGA應(yīng)用文檔：將YCrCb轉(zhuǎn)為RGB
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Xilinx
YcrCb
RGB
HDL
RTL
Color-Space Converter
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CIC Xilinx FPGA trainning HDL code guide
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CIC
Xilinx Synthesis
FPGA
RTL
Verilog HDL
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CIC Xilinx FPGA training - simulation flow with ModelSim
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CIC
Xilinx FPGA
Simulation Flow
ModelSim
RTL
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Hongjun
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IC 設(shè)計行業(yè)的朋友們推薦優(yōu)秀的書籍和相關(guān)資料
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IC設(shè)計
HDL
Test
Functional Verification
RTL
ASIC
FPGA
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擴頻載波通信電路KT8341的設(shè)計
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RTL
GDS2
邏輯綜合
直接序列擴頻
偽隨機碼序列
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Texas Instruments
TINIS400外部串口
DSTINIS400
Verilog RTL
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CPLD
FPGA
VHDL
寄存器傳輸級(RTL)
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DRAM
GDSII
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用來實現(xiàn)DSP算法的C合成方法
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關(guān)于視頻壓縮
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DCT/IDCT
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RTL代碼優(yōu)化的文章
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代碼優(yōu)化
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Synopsys - Describing Synthesizable RTL in SystemC
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Synthesizable RTL
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