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EEPW首頁 >> 主題列表 >> fpga-to-asic

利用Virtex-5 FPGA實現(xiàn)更高的性能

  • 在FPGA系統(tǒng)設(shè)計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設(shè)計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
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做中國的FPGA 迎接消費電子盛宴——專訪Actel CEO John East

  • 　　做中國的FPGA產(chǎn)品！這句話聽起來很響亮，出自賽靈思？還是Altera?多年來，人們總是習慣性的把FPGA市場上的風吹草動都歸結(jié)到難分伯仲的PLD雙雄身上。不僅因為這兩家公司長期壟斷FPGA市場，總計占了85%以上的份額，還在于最近他們?yōu)闋帄Z65納米聲勢激烈競爭，口水仗不斷上演。這種多年不變的市場格局讓人們幾乎淡忘了FPGA市場上還有Lattice 、Actel 、Quicklogic等眾多無名小輩。不過，這一響亮的聲音不是來自PLD雙雄，而是目前市場上排名第四的FPGA供應商Actel。 　　Ac
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S2C成為Tensilica中國地區(qū)最新SoC原型合作伙伴

  • 　　Tensilica宣布結(jié)盟S2C 公司共建SoC原型合作伙伴關(guān)系。 S2C已將Tensilica的Diamond Standard 108mini集成到TAI Logic Module基于FPGA的 ESL平臺中，并正在開發(fā)針對Tensilica廣受歡迎的Diamond Standard 330HiFi音頻IP核的參考設(shè)計和演示平臺。 　　S2C基于FPGA的ESL 解決方案能夠使設(shè)計工程師容易和安全地
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多內(nèi)核和多線程SoC帶來新的調(diào)試挑戰(zhàn)

  • 2005 年， MIPS收購了 FS2，滿足客戶有關(guān)調(diào)試支持要求 FS2 作為MIPS 科技的一個部門其先的系統(tǒng)級測試、調(diào)試和跟蹤能力。FS2的在線儀技術(shù)為SoC內(nèi)部工作提供深入系統(tǒng)級可視性這是保證設(shè)計成功和加快上市時間的關(guān)鍵。兩公司合開發(fā)了 PDtrace?(程序和數(shù)據(jù)蹤)和蹤，用于MIPS32 4KE24K24KE以及最新的 34K 多線程處理器系列。除了 PDtrace 技術(shù)，F(xiàn)S2為嵌入式系統(tǒng)開發(fā)及調(diào)試提供系統(tǒng)導航( System Navigator)。FS2還為先處理器總線系統(tǒng)級分析IP 和工具
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面向FPGA的ESL工具

  • 邏輯設(shè)計領(lǐng)域正發(fā)生著根本變化，新一代設(shè)計工具能夠幫助軟件開發(fā)者將其算法表達直接轉(zhuǎn)換成硬件，而無需學習傳統(tǒng)的硬件設(shè)計技術(shù)。這些工具及相關(guān)設(shè)計方法學一起被歸類為電子系統(tǒng)級 (ESL) 設(shè)計，廣義上指從比目前主流的寄存器傳輸級 (RTL) 更高的抽象級別上開始的系統(tǒng)設(shè)計與驗證方法學。與硬件語言如 Verilog 和 VHDL比起來，ESL 設(shè)計語言在語法和語義上與流行的 ANSI C 比較接近。 ESL 與 FPGA 的關(guān)系ESL 工具已經(jīng)存在了一段時間，而許多人覺得這些工具主要專注于 ASIC 設(shè)計流程。然
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基于軟件無線電的廣域自適應頻譜技術(shù)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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軟件無線電和重配置技術(shù)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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高性能模擬：SoC難集成 中國市場增勢猛

  • 　　數(shù)字時代的到來不僅沒有讓模擬產(chǎn)品銷聲匿跡，相反，主營模擬產(chǎn)品的公司活得有滋有味。德州儀器、美國國家半導體、凌力爾特(Linear)、ADI、Intersil等公司在大力宣傳數(shù)字時代下模擬產(chǎn)品重要性的同時，不約而同地表示要將精力集中在高性能模擬產(chǎn)品上。那么，在眾說紛紜“高性能”的情況下，什么產(chǎn)品才是高性能模擬產(chǎn)品？面對集成度越來越高的半導體行業(yè)，高性能模擬產(chǎn)品是否生存不易？中國市場對高性能模擬產(chǎn)品的接受程度如何？ 　　眾說紛紜“高性能” 　　就在各大公司紛紛標榜自己是高性能模擬產(chǎn)品生產(chǎn)商時，還沒有任何一
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USB2.0虛擬邏輯分析儀的設(shè)計與實現(xiàn)

  • 引言 傳統(tǒng)的邏輯分析儀體積龐大、價格昂貴、通道數(shù)目有限，并且在數(shù)據(jù)采集、傳輸、存儲、顯示等方面存在諸多限制，在很大程度上影響了其在實際中的應用。選用高性能的FPGA芯片進行數(shù)據(jù)處理，充分利用PC的強大處理功能，配合LabView圖形化語言開發(fā)的虛擬邏輯分析儀，其數(shù)據(jù)處理和傳輸速率大大提高，適用性極大增強，其顯示、操作界面和低廉的成本較之傳統(tǒng)的邏輯分析儀具有極大的優(yōu)勢和發(fā)展前景。 工作原理 本設(shè)計選用Altera公司的Cyclone系列FPGA器件EP1C3進行數(shù)據(jù)采集和處理，外接S
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賽靈思宣布交付性能最高的DSP平臺——VIRTEX-5 SXT FPGA

  • 　　賽靈思宣布開始向市場交付針對高性能數(shù)字信號處理（DSP）而優(yōu)化的65 nm Virtex-5 SXT現(xiàn)場可編程門陣列（FPGA）器件的首批產(chǎn)品。SXT平臺創(chuàng)造了DSP性能的行業(yè)新紀錄——550MHz下性能達352 GMAC，而且動態(tài)功率較上一代90nm器件相比降低35%。此外，SXT平臺還是第一個集成了串行收發(fā)器的DSP優(yōu)化的FPGA產(chǎn)品系列。 　　通過三款可滿足下一代無線和視頻應用對超高DSP帶寬和更低系統(tǒng)成本要求的新器件，Virtex-5 SXT平
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一種新型數(shù)字溫度測量電路的設(shè)計及實現(xiàn)

  • 摘　要：提出一種內(nèi)嵌時鐘功能的溫度測量電路的設(shè)計方案。測溫電路利用溫度傳感器監(jiān)測外界溫度的變化,通過振蕩器將溫度傳感器的阻值變化轉(zhuǎn)換為頻率信號的變化,實現(xiàn)模擬信號到數(shù)字信號的轉(zhuǎn)換,然后利用數(shù)字信號處理方法計算得出溫度值,實現(xiàn)溫度的測量。 關(guān)鍵詞：溫度傳感器 振蕩器 FPGA 用傳統(tǒng)的水銀或酒精溫度計來測量溫度,不僅測量時間長、讀數(shù)不方便、而且功能單一,已經(jīng)不能滿足人們在數(shù)字化時代的要求。本文提出了一種新型的數(shù)字式溫度測量電路的設(shè)計方案,該方案集成了溫度測量電路和實時日歷時鐘電路。 
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基于DSP與雙目CMOS攝像頭的數(shù)字圖像處理系統(tǒng)

  • 摘　要：介紹了基于浮點DSP處理器與雙CMOS攝像頭的數(shù)字圖像采集處理系統(tǒng),探討了系統(tǒng)的基本原理和設(shè)計方法,并給出了系統(tǒng)的實現(xiàn)方案。在該系統(tǒng)中,數(shù)據(jù)采集由兩個相互獨立的CMOS攝像頭完成,并由DSP進行圖像處理,FPGA協(xié)同DSP完成時序邏輯控制和組合邏輯控制。處理后的圖像可以通過1394接口輸出。該系統(tǒng)主要由FPGA和DSP實現(xiàn),設(shè)計靈活,具有很強的重構(gòu)性。  關(guān)鍵詞：圖像 圖像處理 DSP FPGA IEEE1394  傳統(tǒng)的數(shù)字圖像處理通常
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G.726語音編解碼器在SoPC中的實現(xiàn)

  • 摘　要：在對G.726語音編解碼標準分析的基礎(chǔ)上給出了基于FPGA的DSP設(shè)計流程,利用MATLAB/Simulink、DSP Builder和SOPC Builder工具設(shè)計了G.726語音編解碼器,通過仿真實驗驗證了所設(shè)計的編解碼器模型的正確性,實現(xiàn)了編解碼器在SoPC系統(tǒng)中的綜合。 關(guān)鍵詞：ADPCM MATLAB/Simulink DSP Builder FPGA SoPC G.726是ITU前身CCITT于1990年在G.721和G.723標準的基礎(chǔ)上提出的關(guān)于把64kbps非線性PCM信號
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基于FPGA的IPV6數(shù)據(jù)包的拆裝實現(xiàn)

  • 基于FPGA的IPV6數(shù)據(jù)包的拆裝實現(xiàn) 王志遠, 杜詩武, 曲 晶(信息工程學院 信息技術(shù)研究所,河南 鄭州 450002)  　　摘　要：介紹了一種運用FPGA將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分分離并重新封裝的方法。利用該方法,可以使IPV6數(shù)據(jù)包的拆裝處理速度達到2Gbit/s以上。 　　關(guān)鍵詞：FPGA IPV6數(shù)據(jù)包 拆裝 FIFO 　　筆者在參與國家“863”重大專題項目“高速密碼芯片及驗證平臺系統(tǒng)”的過程中,遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開,然后把數(shù)據(jù)部分送密碼芯片進行加
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SoC原型驗證技術(shù)的研究

  • SoC原型驗證技術(shù)的研究 北京清華大學微電子所(100084) 馬鳳翔 孫義和  　　摘　要：快速系統(tǒng)原型技術(shù)已成為SoC(片上系統(tǒng))驗證的主要手段之一,但大多數(shù)的原型描述仍使用Verilog/VHDL語言,描述效率低。以軟件編譯式系統(tǒng)設(shè)計(SCSD)為基礎(chǔ),提出了SoC的原型驗證流程,用Handel-C語言描述SoC原型,并直接實現(xiàn)在原型驗證硬件上;用SCSD的軟件工具、RC1000和RC200硬件平臺搭建了一個SoC原型驗證系統(tǒng)的樣機,并在樣機上完成了Lena圖像處理SoC的原型驗證;在反復
  • 關(guān)鍵字： Handel-C  SoC  軟件編譯式系統(tǒng)設(shè)計  驗證  原型  SoC  ASIC  
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