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臺積電可能調(diào)高財測 3Q成長挑戰(zhàn)兩位數(shù)

  • 　　晶圓雙雄法說本周隆重登場，臺積電在通訊與PC相關(guān)IC客戶投片積極下有機(jī)會調(diào)高原本第3季財測，單季挑戰(zhàn)兩位數(shù)成長，臺積電董事長張忠謀亦可望釋出謹(jǐn)慎、樂觀產(chǎn)業(yè)展望;而提早一天登場的聯(lián)電也預(yù)期，在先進(jìn)制程產(chǎn)能吃緊及積極價格策略奏效下，成長率表現(xiàn)也不俗，可望高個位數(shù)成長;排名晶圓代工老三的新加坡特許(Chartered Semiconductor)則是已經(jīng)率先調(diào)升資本支出至5億美元。 　　晶圓代工本周法說將登場，臺積電、世界先進(jìn)上周股價已率先表態(tài)，完成填權(quán)息，預(yù)料臺積電30日壓軸法說最為關(guān)鍵，而世界先進(jìn)第2
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基于FPGA的VGA圖象信號發(fā)生器設(shè)計

  • 1、引言 VGA（視頻圖形陣列）作為一種標(biāo)準(zhǔn)的顯示接口在視頻和計算機(jī)領(lǐng)域得到了廣泛的應(yīng)用。VGA圖像信號發(fā)生器是電視臺、電視機(jī)生產(chǎn)企業(yè)、電視維修人員常用的儀器，其主要功能就是產(chǎn)生標(biāo)準(zhǔn)的圖像測試信號。
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功率管理：用混合信號FPGA控制電壓攀升率

  • 引言(混合信號FPGA控制多電平系統(tǒng)的電壓攀升率)：隨著工藝尺度不斷縮小，器件常常需要多個電源。為了減小功耗和最大限度地提高性能，器件的核心部分一般趨向于在低電壓下工作。為了與傳統(tǒng)的器件接口，或與現(xiàn)有的I/O標(biāo)
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基于FPGA和MV-D1024E相機(jī)的圖像采集系統(tǒng)

  • 摘要：分析了MV-D1024E系列高幀頻CMOS相機(jī)的工作時序和參數(shù)，闡述了CAMERA-LINK接口協(xié)議，并對高速數(shù)據(jù)流的存儲與處理機(jī)制進(jìn)行分析，利用FPGA實現(xiàn)了相機(jī)的數(shù)據(jù)接口和控制，并設(shè)計靈活的USB接口，利用PC機(jī)作為參數(shù)輸入
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基于ARM和FPGA的電腦繡花機(jī)控制系統(tǒng)的設(shè)計

  • 電腦繡花機(jī)是隨著計算機(jī)技術(shù)、電子技術(shù)、機(jī)械加工技術(shù)的應(yīng)用發(fā)展而不斷發(fā)展起來的光、機(jī)、電一體化設(shè)備。嵌入式系統(tǒng)的發(fā)展及研究風(fēng)頭正勁，其在數(shù)字機(jī)床、智能控制等方面的應(yīng)用正逐漸改變著傳統(tǒng)的工業(yè)生產(chǎn)和服務(wù)方
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芯片-封裝協(xié)同設(shè)計方法優(yōu)化SoC設(shè)計

  • 隨著工藝節(jié)點(diǎn)和裸片尺寸不斷縮小，采用倒裝芯片封裝IC器件的消費(fèi)電子產(chǎn)品的數(shù)量日益增加。但是，倒裝芯片封...
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FPGA相關(guān)技術(shù)助力高端存儲器接口設(shè)計

  • 高性能系統(tǒng)設(shè)計師在滿足關(guān)鍵時序余量的同時要力爭獲得更高性能，而存儲器>存儲器接口設(shè)計則是一項艱巨挑戰(zhàn)。雙倍數(shù)據(jù)速率SDRAM和4倍數(shù)據(jù)速率SDRAM都采用源同步接口來把數(shù)據(jù)和時鐘(或選通脈沖)由發(fā)射器
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級聯(lián)信號處理器的FPGA實現(xiàn)

  • 摘要：現(xiàn)代通信系統(tǒng)中，數(shù)字化已成為發(fā)展的必然趨勢，數(shù)字信號處理則是數(shù)字系統(tǒng)中的重要環(huán)節(jié)。在數(shù)字信號處理方面提出一種級聯(lián)信號處理器的FPGA實現(xiàn)方案，用以取代昂貴的專用數(shù)字處理芯片。首先對級聯(lián)信號處理器做了
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新一代視頻編碼器分析介紹

  • 先進(jìn)的視頻編碼(AVC)正在慢慢地超越數(shù)字視頻的主要標(biāo)準(zhǔn)。也稱之為H.264和MPEG-4part10，其AVC編碼在1Mbit/s~2...
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基于FPGA的多通道校準(zhǔn)算法的同步實現(xiàn)

  • 　　數(shù)字信號處理模塊是接收機(jī)系統(tǒng)的核心部分，系統(tǒng)要求數(shù)字信號處理模塊能實時處理ADC變換后的數(shù)字信號，并用軟件的方法來實現(xiàn)大量的無線電功能，這些功能包括：多通道校準(zhǔn)、編解碼、調(diào)制解調(diào)、濾波、同步、盲均衡、
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基于DSP和FPGA技術(shù)的低信噪比雷達(dá)信號檢測

  • 摘要：提出一種基于DSP和FPGA技術(shù)的低信噪比情況下雷達(dá)信號檢測技術(shù)的工作原理與硬件實現(xiàn)方法，采用數(shù)字化的處理方法處理信息，取代傳統(tǒng)使用的模擬檢測技術(shù)，并對實現(xiàn)的檢測方法和關(guān)鍵算法做了詳細(xì)介紹。
    關(guān)鍵詞：高
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基于FPGA IP核的FFT實現(xiàn)

  • 對于FFT而言，很多領(lǐng)域都提出了其高速實時運(yùn)算的要求。利用FFT IP核實現(xiàn)FFT算法，并在cycloneⅡ系列的EP2C70F896C8器件上設(shè)計出處理速度為69.58 MHz的24位512點(diǎn)復(fù)數(shù)FFT處理器需29.3 μs，該方法具有效率高、速度快、周期短、靈活性強(qiáng)等特點(diǎn)。仿真結(jié)果表明此方法具有良好性能。
  • 關(guān)鍵字： FPGA  FFT  IP核    

基于FPGA的多通道校準(zhǔn)算法同步實現(xiàn)

  • 本文主要研究了多通道校準(zhǔn)算法在FPGA上的同步實現(xiàn)問題。介紹FPGA時鐘同步設(shè)計的基本原理以及用Xilinx公司的FPGA芯片Xc2v8000ff1152-5實現(xiàn)了多通道校準(zhǔn)的同步算法，極大提高了系統(tǒng)穩(wěn)定性。
  • 關(guān)鍵字： ADC  FPGA  多通道校準(zhǔn)  同步實現(xiàn)  200907  

基于FPGA的UART設(shè)計實現(xiàn)及驗證

  • 通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter，UART)是數(shù)字通信領(lǐng)域流行和廣泛使用的一種接口設(shè)備，主要用來控制符合RS 232-C協(xié)議的計算機(jī)與串行設(shè)備間的通信。普通串行外設(shè)和計算機(jī)間的通信，一般使
  • 關(guān)鍵字： FPGA  UART  設(shè)計實現(xiàn)    
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