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synopsys 文章 最新資訊

Synopsys推出下一代布局布線解決方案

  • Synopsys發(fā)布了下一代布局布線解決方案——IC Complier 2007.03版。該版本運行時間更快、容量更大、多角/多模優(yōu)化（MCMM）更加智能、而且具有改進的可預(yù)測性，可顯著提高設(shè)計人員的生產(chǎn)效率。 同時，新版本還推出了支持正在興起的45納米技術(shù)的物理設(shè)計。目前，有近百個采用IC Compiler的客戶設(shè)計正在進行中，訂單金額超過一億美元。IC Compiler正成為越來越多市場領(lǐng)先的IC設(shè)計公司在各種應(yīng)用和廣泛硅技術(shù)中的理想選擇。2007.03&nbs
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Synopsys推出IC COMPILER 2007.03版

  • 　　Synopsys 今天發(fā)布了下一代布局布線解決方案——IC Complier 2007.03 版。該版本運行時間更快、容量更大、多角/多模優(yōu)化（MCMM）更加智能、而且具有改進的可預(yù)測性，可顯著提高設(shè)計人員的生產(chǎn)效率。 　　同時，新版本還推出了支持正在興起的45納米技術(shù)的物理設(shè)計。目前，有近百個采用IC Compiler的客戶設(shè)計正在進行中，訂單金額超過一億美元。IC Compiler正成為越來越多市場領(lǐng)先的IC設(shè)計公司在各種應(yīng)用和廣泛硅技術(shù)中的理想選擇。2007.03 版的重大技術(shù)創(chuàng)新將為加速其廣
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瑞薩科技選用Synopsys IC Compiler 作為SoC設(shè)計流程解決方案

  • 　　Synopsys宣布，瑞薩科技公司已采用Synopsys IC Compiler 下一代布局布線解決方案用于產(chǎn)品IC 的設(shè)計流程。隨著瑞薩設(shè)計項目的日益復(fù)雜化，他們需要滿足各種不同功能模式下的時序安排。在全面評估了所有備選方案之后，瑞薩最終選擇了 Synopsys IC Compiler 解決方案，因為可以通過其真正的多模式功能，經(jīng)并發(fā)優(yōu)化所有時序模式，從而實現(xiàn)期望的芯片性能。瑞薩同時也獲得了轉(zhuǎn)換時間更短和使用更加簡便的優(yōu)勢。 　　瑞薩科技公司設(shè)計技術(shù)部DFM & EDA 技術(shù)開發(fā)組部門經(jīng)理
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Synopsys優(yōu)化Hercules物理驗證套件完善IBM 65nm 設(shè)計工具包

  • 　　Synopsys宣布，其Hercules™ 物理驗證套件 (PVS) 已經(jīng)實現(xiàn)了先進器件參數(shù)測量功能。該功能的開發(fā)可支持IBM 最新發(fā)布的65nm 設(shè)計工具包，從而幫助IBM晶圓代工客戶應(yīng)用Hercules工具包中的版圖原理圖一致性驗證 (LVS) 規(guī)范文件，輕松而準確地將器件特性與IBM流程相關(guān)聯(lián)。 　　作為65nm設(shè)計工具包發(fā)布的一部分，最新的Hercules設(shè)計規(guī)則檢查(DRC) 也可同時提供給IBM晶圓代工客戶。這些文件有助于提升精度并優(yōu)化性能。 　　IBM全球工程解決方案實施
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Synopsys公司中國員工自發(fā)捐資重建湘西小學(xué)

  • 全球領(lǐng)先的電子設(shè)計自動化（EDA）軟件工具領(lǐng)導(dǎo)廠商Synopsys宣布，由中國員工發(fā)起，全球員工參與的自發(fā)捐資重建的湘西永明小學(xué)新教學(xué)樓，已于2006年底順利竣工，并用上新的名字：新思永明小學(xué)。 Synopsys上海ELC(Employee Leadership Community)組織通過偶然的機會了解到，公司湖南籍員工陽小奇的家鄉(xiāng)小學(xué)因缺乏經(jīng)費而年久失修，于是自發(fā)號召Synopsys公司中國區(qū)的全體員工奉獻愛心，捐款重建位于湘西山區(qū)的永明小學(xué)。此次捐資活動于2006年6月10日正式啟動，不僅得到Sy
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Synopsys DFT MAX助珠海炬力節(jié)省90％測試成本

  • 　　Synopsys宣布，珠海炬力集成電路設(shè)計有限公司（簡稱珠海炬力）已采用Synopsys DFT MAX掃描壓縮自動化解決方案實現(xiàn)其0.13微米系統(tǒng)級芯片(SoC)設(shè)計，使測試設(shè)備相關(guān)成本降低了90％。DFT MAX通過片上掃描數(shù)據(jù)壓縮，可顯著減少高質(zhì)量制造測試所需的測試時間和測試數(shù)據(jù)量?！?nbsp;　　珠海炬力首席技術(shù)官李邵川表示：“作為便攜式多媒體播放器（PMP）SoC的領(lǐng)先供應(yīng)商，我們的產(chǎn)品設(shè)計廣泛應(yīng)用于遍布世界各地的便攜式消費電子產(chǎn)品中。因此，我們的設(shè)計團隊需要易于使用而成熟的壓縮解決方案，
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Synopsys擴展VMM方法以實現(xiàn)更高功能性驗證的生產(chǎn)效率

  • 　Synopsys宣布應(yīng)用其擴展的業(yè)界領(lǐng)先的VMM方法，幫助產(chǎn)品開發(fā)團隊更有效地定義、測量并實現(xiàn)他們的驗證目標。新一代VMM解決方案可通過三個新的部分實現(xiàn)更高的驗證生產(chǎn)效率，即VMM Planner、VMM Applications和VMM Automation。VMM Planner有助于經(jīng)理們系統(tǒng)地計劃和跟蹤驗證進展，提高驗證的可視性和可預(yù)測性；VMM Applications有助于架構(gòu)師迅速構(gòu)建有效的驗證環(huán)境，縮短測試工作臺的創(chuàng)建時間；VMM&nbs
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Synopsys公司Design Compiler拓樸繪圖技術(shù)助ST加速ASIC設(shè)計

  • 　　Synopsys宣布意法半導(dǎo)體在其90nm和65nm 的ASIC設(shè)計流程中，應(yīng)用Design Compiler拓樸繪圖技術(shù)，縮短了整個設(shè)計時間。意法半導(dǎo)體在其ASIC方法集中應(yīng)用Design Compiler拓樸繪圖技術(shù)，從而消除了設(shè)計的反復(fù)(Iteration)，實現(xiàn)了內(nèi)部設(shè)計團隊和外部客戶整個設(shè)計環(huán)節(jié)工作的順暢。 　　在ASIC模式下，設(shè)計能否按計劃完成，在很多程度上取決于設(shè)計收斂完成前，網(wǎng)表在客戶與ASIC供應(yīng)商間反復(fù)時間的縮短。Design Compil
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瑞薩科技采用Synopsys VCS解決方案和VMM方法論

  • Synopsys的SystemVerilog解決方案被用于驗證針對網(wǎng)絡(luò)、外設(shè)和消費應(yīng)用的下一代 片上互連架構(gòu) 全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）近日宣布，全球領(lǐng)先的移動、汽車和PC/音頻視頻半導(dǎo)體系統(tǒng)解決方案供應(yīng)商—瑞薩科技采用其VCS®的功能驗證解決方案，開發(fā)復(fù)雜的芯片上系統(tǒng)（SoC），并選定了VMM方法集，即《Verification Methodology Manual (VMM) for
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Synopsys公司發(fā)布DFM新系列產(chǎn)品

  • 解決45納米及以下工藝相關(guān)變異問題 創(chuàng)新的工藝識別DFM系列產(chǎn)品有助于設(shè)計者減少工藝變異的影響， 改善先進半導(dǎo)體的制造設(shè)計 全球領(lǐng)先的電子設(shè)計自動化（EDA）軟件工具領(lǐng)導(dǎo)廠商Synopsys推出了具備工藝識別功能的可制造性設(shè)計(DFM)新系列產(chǎn)品PA－DFM，用于分析45納米及以下工藝定制/模擬設(shè)計階段的工藝變異的影響。隨著工藝尺寸的日益減小，先進硅技術(shù)將引起更多如應(yīng)力工程的變異問題，這將越來越影響電路的性能。Synopsys PA-DFM系列的核心產(chǎn)品Seismos 和 P
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威捷采用Synopsys IC Compiler進行90納米設(shè)計

  • 易于移植、強有力的技術(shù)發(fā)展路線圖等優(yōu)勢使其在競爭中脫穎而出 全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）近日宣布，美國威捷半導(dǎo)體公司（Silicon Optix）采用Synopsys IC Compiler下一代布局布線解決方案，設(shè)計其高性能視頻處理器。長期以來，威捷半導(dǎo)體一直是Synopsys布局布線技術(shù)的用戶。為了轉(zhuǎn)向90納米工藝，威捷半導(dǎo)體評估了市場上所有的解決方案，并最終選定了IC Compiler，這是
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Synopsys與聯(lián)華電子合作以低功耗和DFT功能加強90納米參考流程

  • Synopsys與聯(lián)華電子合作，以低功耗和DFT功能加強90納米參考流程 針對聯(lián)華電子的90納米工藝，Synopsys的 Galaxy®設(shè)計平臺業(yè)已通過多電壓 （Multi-Vdd）功能的實戰(zhàn)驗證  全球電子設(shè)計自動化軟件工具（EDA）領(lǐng)導(dǎo)廠商Synopsys（Nasdaq: SNPS）與世界半導(dǎo)體晶圓專工領(lǐng)導(dǎo)者臺灣聯(lián)華電子共同宣布，雙方合作以Synopsys的Galaxy™ 設(shè)計解決方案平臺為基礎(chǔ)，針對聯(lián)華電子的90納米工藝，在參考設(shè)計流程中增
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華虹NEC與Synopsys攜手開發(fā)參考設(shè)計流程2.0

  • 華虹NEC選擇Synopsys作為其首選EDA供應(yīng)商  全球領(lǐng)先的電子設(shè)計自動化（EDA）軟件工具領(lǐng)導(dǎo)廠商Synopsys 與中國最先進的集成電路制造商之一上海華虹NEC電子有限公司今日宣布，雙方將攜手開發(fā)應(yīng)用于華虹NEC 0.18微米工藝的參考設(shè)計流程 2.0。華虹NEC選擇Synopsys作為其首選EDA供應(yīng)商后，將充分利用Synopsys Professional Services開發(fā)基于Synopsys Galaxy™
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Tensilica實現(xiàn)對Synopsys和Cadence支持

  • TensilicaÒ宣布增加了自動可配置處理器內(nèi)核的設(shè)計方法學(xué)以面對90納米工藝下普通集成電路設(shè)計的挑戰(zhàn)。這些增加支持Cadence和Synosys工具的最新能力，包括自動生成物理設(shè)計流程腳本，自動輸入用戶定義的功耗結(jié)構(gòu)以及支持串繞分析。 Tensilica利用Synopsys的Power Compiler™的低功耗優(yōu)化能力，同時在Xtensa LX內(nèi)核和所有設(shè)計者自定義的擴展功能中自動的插入精細度時鐘門控，從而降低動態(tài)功耗。新自動生成的Xtensa布線腳本可
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在設(shè)計過程早期發(fā)現(xiàn)并解決問題

  • 在設(shè)計過程早期發(fā)現(xiàn)并解決問題 在電路和系統(tǒng)設(shè)計中，需要昂貴的驗證周期這一點證明電子設(shè)計師和 EDA 供應(yīng)商也都是不免要犯錯的，所以最好使用能避免大多數(shù)錯誤的工具和方法?！　∫?點　　●  制造能力與工程生產(chǎn)率之間的差距繼續(xù)在加大?！　　?nbsp; 現(xiàn)在不存在標準的驗證方法。　　●  形式證明可減小設(shè)計師對功能驗證的依賴性?！　　?nbsp; 由于深亞微米加工存在許多電子物理學(xué)問題，電路驗證的重要性正在增加?！　≡O(shè)計驗證需要每個設(shè)計小組花費大量的時間和資源。設(shè)計驗證費用與設(shè)計的規(guī)模和
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synopsys介紹

Synopsys公司(Nasdaq: SNPS)是為全球集成電路設(shè)計提供電子設(shè)計自動化(EDA)軟件工具的主導(dǎo)企業(yè)。為全球電子市場提供技術(shù)先進的IC設(shè)計與驗證平臺，致力于復(fù)雜的芯片上系統(tǒng)(SoCs)的開發(fā)。同時，Synopsys公司還提供知識產(chǎn)權(quán)和設(shè)計服務(wù)，為客戶簡化設(shè)計過程，提高產(chǎn)品上市速度。 Synopsys公司總部設(shè)在美國加利福尼亞州Mountain View，有超過60家分公司分布在北美 [ 查看詳細 ]

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