- 作者：王 曦 王立德 劉 彪 丁國君
0 引言內燃機車在實際應用中仍占有很大的比重，比如在貨運及調車運轉方面發(fā)揮著重要的作用，且隨著科學技術的發(fā)展，對機車的可靠性，安全性及高效性提出了更高的要求。因此，基于
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無觸點化 SOC 邏輯控制 IP核 CAN
- 嵌入式計算作為新一代計算系統的高效運行方式，應用于多個高性能領域，如陣列信號處理、核武器模擬、計算流體動力學等。在這些科學計算中，需要大量的浮點矩陣運算。而目前已實現的浮點矩陣運算是直接使用VHDL語言編
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Altera 浮點 IP核 點矩陣
- 摘要 IP核的廣泛應用提高了電路集成的效率。由于眾多功能各異的IP核集成在電路中，完善的測試機制是確保其正常工作的前提。因此，如何對IP核進行測試成為復用IP核技術必須解決的問題。IEEE Std 1500提供了IP核的測試
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IP核 IEEE 1500 Wrapper Hamming碼
- 摘要 利用FPGA IP核設計了一種快速、高效的傅里葉變換系統。針對非整數倍信號周期截斷所導致的頻譜泄露問題，提出了一種通過時輸入信號加窗處理來抑制頻譜泄露的方法。利用Modelsim和Matlab對設計方案進行了仿真，同
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FFT FPGA IP核 加窗處理
- SOPC(System On a Programmable Chip,可編程芯片系統)就是在一個可編程芯片上實現一個電子系統的技術。SOPC是可編程邏輯器件技術和SoC(System on Chip)技術發(fā)展與
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Avalon總線 SHT11 溫濕度傳感器 IP核
- 一種CORDIC協處理器核的設計與實現, 隨著航天技術的發(fā)展，航天任務對于導航計算機的性能要求越來越高。導航計算機除了要對傳感器數據進行采集，與控制系統進行實時通訊，還要能進行實時的計算。盡管目前航天任務中使用的處理器芯片性能越來越強，但大多
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FPGA IP核 CORDIC 協處理器
- Arasan今日宣布，其MIPI DPHY IP核Ver1.2版本即刻開始供貨，該版本在TSMC 28納米HPC工藝之上可支持高達2.5Gbps的速度。該IP產品將很快被移植到TSMC最新的HPC Plus工藝上。Arasan的MIPI DPHY IP核向下兼容以前的標準版本，需要時能夠以1.5Gbps或更低的速度運行。
Arasan提供的最新DPHY IP產品使用了全新的、正在申請專利的DPHY架構，該架構為實現超低功耗和超小面積而優(yōu)化了DPHY設計。
“我們利用自己在DPH
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Arasan IP核
- 今天帶大家來設計一個自定義的IP核，我們從最基本的做起，包括datasheet 的理解，設計的整體框架，AD轉換代碼的編寫，仿真，Avalon-MM總線接口的編寫，硬件系統還是基于上次的硬件系統，不過我們不再用altera給我們提供的IP核了，我們要自己做一個，有時候我們找不到他們提供的IP核，或者有些IP核是收費的，這個時候我們就可以自己來編寫自己的IP，雖然沒有官方的那么標準，但是用來做一些實驗還是沒什么問題的。
這次實驗我用的是原來我那塊板子，因為那塊板子上有AD轉換芯片，而我們上次搭建的
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SOPC IP核
- 引 言
Leon2是GaislerResearch公司于2003年研制完成的一款32位、符合IEEE-1754(SPARCVS)結構的處理器IP核。它的前身是歐空局研制的Leon以及ERC32。Leon2的目標主要是權衡性能和價格、高的可靠性、可移植性、可擴展性、軟件兼容性等.其內部硬件資源可裁剪(可配置)、主要面向嵌入式系統，可以用FPGA/CPLD和ASIC等技術實現。Leon2處理器的片上資源如下：分離的指令和數據Cache、硬件乘法器和除法器、中斷控制器、具有跟蹤緩沖器的調試支持單元(D
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Leon2 IP核
- 引 言
Leon2是GaislerResearch公司于2003年研制完成的一款32位、符合IEEE-1754(SPARCVS)結構的處理器IP核。它的前身是歐空局研制的Leon以及ERC32。Leon2的目標主要是權衡性能和價格、高的可靠性、可移植性、可擴展性、軟件兼容性等.其內部硬件資源可裁剪(可配置)、主要面向嵌入式系統，可以用FPGA/CPLD和ASIC等技術實現。Leon2處理器的片上資源如下：分離的指令和數據Cache、硬件乘法器和除法器、中斷控制器、具有跟蹤緩沖器的調試支持單元(D
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Leon2 IP核
- 有機發(fā)光二極管又稱為有機電激光顯示(Organic Light-Emitting Diode，OLED)，，具有自發(fā)光的特性，采用非常薄的有機材料涂層和玻璃基板，當有電流通過時，這些有機材料就會發(fā)光，而且OLED顯示屏幕可視角度大，并且能夠節(jié)省電能。
基于Zynq的OLED驅動設計
文章闡述了OLED的特性和SPI控制方式，給出了設計流程和硬件電路圖。利用Zynq的PL部分完成了OLED驅動的IP核，利用Zynq的PS部分實現了OLED的驅動程序設計。通過AXI總線實現PL和PS的通信。最
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IP核 Linux
- 0.引言
FIR(Finite Impulse Response，有限沖擊響應)數字濾波器具有穩(wěn)定性高、可以實現線性相位等優(yōu)點，廣泛被應用于信號檢測與處理等領域[1,2]。由于FPGA(Field Programmable Gate Array，現場可編程門陣列)基于查找表的結構和全硬件并行執(zhí)行的特性，如何用FPGA 來實現高速FIR 數字濾波器成了近年來數字信號處理領域研究的熱點。目前，全球兩大PLD 器件供應商都提供了加速FPGA 開發(fā)的IP(IntelligentProperty，知識產權
- 關鍵字：
IP核 FIR 低通濾波器
- 0.引言
FIR(Finite Impulse Response，有限沖擊響應)數字濾波器具有穩(wěn)定性高、可以實現線性相位等優(yōu)點，廣泛被應用于信號檢測與處理等領域[1,2]。由于FPGA(Field Programmable Gate Array，現場可編程門陣列)基于查找表的結構和全硬件并行執(zhí)行的特性，如何用FPGA 來實現高速FIR 數字濾波器成了近年來數字信號處理領域研究的熱點。目前，全球兩大PLD 器件供應商都提供了加速FPGA 開發(fā)的IP(IntelligentProperty，知識產權
- 關鍵字：
IP核 低通濾波器
- 項目背景及可行性分析
2.1 項目名稱及摘要：
基于fpga二維小波變換核的實時可重構電路
現場可編程門陣列為可進化設計提供了一個理想的模板。FPGAs 提供了一個硬件環(huán)境 ，這個環(huán)境 可將邏輯物理實現和 布線資源 按照為了特定功能所配置的比特流而重新組織構建起來。 RTR設計工具 繞過傳統的fpga綜合以及比特流生成過程 使可進化設計成為可能. JBits工具套裝 就為在Xilinx 的Virtex系列和4000系列設備上進行RTR設計提供了一個設計環(huán)境。
這個項目旨在利用J
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fpga 小波變換 IP核
- 摘要：隨著集成電路產業(yè)的迅速發(fā)展，集成電路設計的安全性越來越受重視，電路設計盜用等知識產權(IP)侵權行為嚴重損害了設計者和消費者的權益，阻礙了集成電路產業(yè)的發(fā)展。本文提出了一種有效保護IP核的方法，通過設計一個保護電路，控制功能電路運行結果的輸出，在消費者未取得合法授權時,功能電路無法正常工作，從而達到了保護電路的目的。本文將該保護方法運用在實際的電路上，進行仿真并驗證了該方法的有效性。
引言
隨著片上系統SoC的迅速發(fā)展，IP復用的知識產權保護問題日益嚴重，危害了設計者和消費者的權益[
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IP核 FPGA 寄存器 IP固核 RDY 201412
ip核介紹
IP核概述
IP核則是一段具有特定電路功能的硬件描述語言程序，該程序與集成電路工藝無關，可以移植到不同的半導體工藝中去生產集成電路芯片。利用IP核設計電子系統，引用方便，修改基本元件的功能容易。具有復雜功能和商業(yè)價值的IP核一般具有知識產權，盡管IP核的市場活動還不規(guī)范，但是仍有許多集成電路設計公司從事IP核的設計、開發(fā)和營銷工作。IP核有兩種，與工藝無關的VHDL程序稱為軟核；具有特定電路 [
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