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fpga-to-asic 文章 最新資訊

基于CycloneII和MSP430的網(wǎng)絡數(shù)據(jù)加密實現(xiàn)

基于NiosII的視頻采集與DVI成像研究及實現(xiàn)

  • 摘要：采用FPGA作為視頻采集控制和圖像處理芯片，配置NiosII軟核，在FPGA片內完成圖像處理和圖像顯示控制，...
  • 關鍵字： FPGA  NiosII  DVI  圖像采集  

基于FPGA實現(xiàn)多路模擬信號自適應采集系統(tǒng)

  • 主要介紹基于FPGA實現(xiàn)多路模擬信號自適應采集系統(tǒng)的設計。該系統(tǒng)主要包括軟件和硬件兩部分：硬件主要采用FPGA芯片，AD7982-1，ADG406和運放AD824來搭建硬件平臺；軟件包括FPGA程序和事后數(shù)據(jù)處理程序。系統(tǒng)采用動態(tài)8位量化方式克服了固定8位量化對信號采集精度的影響，目前已成功用于產品中。
  • 關鍵字： FPGA  多路  采集系統(tǒng)  模擬信號    

i-IP（唐芯微電子）將推出Altera SIV ASIC/SOC驗證平臺

  • 　　I-IP(唐芯微電子)此前推出的Xilinx雙V5 ASIC/SOC原型驗證平臺，經(jīng)過不斷的市場滲透，滿足了一部分需要超大規(guī)模存儲空間、超高性能科學計算能力的客戶需求，隨著對客戶的深入了解，針對客戶對單芯片大容量ASIC/SOC 原型驗證板產品的需求，公司著手組織研發(fā)資源，利用 ALTERA 最新工藝、主頻更快、功耗更低的高性能FPGA 器件，將全力推出 Altera Stratix IV 360 530 820 可堆疊 ASIC/SOC 原型驗證平臺(MB3100-A3/5/8)。配合尖端的 DDR
  • 關鍵字： 唐芯微電子  ASIC  SOC  驗證平臺  

低碼率語音編碼MELP聲碼器的SOPC實現(xiàn)

  • 摘要：討論了低碼率語音編碼MELP的編解碼過程，有效降低了語音編碼碼率并能使說話者個人語音特征減弱，特...
  • 關鍵字： SOPC  MELP  語音編碼  FPGA  NiosII  

SignalTapII ELA的FPGA在線調試技術

  • 通過對FPGA內部信號的捕獲測試，可以實現(xiàn)對系統(tǒng)設計缺陷的實時分析和修正。與外部測試設備相比，可以總結出SignalTapII ELA的幾點優(yōu)越性：不占用額外的I／O引腳，不占用PCB上的空間，不破壞信號的時序和完整性，不需額外費用；從多方面證實，該測試手段可以減少調試時間，縮短設計周期。
  • 關鍵字： SignalTapII  FPGA  ELA  在線調試    

誰會在代工投資“盛宴”中缺席？

  • 　　在前3年之前全球代工總是在看前4大的動向，包括臺積電、聯(lián)電、中芯國際及特許。然而，臺積電一家獨大，聯(lián)電居老二似乎也相安無事。 　　自AMD分出Globalfoundries，及ATIC又兼并特許，再把Globalfoundries與特許合并在一起。表面上看少了一個特許，實際上由于Globalfoundries在其金主支持下積極建新廠，在代工業(yè)界引發(fā)了波浪,至少誰將成為老二成為話題。 　　加上存儲器大享三星近期開始投資代工，放言要接高通的手機芯片訂單;加上fabless大廠Xilinx改變策略，把2
  • 關鍵字： 臺積電  FPGA  28nm  

基于FPGA的RS485接口誤碼測試儀的設計和實現(xiàn)

  • 介紹了一種基于FPGA的誤碼測試儀的設計原理、實現(xiàn)過程及調試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口，具有原理簡單、接口獨特、功能豐富等特點，系統(tǒng)具有較好的可擴展性。
  • 關鍵字： FPGA  485  RS  接口    

子帶分解的自適應濾波器的FPGA實現(xiàn)

  • 基于子帶分解的自適應濾波器在提高收斂性能的同時又可以節(jié)省一定的計算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7．2進行子帶分解的NLMS算法的自適應濾波器現(xiàn)場可編程門陣列設計，利用Simulink和ModelSim對設計方案進行了模型仿真和功能仿真，達到較好的效果。
  • 關鍵字： FPGA  分解  自適應濾波器    

常用FPGA/CPLD四種設計技巧

  • 常用FPGA/CPLD四種設計技巧,FPGA/CPLD的設計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日
  • 關鍵字： 技巧  設計  FPGA/CPLD  常用  

AEMB軟核處理器的SoC系統(tǒng)驗證平臺的構建

基于FPGA的RS485接口誤碼測試儀的設計

  • 摘要：介紹了一種基于FPGA的誤碼測試儀的設計原理、實現(xiàn)過程及調試經(jīng)驗。該誤碼測試系統(tǒng)使用RS485接口...
  • 關鍵字： FPGA  RS485  誤碼測試儀  

可實現(xiàn)快速鎖定的FPGA片內延時鎖相環(huán)設計

  • 摘要：延時鎖相環(huán)(DLL)是一種基于數(shù)字電路實現(xiàn)的時鐘管理技術。DLL可用以消除時鐘偏斜，對輸入時鐘進行分頻、倍頻、移相等操作。文中介紹了FPGA芯片內DLL的結構和設計方案，在其基礎上提出可實現(xiàn)快速鎖定的延時鎖相環(huán)
  • 關鍵字： FPGA  延時  鎖相環(huán)    

使用SignalTap II邏輯分析儀調試FPGA

  • 摘 要 ：本文介紹了可編程邏輯器件開發(fā)工具Quartus II 中SingalTap II 嵌入式邏輯分析器的使用，并給出一個具體的設計實例，詳細介紹使用SignalTap II對FPGA調試的具體方法和步驟。
    關鍵字 ： SignalTap；硬件調試
  • 關鍵字： SignalTap  FPGA  邏輯分析儀  調試    

復用器重構降低FPGA成本

  • 摘 要： 本文介紹了一種新的復用器重構算法，能夠降低FPGA實際設計20％的成本。該算法通過減少復用器所需查找表（LUT）的數(shù)量來實現(xiàn)。算法以效率更高的4:1復用器替代2:1復用器樹。算法性能的關鍵在于尋找總線上出現(xiàn)的
  • 關鍵字： FPGA  復用器    
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