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fpga-ask 文章 最新資訊

基于FPGA的語音端點檢測

  • 基于FPGA的語音端點檢測,語音端點檢測就是從背景噪聲中找到語音的起點和終點，其目標是要在一段輸入信號中將語音信號同其他信號(如背景噪聲)分離并且準確地判斷出語音的端點。研究表明，即使在安靜的環(huán)境中，一半以上的語音識別系統(tǒng)識別錯誤
  • 關鍵字： 檢測  語音  FPGA  基于  

基于FPGA的AD9910控制設計

  • 為了滿足目前對數(shù)據(jù)處理速度的需求，設計了一種基于FPGA+DDS的控制系統(tǒng)。根據(jù)AD9910的特點設計了控制系統(tǒng)的硬件部分，詳細闡述了電源、地和濾波器的設計。設計了FPGA的軟件控制流程，給出了流程圖和關鍵部分的例程，并對DDS AD9910各個控制寄存器的設置與時序進行詳細說明，最后給出了實驗結果。實驗結果證明輸出波形質量高、效果好。對于頻率源的設計與實現(xiàn)具有工程實踐意義。
  • 關鍵字： FPGA  9910  AD  控制設計    

賽靈思和Synopsys聯(lián)手推出業(yè)界首部開發(fā)方法手冊

  • 　　全球可編程邏輯解決方案領先廠商賽靈思公司(NASDAQ:XLNX))今日宣布與全球半導體設計、驗證和制造領域的軟件及 IP 領先廠商Synopsys公司(NASDAQ：SNPS)聯(lián)手推出《 FPGA的原型開發(fā)方法手冊》(FPMM)，這是一本介紹如何使用 FPGA 作為平臺進行片上系統(tǒng)(SoC)開發(fā)的實用指南。FPMM 收錄了眾多公司的設計團隊在設計和驗證方面的寶貴經(jīng)驗。
  • 關鍵字： 賽靈思   FPGA   

大規(guī)?，F(xiàn)場可編程門陣列（FPGA）開發(fā)系統(tǒng)電源設計研究

  • 摘要：以Xilinx的FPGA為例，介紹了FPGA開發(fā)系統(tǒng)的電源要求和功耗，并給出了采用線性低壓降（LDO）穩(wěn)壓器,DC/DC調整器,DC/DC控制器和電源模塊等幾種電源解決方案。 關鍵詞：現(xiàn)場可編程門陣列；電源設計；DC/DC變換器
  • 關鍵字： 系統(tǒng)  電源  設計  研究  開發(fā)  FPGA  現(xiàn)場  可編程  陣列  大規(guī)模  

NI發(fā)布全新 LabWindows?/CVI 2010

  • 　　美國國家儀器有限公司(National Instruments，簡稱NI)近日發(fā)布了全新NI LabWindows/CVI 2010，該軟件可基于驗證過的ANSI C測試測量軟件平臺，提供更高的開發(fā)效率，并簡化FPGA通信的復雜度。此外，NI還發(fā)布了LaWindows/CVI 2010 Linux Run-Time模塊和LabWindows/CVI 2010實時模塊，可擴展開發(fā)環(huán)境至Linux和實時操作系統(tǒng)中。
  • 關鍵字： NI  FPGA  

28納米FPGA: 降低功耗 提高帶寬

  • 　　低功耗和高帶寬是下一代高端設計的兩個主要需求。對全球范圍多個應用領域的調研表明，以相同甚至更低功耗及成本來實現(xiàn)更大的帶寬已成為大勢所趨?，F(xiàn)在應對帶寬不斷增長的技術是演進中的40G和100G系統(tǒng)(以及即將出現(xiàn)的400G系統(tǒng))。設計下一代FPGA來滿足目前對寬帶和低功耗需求的難度越來越大?！　?/li>
  • 關鍵字： Altera  FPGA  

基于FPGA的CMI編碼系統(tǒng)設計

  • 摘要：提出了一種基于FPGA并利用Verilog HDL實現(xiàn)的CMI編碼設計方法。研究了CMI碼型的編碼特點，提出了利用Altera公司CycloneⅡ系列EP2C5Q型號FPGA完成CMI編碼功能的方案。在系統(tǒng)程序設計中，首先產(chǎn)生m序列，然后程序
  • 關鍵字： FPGA  CMI  編碼  系統(tǒng)設計    

FPGA實現(xiàn)時分多址的一種改進型方法

  • 摘要：利用FPGA實現(xiàn)時分多址的方法有很多種，但大多數(shù)方法都對FPGA芯片資源的占用非常巨大。針對這一問題，提出一種改進型方法來實現(xiàn)時分多址。通過使用FPGA芯片內部的雙口隨機訪問存儲器(雙口RAM)，利用同一塊RAM采
  • 關鍵字： FPGA  時分  多址  改進型    

基于FPGA的數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)

  • 摘要：基于FPGA和USB2．0的技術方案，設計了一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)是以Altera公司的FPGA芯片EP2C5T144為主控芯片，以Cypress公司的EZ-USB FX2芯片為傳輸手段設計實現(xiàn)的。首先詳細介紹了整體系統(tǒng)的
  • 關鍵字： FPGA  數(shù)據(jù)采集系統(tǒng)    

基于FPGA+DSP的雷達高速數(shù)據(jù)采集系統(tǒng)的實現(xiàn)

  • 摘要：激光雷達的發(fā)射波及回波信號經(jīng)光電器件轉換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點，對其進行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時，A/D轉換器與數(shù)字信號處理器直接連接會導致數(shù)據(jù)傳輸不
  • 關鍵字： FPGA  DSP  雷達  高速數(shù)據(jù)    

數(shù)字基帶傳輸系統(tǒng)的FPGA設計與實現(xiàn)

  • 摘要：為了提高系統(tǒng)的集成度和可靠性，降低功耗和成本，增強系統(tǒng)的靈活性，提出一種采用非常高速積體電路的硬件描述語言(VHDL語言)來設計數(shù)字基帶傳輸系統(tǒng)的方法。詳細闡述數(shù)字基帶傳輸系統(tǒng)中信號碼型的設計原則，數(shù)
  • 關鍵字： FPGA  數(shù)字基帶  傳輸系統(tǒng)    

Altera有望2012年成FPGA龍頭

  • 　　市場分析師預測，全球營收排名第二大的可程序化邏輯組件供貨商Altera，有機會在2012年初取代該市場龍頭Xilinx躍上第一大供貨商位置。 　
  • 關鍵字： Altera  FPGA  

FPGA實現(xiàn)IRIG-B(DC)碼編碼和解碼的設計

  • 為達到IRIG-B碼與時間信號輸入、輸出的精確同步，采用現(xiàn)代化靶場的IRIG-B碼編碼和解碼的原理，從工程的角度出發(fā)，提出了使用現(xiàn)場可編程門陣列(FPGA)來實現(xiàn)IRIG-B碼編碼和解碼的設計方案和體系結構，設計中會涉及到幾個不同的時鐘頻率，F(xiàn)PGA對時鐘的同步性具有靈活性、效率高、且功耗低?？垢蓴_性好的特點。結果表明，F(xiàn)PGA能夠確保為從設備提供同源的時鐘基準，使時鐘與信號的延遲控制在200 ns以內，從而得到了IRIG-B碼與時間精確同步的效果。
  • 關鍵字： IRIG-B  FPGA  DC  編碼    

基于FPGA與DSP的雷達高速數(shù)據(jù)采集系統(tǒng)

  • 激光雷達的發(fā)射波及回波信號經(jīng)光電器件轉換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點，對其進行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時，A／D轉換器與數(shù)字信號處理器直接連接會導致數(shù)據(jù)傳輸不及時，影響系統(tǒng)可靠性、實時性。針對激光雷達回撥信號，提出基于FPGA與DSP的高速數(shù)據(jù)采集系統(tǒng)，利用FPGA內部的異步FIFO和DCM實現(xiàn)A／D轉換器與DSP的高速外部存儲接口(EMIF)之間的數(shù)據(jù)傳輸。介紹了ADC外圍電路、工作時序以及DSP的EMIF的設置參數(shù)，并對異步FIFO數(shù)據(jù)讀寫進行仿真，結合硬件結構詳細地
  • 關鍵字： FPGA  DSP  雷達  高速數(shù)據(jù)    

高精度DDFS信號源FPGA實現(xiàn)

  • 為進行高精度信號源的設計，同時降低設計成本，以Cyclone II系列低端FPGA為核心，利用直接頻率合成技術，對正弦信號等數(shù)據(jù)進行1／4周期壓縮存儲到ROM中，在外部時鐘頻率為50 MHz，實現(xiàn)了正弦信號源的設計，同時，實現(xiàn)三角波、鋸齒波、矩形脈沖及2-ASK、2-PSK和2-FSK等數(shù)字調制信號，系統(tǒng)還具有掃頻、指定波形次數(shù)等功能。仿真結果表明，信號源精度高，頻率調整步進可達0．034 92 Hz，頻率范圍為0．034 92 Hz～9．375 MHz，制作成本低，功能豐富。
  • 關鍵字： DDFS  FPGA  高精度  信號源    
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