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TMS320C61416控制FPGA數(shù)據(jù)加載設計
- TMS320C61416控制FPGA數(shù)據(jù)加載設計,本文提出了采用通過市面上常見的Flash ROM芯片替代專用PROM的方式,通過DSP的外部高速總線進行FPGA加載;既節(jié)約了系統(tǒng)成本,也能達到FPGA上電迅速加載的目的;特別適用于在FPGA調(diào)試后期,待固化程序的階段。下面以兩片Xilinx公司Virtex-4系列XC4VLX60芯片為例,詳細介紹采用TI公司的TMS320C61416 DSP控制FPGA芯片數(shù)據(jù)加載的軟硬件設計。
- 關鍵字: 加載 設計 數(shù)據(jù) FPGA 控制 TMS320C61416
Altera發(fā)布業(yè)界第一款28-nm FPGA開發(fā)套件
- 2011年9月7號,北京——Altera公司(NASDAQ:ALTR)今天宣布開始提供第一款帶有28-nm FPGA的開發(fā)套件——Stratix V GX FPGA信號完整性套件,在推動業(yè)界28-nm FPGA發(fā)展方面樹立了新里程碑。這一全功能套件支持設計工程師加速高性能系統(tǒng)的設計和開發(fā),滿足了業(yè)界對提高帶寬的需求。Stratix V GX FPGA信號完整性開發(fā)套件為用戶提供的平臺能夠測量并評估從600 Mbps到12.5 Gbps的收發(fā)器鏈路性能。
- 關鍵字: Altera FPGA Stratix V GX
多時鐘域數(shù)據(jù)傳遞的Spartan-II FPGA實現(xiàn)
- 本文采用FPGA來設計一款廣泛應用于計算機、Modem、數(shù)據(jù)終端以及許多其他數(shù)字設備之間的數(shù)據(jù)傳輸?shù)膶S卯惒讲⑿型ㄐ沤涌谛酒?,實現(xiàn)了某一時鐘域(如66 MHz)的8位并行數(shù)據(jù)到另一低時鐘域(如40 MHz)16位并行數(shù)據(jù)的異步轉(zhuǎn)換,并且客戶可以根據(jù)自己的要求進行數(shù)據(jù)定義。完成數(shù)據(jù)在不同時鐘域間的正確傳遞的同時防止亞穩(wěn)態(tài)的出現(xiàn),保持系統(tǒng)的穩(wěn)定,是電路設計的關鍵。
- 關鍵字: Spartan-II FPGA 多時鐘域 數(shù)據(jù)
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