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fpga+dsp 文章 最新資訊

基于FPGA的雙口RAM與PCI9O52接口設計

  • 摘要：為了解決PCI9052和雙口RAM之間讀寫時序不匹配的問題，本設計采用可編程器件來實現(xiàn)它們之間的接口電路。此電路可以使系統(tǒng)更加緊湊。核心邏輯部分采用有限狀態(tài)機實現(xiàn)，使控制邏輯直觀簡單，提高了設計效率。
    通
  • 關(guān)鍵字： FPGA  PCI9  RAM  PCI    

一種基于FPGA技術(shù)的智能導盲犬設計

  • 引言隨著信息化和數(shù)字化的發(fā)展，現(xiàn)在社會中人們的生活變得更加豐富多彩，生活更加便利。但是有一種...
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ADI推出SHARC DSP產(chǎn)品組合

  • 　　Analog Devices, Inc.，全球領先的高性能信號處理解決方案供應商，最新推出32位浮點數(shù)字信號處理器SHARC產(chǎn)品組合的最新成員——SHARC 2148x及SHARC 2147x系列。 高性能SHARC 2148x及低功耗SHARC 2147x系列處理器憑借集成高達5Mb 的存儲器，為各種應用提高了單芯片、浮點信號處理精度，并為便攜式設備實現(xiàn)了高端系統(tǒng)功能。 通過SHARC 2148x及SHARC 2147x處理器，設計師可以利用端到端 SHARC 系列的代碼兼容
  • 關(guān)鍵字： ADI  DSP  SHARC  

甚于ARM和FPGA的全彩獨立視頻LED系統(tǒng)

  • 目前，顯示屏按數(shù)據(jù)的傳輸方式主要有兩類:一類是采用與計算機顯示同一內(nèi)容的實時視頻屏;另一類為通過USB、以太網(wǎng)等通信手段把顯示內(nèi)容發(fā)給顯示屏的獨立視頻源顯示屏，若采用無線通信方式，還可以隨時更新顯示內(nèi)容，靈
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基于IPTV系統(tǒng)中的FPGA供電問題解

  • IPTV視頻廣播中采用FPGA作為編碼和解碼平臺的好處是明顯的。然而，為FPGA供電可能是一個挑戰(zhàn)，而采用根據(jù)電源要求設計的專用電源管理器件，如MIC68200，將極大地縮短新系統(tǒng)的上市時間。
  • 關(guān)鍵字： 供電  問題  FPGA  系統(tǒng)  IPTV  基于  通信協(xié)議  

CEVA發(fā)布針對6Gbps固態(tài)硬盤應用的SATA3.0 IP

  • 　　全球領先的硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器(DSP)內(nèi)核授權(quán)廠商CEVA公司宣布提供CEVA-SATA3.0設備控制器IP。基于與固態(tài)硬盤 (SSD) 客戶廣泛的合作經(jīng)驗，CEVA公司已經(jīng)提升其SATA設備控制器IP性能，提供 6Gbps 線路速率 (line rate) 以實現(xiàn)更快的數(shù)據(jù)傳輸，使得吞吐量較上代產(chǎn)品提高一倍。該IP已經(jīng)授權(quán)予一家領先的閃存半導體制造商，用于其未來的固態(tài)硬盤設計中。 　　CEVA-SATA3.0 IP 采用最新的原生指令排序 (Native Co
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基于ADSP-BF561的車輛輔助駕駛系統(tǒng)硬件設計

FPGA的嵌入式系統(tǒng)USB接口設計

  • FPGA的嵌入式系統(tǒng)USB接口設計,摘要：設計基于FPGA的IP-BX電話應用系統(tǒng)，用于傳統(tǒng)的電話網(wǎng)絡(PSTN)與PC機之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機之間提供數(shù)據(jù)和命令通道，從
  • 關(guān)鍵字： 接口  設計  USB  系統(tǒng)  嵌入式  FPGA  

DSP實現(xiàn)3G LTE應用技術(shù)簡介

  • DSP實現(xiàn)3G LTE應用技術(shù)簡介,3G LTE是第三代伙伴計劃(3GPP)的一個高級標準，為廣域網(wǎng)提供下一代寬帶無線技術(shù)。 與以前各階段的3GPP相比，3G LTE的目標是更高的吞吐量、更低的時延以及高效的IP回程，提供一種新的可以大規(guī)模部署的移動網(wǎng)絡技術(shù)，預
  • 關(guān)鍵字： 應用技術(shù)  簡介  LTE  3G  實現(xiàn)  DSP  

FPGA 協(xié)處理的進展

  • 對許多包含并行性或可流水化的算法而言，由于裕量連接帶寬可實現(xiàn)用戶自定義的數(shù)據(jù)通路，這樣，邏輯可在一個時鐘周期內(nèi)訪問存儲器或訪問另一個邏輯塊的結(jié)果，從而使FPGA的持續(xù)性能可接近峰值性能。由于固定架構(gòu)具備預先確定的用以實現(xiàn)不同功能的邏輯塊集合，所以可以為FPGA配置支持某種給定算法的最優(yōu)邏輯函數(shù)比例來實現(xiàn)器件資源的最佳利用。




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基于高速幀同步和相位模糊估計法的FPGA實現(xiàn)

Altera Stratix IV GT FPGA與QSFP實現(xiàn)互操作性

  • 　　Altera 公司今天宣布其Stratix® IV GT FPGA 實現(xiàn)了與Avago公司 的 40G 四通道小型可插拔 (QSFP) 光學模塊的互操作性。QSFP 光學模塊在單條光纖電纜鏈路上數(shù)據(jù)速率為 40-Gbps。利用 Stratix IV GT FPGA 中特有的 11.3-Gbps 嵌入式收發(fā)器，設計人員現(xiàn)在可以運用 FPGA 的靈活性和性能優(yōu)勢在其線卡中將 40G QSFP 光學模塊橋接到其它器件，從而增加總系統(tǒng)帶寬。 　　QSFP 是一些計算及電信應用中使用的高性能交換機、路
  • 關(guān)鍵字： Altera  FPGA  Stratix  QSFP  

基于FPGA的DDS設計

  • 摘要：利用現(xiàn)場可編程門陣列(FPGA)設計并實現(xiàn)直接數(shù)字頻率合成器(DDS)。結(jié)合DDS的結(jié)構(gòu)和原理，給出系統(tǒng)設計方法，并推導得到參考頻率與輸出頻率間的關(guān)系。DDS具有高穩(wěn)定度，高分辨率和高轉(zhuǎn)換速度，同時利用Ahera公司
  • 關(guān)鍵字： FPGA  DDS    

基于FPGA的時間間隔測量模塊設計

  • 摘要：介紹一種基于FPGA技術(shù)的時間間隔測量方法，通過分析FPGA的主要技術(shù)優(yōu)勢及其在工業(yè)控制領域中所處的重要地位，給出設計時間間隔測量模塊所選用的FPGA器件并進行硬件設計，以及所選用的軟件并進行軟件設計。描述
  • 關(guān)鍵字： FPGA  時間間隔測量  模塊設計    

基于雙DSP的大功率變流器通用控制平臺的設計

  • 基于雙DSP的大功率變流器通用控制平臺的設計, 摘要：介紹一種大功率變流器通用控制平臺，是以TMS320C6713B為浮點算法運算核，TMS320F2812為系統(tǒng)定點控制核的雙DSP的控制系統(tǒng)架構(gòu)。詳細分析該系統(tǒng)設計各模塊硬件電路和軟件程序設計。該系統(tǒng)控制平臺運算性能強，
  • 關(guān)鍵字： 控制  平臺  設計  通用  變流器  DSP  大功率  基于  
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