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利用FPGA實(shí)現(xiàn)攝像機(jī)傳感器接口

  • 　　圖像傳感器可以說是在數(shù)字視頻或靜止相機(jī)中視頻或靜止圖像處理流水線的最重要部分。如果沒有傳感器，就沒有圖像信號可進(jìn)行處理。眾所周知傳感器是非標(biāo)準(zhǔn)化的。在采用的方案中，它們有以下的不同之處： 　　轉(zhuǎn)換可見光或紅外光為電信號的方式;尤其是在該信號離開這塊芯片之前，對這個(gè)信號采用的編碼和壓縮(有時(shí))的方式。 　　對傳感器內(nèi)部的寄存器進(jìn)行編程的方式，以調(diào)整增益、曝光時(shí)間、傳感器模式(如線性、HDR)，傳感器圖像坐標(biāo)等。 　　實(shí)現(xiàn)特殊功能的方式，如高(或?qū)?動(dòng)態(tài)范圍(HDR/WDR);例如通過在同一封裝中的
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FPGA在電梯控制系統(tǒng)中的應(yīng)用

  •  　　摘 要： 介紹了基于Altera公司EP1K30TC144芯片的電梯控制器設(shè)計(jì)過程，描述了該控制系統(tǒng)的功能。該設(shè)計(jì)采用VHDL語言進(jìn)行編程，以QUARTUSⅡ軟件為開發(fā)平臺，對本設(shè)計(jì)進(jìn)行了仿真，并使用JTAG將程序代碼下載到實(shí)驗(yàn)板上進(jìn)行了硬件驗(yàn)證。 　　關(guān)鍵詞： 電梯控制器; VHDL; EP1K30TC144; QUARTUSⅡ 　　隨著社會的發(fā)展，電梯的使用越來越普遍，對電梯功能的要求也不斷提高，相應(yīng)地其控制方式也在不斷發(fā)生變化。對于電梯的控制,傳統(tǒng)的方法是使用繼電器-接觸器控制系
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FPGA技術(shù)在汽車電子中的應(yīng)用

  • 　　因?yàn)楝F(xiàn)場可編程門陣列(FPGA)技術(shù)具有自定義邏輯功能和高可靠性的特點(diǎn)，所以，工程師已將FPGA技術(shù)融入測試系統(tǒng)，解決汽車電子設(shè)計(jì)與測試的困難，同時(shí)滿足低成本、系統(tǒng)可擴(kuò)展性和復(fù)雜的測試環(huán)境要求。本文將探討FPGA相關(guān)技術(shù)在汽車電子中的應(yīng)用。 　　FPGA技術(shù)的應(yīng)用領(lǐng)域 　　FPGA(Field Programmable Gate Array)，是PAL、GAL、PLD等可編程器件進(jìn)一步發(fā)展的產(chǎn)物，其邏輯功能由內(nèi)部規(guī)則排列的邏輯單元陣列完成。邏輯單元陣列內(nèi)部包括可配置邏輯模塊、輸入輸出模塊和內(nèi)部連線
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基于FPGA 的DDR SDRAM控制器在高速數(shù)據(jù)采集系統(tǒng)中

  • 實(shí)現(xiàn)數(shù)據(jù)的高速大容量存儲是數(shù)據(jù)采集系統(tǒng)中的一項(xiàng)關(guān)鍵技術(shù)。本設(shè)計(jì)采用Altera 公司Cyclone系列的FPGA 完成了對DDR SDRAM 的控制，以狀態(tài)機(jī)來描述對DDR SDRAM 的各種時(shí)序操作，設(shè)計(jì)了DDR SDRAM 的數(shù)據(jù)與命令接口。用控
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FPGA遠(yuǎn)程更新重啟系統(tǒng)

  • 正文　 1) 因?yàn)镕PGA具有開發(fā)周期短，可更新等優(yōu)點(diǎn)，現(xiàn)在有越來越多的通訊系統(tǒng)采用FPGA作為實(shí)際產(chǎn)品方案。已經(jīng)有大量的FPGA應(yīng)用到通訊系統(tǒng)中，為了降低系統(tǒng)維護(hù)的人力成本，需要能夠?qū)崿F(xiàn)FPGA遠(yuǎn)程版本更新。本文將以Xi
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基于FPGA芯片EP3C10E144C8的OLED真彩色顯示方案

  • 作為第3 代顯示器，有機(jī)電致發(fā)光器件（ OrganicLight Emitting Diode，OLED） 由于其主動(dòng)發(fā)光、響應(yīng)快、高亮度、全視角、直流低壓驅(qū)動(dòng)、全固態(tài)以及不易受環(huán)境影響等優(yōu)異特性，具有LCD 無法比擬的優(yōu)點(diǎn)，在手機(jī)、個(gè)人電
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C8051F320及其USB接口應(yīng)用

  • C8051F320是由美國Cygnal公司推出的C8051F系列單片機(jī)中的一款小型單片機(jī)。它是集成的混合信號片上系統(tǒng)SOC（Sy ...
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模擬器件整合潮流正在到來？

  • 　　大多數(shù)電子工程師在提到IC時(shí)，一般情況下首先想到的大多數(shù)是MCU、DSP、FPGA等數(shù)字IC，而模擬IC則很少被關(guān)注到。同樣在目前消費(fèi)電子大流行的情況下興起的拆解，在工程師對這些產(chǎn)品的物料清單(BOM)進(jìn)行分析時(shí)，大部分的案例都將重點(diǎn)放在了采用了哪些主處理器和存儲器等數(shù)字芯片上，而不會對于模擬IC投入太大精力。 　　現(xiàn)在數(shù)字IC的集成度也越來越高，SoC的設(shè)計(jì)理念大行其道，毫無疑問，在這場數(shù)字時(shí)代的盛宴中，數(shù)字芯片成為了業(yè)界矚目的焦點(diǎn)。 　　但是，即便數(shù)字IC的性能再優(yōu)異，如果沒有模擬IC的搭配，
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Altera推出Serial RapidIO IP內(nèi)核

  • Altera公司 (NASDAQ: ALTR)日前宣布，開始提供新的Serial RapidIO? Gen2 MegaCore?功能知識產(chǎn)權(quán)(IP)，滿足全球通信基礎(chǔ)設(shè)施系統(tǒng)日益增長的帶寬需求。該IP新解決方案成功實(shí)現(xiàn)了所有硬件與最新Integrated Device Technology (IDT) RapidIO芯片的互操作性，并支持28 nm Altera Stratix? V FPGA，每通路工作速率高達(dá)6.25 Gbaud。
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基于FPGA的嵌入式智能管理系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

  • 基于FPGA的嵌入式智能管理系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),近些年，針對智能管理的研究越來越廣泛，采用的技術(shù)也越來越多，如基于單片機(jī)開發(fā)的智能監(jiān)控平臺[1]、在Linux內(nèi)核下的智能儀器開發(fā)[2]、對智能管理的某一個(gè)方面進(jìn)行研究[3]等。隨著嵌入式核心芯片的高速發(fā)展，傳統(tǒng)嵌
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實(shí)踐9號B衛(wèi)星SoC芯片小如指甲 實(shí)現(xiàn)全套大腦功能

  • 　　10月14日發(fā)射的實(shí)踐九號B衛(wèi)星上芯片的變化讓北京控制工程研究所星載計(jì)算機(jī)及電子產(chǎn)品總工程師華更新喜不自禁，在該衛(wèi)星上，控制管理單元的核心處理器及其外圍電路被一個(gè)名為“SoC2008”的片上系統(tǒng)芯片替代了，這好比衛(wèi)星自動(dòng)駕駛儀由一臺整機(jī)設(shè)備變成了設(shè)備里一個(gè)指甲片大小的芯片。更重要的是，這個(gè)芯片是由北京控制工程研究所年輕的設(shè)計(jì)團(tuán)隊(duì)自主研發(fā)的。 　　“這意味著之前功能相對單一的芯片升級為大腦系統(tǒng)，航天型號不再處于一種持續(xù)跟仿國外各種芯片的局面，而是可以通過系統(tǒng)與元器件
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基于IP核的FPGA 設(shè)計(jì)方法

  • 幾年前設(shè)計(jì)專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計(jì)工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實(shí)現(xiàn), 系統(tǒng)制造公司的設(shè)計(jì)人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL
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HDTV接收機(jī)中Viterbi譯碼器的FPGA實(shí)現(xiàn)

  • 高清晰度數(shù)字電視HDTV技術(shù)是當(dāng)今世界上最先進(jìn)的圖像壓縮編碼技術(shù)和數(shù)字通信技術(shù)的結(jié)合。它代表一個(gè)國家的科...
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Altera率先在28nm FPGA上測試復(fù)數(shù)高性能浮點(diǎn)DSP設(shè)計(jì)

  • 　　Altera公司30日宣布，在業(yè)界率先在28 nm FPGA器件上成功測試了復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號處理(DSP)設(shè)計(jì)。獨(dú)立技術(shù)分析公司Berkeley設(shè)計(jì)技術(shù)有限公司(BDTI)驗(yàn)證了能夠在Altera Stratix? V和Arria? V 28 nm FPGA開發(fā)套件上簡單方便的高效實(shí)現(xiàn)Altera浮點(diǎn)DSP設(shè)計(jì)流程，同時(shí)驗(yàn)證了要求較高的浮點(diǎn)DSP應(yīng)用的性能。 　　Altera的浮點(diǎn)DSP設(shè)計(jì)流程經(jīng)過規(guī)劃，能夠快速適應(yīng)可參數(shù)賦值接口的設(shè)計(jì)更改，其工作環(huán)境包括來自MathWorks
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基于FPGA的短幀Turbo譯碼器的實(shí)現(xiàn)

  • 基于FPGA的短幀Turbo譯碼器的實(shí)現(xiàn),Turbo碼雖然具有優(yōu)異的譯碼性能，但是由于其譯碼復(fù)雜度高，譯碼延時(shí)大等問題，嚴(yán)重制約了Turbo碼在高速通信系統(tǒng)中的應(yīng)用。因此，如何設(shè)計(jì)一個(gè)簡單有效的譯碼器是目前Turbo碼實(shí)用化研究的重點(diǎn)。本文主要介紹了短幀Tur
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