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基于DSP的穩(wěn)定平臺伺服系統(tǒng)的設(shè)計研究

  • 　　在伺服電機(jī)和伺服驅(qū)動器組成的高性能穩(wěn)定平臺伺服系統(tǒng)中，需要實(shí)時地獲得伺服電機(jī)的轉(zhuǎn)角和轉(zhuǎn)速信息，高速高精度的傳感器以及相應(yīng)的外圍電路設(shè)計是必不可少的。由于單片機(jī)自身資源的局限性，難以滿足現(xiàn)在伺服系統(tǒng)高精度、高運(yùn)算率以及快速實(shí)時性的要求。在穩(wěn)定平臺伺服控制系統(tǒng)中，DSP已經(jīng)逐漸取代單片機(jī)，成為主流芯片。本設(shè)計采用TI公司的32 bit浮點(diǎn)型DSP芯片TMS320F28335，其工作時鐘頻率高達(dá)150 MHz，具有強(qiáng)大的運(yùn)算能力，能夠?qū)崟r地完成復(fù)雜的控制算法。片內(nèi)集成了豐富的電機(jī)控制外圍部件和電路，簡化了控
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美高森美與 New Wave DV合作開發(fā)用于以太網(wǎng)和光纖通道解決方案的創(chuàng)新網(wǎng)絡(luò)產(chǎn)品和IP內(nèi)核

  • 　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布與New Wave Design & Verification (New Wave DV)合作開發(fā)網(wǎng)絡(luò)硬件和光纖通道IP內(nèi)核。現(xiàn)在，PMC/XMC 卡和IP內(nèi)核均可用于美高森美的SmartFusion2® SoC FPGA和IGLOO2® FPGA器件，能夠?yàn)橛靡蕴W(wǎng)和/或光纖通道的新型國防、航空航天、企業(yè)網(wǎng)絡(luò)和存儲應(yīng)用加快開發(fā)周期。 　　美高
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京微雅格：打破高端通用芯片“硅谷神話”

  • 　　4家美國公司用近9000項(xiàng)專利構(gòu)筑的知識產(chǎn)權(quán)壁壘，讓60多家企業(yè)先后折戟，巨額投入付之東流……這樣的領(lǐng)域，足以讓后來者望而卻步。然而，一家中國公司卻另辟蹊徑，精研知識產(chǎn)權(quán)規(guī)則，自主開發(fā)出FPGA芯片并實(shí)現(xiàn)了量產(chǎn)，成為世界上硅谷以外唯一成功的挑戰(zhàn)者。 　　FPGA，現(xiàn)場可編程邏輯門陣列，代表了國家重大科技專項(xiàng)“核高基”中的“高”——高端通用芯片中的一種，京微雅格的董事長兼CEO劉明博士更愿意叫它&ldq
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DSP編程技巧之31---答疑解惑哪家強(qiáng)之（6）

  • 　　答疑解惑哪家強(qiáng)?當(dāng)屬我們EEPW最強(qiáng)。。。接下來繼續(xù)我們的答疑解惑。 　　35. 雖然可用的存儲空間看起來比section的長度要大，但是鏈接器為何提示“placement fails for object”? 　　這種情況一般是因?yàn)槎蔚目臻g的分配是并不是我們想象中的連續(xù)的一個緊挨一個，而是被編譯器給“分塊”管理了。在內(nèi)存地址分配時，一個段需要完全適配到頁(page)中，或者從頁的邊界開始連續(xù)分配;為了滿足這個要求，段在分配到頁中時，可能無法完全利用
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Altera演示FPGA中業(yè)界性能最好的DDR4存儲器數(shù)據(jù)速率

  • 　　Altera公司今天宣布，在硅片中演示了DDR4存儲器接口，其工作速率是業(yè)界最高的2，666 Mbps。Altera的Arria® 10 FPGA和SoC是目前業(yè)界唯一能夠支持這一速率DDR4存儲器的FPGA，存儲器性能比前一代FPGA提高了43%，比競爭20 nm FPGA高出10%。硬件設(shè)計人員現(xiàn)在可以使用最新的Quartus® II軟件v14.1，在Arria 10 FPGA和SoC設(shè)計中實(shí)現(xiàn)2，666 Mbps DDR4存儲器數(shù)據(jù)速率。視頻演示表明，魯棒的存儲器接口能夠工作在2
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一種基于DSP控制的液晶顯示屏的設(shè)計及實(shí)現(xiàn)

  • 　　近年來，隨著低價格、高性能DSP芯片的出現(xiàn)，DSP已越來越多地被應(yīng)用于高速信號采集、語音處理、圖像分析處理等領(lǐng)域中，并且日益顯示其巨大的優(yōu)越性。而液晶顯示屏更以其顯示直觀、便于操作的特點(diǎn)被用作各種便攜式系統(tǒng)的顯示前端。傳統(tǒng)的液晶顯示往往采用單片機(jī)控制。但在系統(tǒng)有大量高速實(shí)時數(shù)據(jù)的情況下，單片機(jī)由于受到處理速度的限制就顯得力不從心。為了解決這些問題，本文提出了一種基于DSP控制的液晶顯示屏的設(shè)計，有效地解決以上所遇到的問題。 　　1 SED1335控制器的介紹 　　AT-320240Q1型液晶顯示屏
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基于FPGA的數(shù)字日歷設(shè)計

  • 　　基于FPGA設(shè)計數(shù)字日歷可以實(shí)現(xiàn)以軟件方式設(shè)計硬件的目的，無需購買專用數(shù)字芯片，從而克服了傳統(tǒng)利用多片數(shù)字集成電路設(shè)計數(shù)字日歷存在焊接麻煩、調(diào)試繁瑣、成本較高等問題。而且，基于FPGA的數(shù)字日歷與傳統(tǒng)系統(tǒng)相比，在設(shè)計靈活、開發(fā)速度、降低成本、計時精度、功能實(shí)現(xiàn)上都得到大幅度提升，能夠更好地滿足人們?nèi)粘Ｉ畹男枰? 　　本文介紹如何利用VHDL硬件描述語言設(shè)計一個具有年、月、日、星期、時、分、秒計時顯示功能，時間調(diào)整功能和整點(diǎn)報時功能的數(shù)字日歷。在QuartusⅡ開發(fā)環(huán)境下，采用自頂向下的設(shè)計方法，建
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Altera Quartus II軟件v14.1支持業(yè)界第一款具有硬核浮點(diǎn)DSP模塊的FPGA實(shí)現(xiàn)TFLOP性能

  • 　　Altera公司今天發(fā)布其Quartus II軟件v14.1，擴(kuò)展支持Arria 10 FPGA和SoC——FPGA業(yè)界唯一具有硬核浮點(diǎn)DSP模塊的器件，也是業(yè)界唯一集成了ARM處理器的20 nm SoC FPGA。Altera最新的軟件版本可立即支持集成在Arria 10 FPGA和SoC中的硬核浮點(diǎn)DSP模塊。用戶現(xiàn)在可以選擇三種獨(dú)特的DSP設(shè)計輸入流程，DSP性能達(dá)到業(yè)界領(lǐng)先的1.5 TFLOPS。軟件還包括多項(xiàng)優(yōu)化，加速Arria 10 FPGA和SoC設(shè)計時間，提高了
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數(shù)字電源為FPGA帶來高效率

  • 　　電源的發(fā)展方向可以歸結(jié)為三方面：一是小型化;第二是高效、高可靠性;第三是智能化或者數(shù)字化。其中數(shù)字化尤為重要。因?yàn)殡S著數(shù)字負(fù)載變化，無論是手機(jī)、通信設(shè)備、工業(yè)設(shè)備、汽車等的處理器的性能大大增強(qiáng)了，另外其電壓數(shù)值也大大降低了。例如，以前一個FPGA的內(nèi)核電壓供電是2V或者1V，現(xiàn)在很多FPGA的核心電壓只有0.9V或0.8V。如何確保你的電源穩(wěn)壓器能夠輸出如此低的電壓值，同時又能夠達(dá)到0.5%或者1%的電壓穩(wěn)壓精度?挑戰(zhàn)在于電壓精度越來越難實(shí)現(xiàn)，例如1V電壓，若達(dá)到0.5%精度，需要穩(wěn)壓的電壓值只有5m
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基于FPGA的高光效LCD投影機(jī)設(shè)計

  • 　　引言 　　顯示技術(shù)正朝著大屏幕、高清晰度、高亮度和高分辨率的方向發(fā)展。通常說來，將屏幕顯示面對角線尺寸在1米(40英寸)以上的顯示稱為大屏幕顯示。投影機(jī)作為一種重要的顯示設(shè)備，已經(jīng)廣泛地應(yīng)用到了金融、教育、企業(yè)、軍事等多個領(lǐng)域，它所具有的大幅面、高清晰多媒體演示功能，使信息的傳遞具有更好的效果。目前，市面上的主流產(chǎn)品是三片式LCD投影機(jī)和DLP投影機(jī)，其中，三片式LCD投影機(jī)的市場份額高達(dá)三分之二。 　　然而，投影機(jī)的主要采購者絕大多數(shù)是政府部門、企業(yè)和高校。無論是三片式LCD投影機(jī)還是DLP投影
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基于FPGA及NiosII軟核處理器的TFT-LCD接口設(shè)計

  • 　　1 引言 　　隨著電子技術(shù)的飛速發(fā)展，TFT-LCD作為在亮度、對比度、功耗、壽命、體積和重量等綜合性能上全面趕上和超過 CRT的顯示器件，被廣泛用于各種儀器儀表、電子設(shè)備及控制領(lǐng)域中。與之相關(guān)的顯示控制技術(shù)也呈現(xiàn)出越來越多的方式。本文以 640*480的數(shù)字輸入的 TFT_LCD顯示屏為例，介紹了一種基于 NiosII軟核處理器實(shí)現(xiàn)對 TFT-LCD接口的方法。解決了通常情況下必須使用LCD 控制專用芯片才能解決 LCD顯示的問題。 　　2 系統(tǒng)組成 　　系統(tǒng)框如圖 1所示。系統(tǒng)是由 FPGA
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基于FPGA的彩色TFT-LCD控制電路設(shè)計及其ASIC實(shí)現(xiàn)

  • 　　1引言 　　通過彩色液晶顯示器(LCD)取景是數(shù)碼相機(jī)優(yōu)于傳統(tǒng)相機(jī)的重要特性之一，它解決了使用取景框取景帶來的各種不便，而且可以在拍攝現(xiàn)場用液晶顯示器回放剛拍的相片來查看拍攝效果[1]，從而決定是否留下這張照片，這樣能使攝影者更好地控制照片的質(zhì)量。所以用液晶顯示器進(jìn)行取景和回放是數(shù)碼相機(jī)兩大必不可少的功能。同時液晶顯示器還用來顯示菜單，提供良好的人機(jī)交互界面。目前市場上出售的數(shù)碼相機(jī)使用的液晶顯示器都是彩色TFT液晶顯示器，這種液晶顯示器解決了一般液晶顯示器中相鄰像素串?dāng)_的現(xiàn)象[2]，所以可用來顯示
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一種基于DSP實(shí)現(xiàn)的LCD液晶屏顯示技術(shù)

  • 　　1 引 言 　　隨著電子產(chǎn)品集成化的發(fā)展.液晶顯示屏在便攜式儀器中實(shí)現(xiàn)圖像或文字的顯示應(yīng)用更為廣泛。 　　同時在當(dāng)今信息時代，數(shù)字圖像處理技術(shù)對實(shí)時性、運(yùn)算量大的要求越來越高，所以高運(yùn)算速度的DSP芯片在數(shù)字圖像處理領(lǐng)域得到了廣泛的應(yīng)用;其使數(shù)據(jù)采集、控制與人機(jī)界面融為一體，由于DSP處理速度快，整個系統(tǒng)能夠由一片DSP芯片控制.體積更小、功耗更低、更便于攜帶[1]。目前大多數(shù)液晶控制器的接[1電路及驅(qū)動程序主要是針對單片機(jī)設(shè)計的[2]，DSP的液晶屏接口電路參考資料相對較少，而在實(shí)際應(yīng)用中，單片
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基于FPGA的LCD顯示遠(yuǎn)程更新的設(shè)計方案及原理圖

  • 　　一 設(shè)計概述 　　1.1目標(biāo)領(lǐng)域和主要應(yīng)用 　　如今，交通在現(xiàn)代人的生活中所占比重越來越重要。如何安全，高效的利用道路資源是每個人都要面對的問題?，F(xiàn)有車載GPS導(dǎo)航只能查看到道路走向信息，卻不能查看到道路上的各種突發(fā)情況，比如交通事故、堵車現(xiàn)象、交通臨時管制、禁止部分車輛通行、臨時禁止左右轉(zhuǎn)、道路維修、道路更改的情況。這時如果有能夠?qū)崟r更新并對外發(fā)布和顯示交通信息、道路狀況信息和設(shè)施狀況等，能起到減少堵塞程度，提高道路通行能力的作用。也間接提高了交通運(yùn)輸，人們出行的效率。 　　該項(xiàng)目是基于FPG
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基于FPGA的LCD大屏幕拼接系統(tǒng)的設(shè)計

  • 　　項(xiàng)目概述 　　隨著各種圖形、圖像內(nèi)容質(zhì)量的不斷提升以及系統(tǒng)運(yùn)行實(shí)時顯示的需要，金融、通信、交通、能源、安全、軍事等越來越多的行業(yè)需要建立能夠?qū)崟r整合多路信號輸入的超大屏幕顯示系統(tǒng)。而數(shù)字技術(shù)的飛速發(fā)展，也使人們對大尺寸、多畫面、真色彩、高畫質(zhì)、高分辨率的計算機(jī)圖形、圖文、數(shù)據(jù)與各類視頻圖像顯示效果的需求得以滿足。其中，以視頻信息的要求最為強(qiáng)烈，人們不僅希望視頻顯示尺寸的越來越大，而且視頻顯示質(zhì)量也要求能達(dá)到多畫面、真色彩、高畫質(zhì)、高分辨率。 　　在大屏幕拼接系統(tǒng)中，拼接控制器的優(yōu)劣直接決定著整個大
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