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一種改進型surendra背景更新算法的FPGA實現
- 針對現有的動態(tài)背景提取運動目標物體算法復雜且難以在硬件上實現的問題,研究了改進型surendra背景更新算法原理的特點,提出了改進型surendra背景更新算法的硬件結構,并對硬件結構進行綜合、仿真后,在FPGA芯片上實現。
- 關鍵字: 運動目標提取 surendra背景更新算法 FPGA
基于FPGA+DSP的智能車全景視覺系統(tǒng)
- 為實現智能車全景視覺系統(tǒng)的應用研究平臺,設計了一種基于FPGA+雙DSP的實時6通道數字圖像采集與處理系統(tǒng)。該系統(tǒng)由兩片FPGA與兩個DSP組成。第一個FPGA進行多通道視覺圖像采集的同步控制、邏輯處理,第二片FPGA輔助DSP進行海量圖像數據的高速并行處理。
- 關鍵字: 全景視覺系統(tǒng) FPGA+DSP 數字圖像采集與處理系統(tǒng)
基于FPGA的嵌入式圖像監(jiān)控系統(tǒng)設計
- 本文主要完成了嵌入式圖像監(jiān)控系統(tǒng)的設計,該系統(tǒng)克服了模擬圖像監(jiān)控技術具有的弊端,在普通家庭、臨時性作業(yè)場所中具有很強的應用前景。這些領域一般對視頻傳輸指標的要求不一定很高,但要求便于攜帶,同時功耗較小(例如臨時性場合等),具有體積小、功耗低、成本低、速度快、穩(wěn)定性好等特點,可以有效地克服傳統(tǒng)的基于計算機的監(jiān)控系統(tǒng)的缺點。系統(tǒng)可做為一個智能部件“嵌入”到各種應用系統(tǒng)中,如將其配上網絡接口接上計算機系統(tǒng),即可構成一個監(jiān)控網絡系統(tǒng),是一種相對獨立的OEM部件。
- 關鍵字: 圖像監(jiān)控系統(tǒng) NiosII FPGA
基于FPGA和多DSP的高速視覺測量系統(tǒng)的研究
- 針對高速視覺測量系統(tǒng)數據處理速度快、數據處理量大的特點,將FPGA技術與DSP技術相結合,研究了一種基于FPGA和多DSP的多通道并行處理的高速視覺測量系統(tǒng)。詳細介紹了FPGA技術與多DSP技術在數字圖像處理過程中的不同應用、高速視覺測量系統(tǒng)的總體結構以及各部分的工作原理。
- 關鍵字: 高速視覺測量系統(tǒng) DSP FPGA
基于FPGA的慢門限恒虛警處理電路設計及其仿真
- 雷達信號的檢測多是在干擾背景下進行,如何從干擾中提取目標信號,不僅要求有一定的信噪比,而且必需有恒虛警處理設備。恒虛警處理是雷達信號處理的重要組成部分,慢門限恒虛警處理主要是針對接收機熱噪聲,文中介紹一種基于FPGA嵌入式設計的慢門限恒虛警處理電路,給出了仿真模型及仿真結果,并已將其用于某檢測器中,取得了良好的經濟效益。
- 關鍵字: 慢門限恒虛警處理電路 內部噪聲 FPGA
基于ARM和FPGA的服務機器人運動控制系統(tǒng)研究
- 介紹了一種基于ARM和FPGA的嵌入式控制系統(tǒng),該系統(tǒng)既能獨立運行又能在計算機輔助下運行,是一種兼具柔性和開放性的系統(tǒng)。利用ARM的強大的數據流轉換功能和FPGA的快速配置能力,實現硬件可重構。給出了系統(tǒng)的總體結構、ARM和FPGA之間的通信設計,重點給出了基于NiosII的嵌入式可重構底層控制設計,PWM功能模塊在FPGA上的實現。設計的系統(tǒng)集成度高、靈活。實驗表明系統(tǒng)具有高可靠性,能滿足服務機器人外圍器件多樣性控制的要求。ARM和FPGA不僅可以并行運行處理數據,其之間又可以互相通信,實現了系統(tǒng)的擴展
- 關鍵字: 硬件可重構 NiosII FPGA
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