基于Xtensa的ASIP開發(fā)流程研究
—— Research on ASIP Design Flow Based-on Xtensa
作者：徐欣鋒 中國科學(xué)院微電子研究所專用集成電路與系統(tǒng)研究室
時間：2009-06-15
來源：電子產(chǎn)品世界
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前言
本文引用地址：http://2s4d.com/article/95269.htm隨著半導(dǎo)體工藝技術(shù)向著納米尺度的發(fā)展，微電子技術(shù)進(jìn)入SoC(系統(tǒng)芯片)時代，且沿著可靠性強(qiáng)、體積小、功耗低等方向繼續(xù)發(fā)展。在下一代SoC設(shè)計流程中，系統(tǒng)級EDA工具的地位變得比以往更加重要，ESL(Electronic System Level)設(shè)計方法學(xué)將是設(shè)計下一代SoC的關(guān)鍵，因為逐漸縮短的上市時間需要硬件-軟件并行設(shè)計。
本文以Tensilica Xtensa可配置、可擴(kuò)展處理器為開發(fā)平臺，探索了高性能低功耗ASIP(Application Specific Instruction-set Processor專用指令處理器)開發(fā)流程。
ASIP設(shè)計理論
面向特定應(yīng)用的ASIP處理器，既有ASIC執(zhí)行特定應(yīng)用的高效性，又有GPP處理器可編程的靈活性，能夠簡化設(shè)計復(fù)雜度、縮短設(shè)計周期、加快上市步伐，在SoC設(shè)計中得到了廣泛的應(yīng)用。如何快速高效地定制ASIP，使其滿足運(yùn)算性能、芯片面積、上市時間和功耗等要求，是一個極具挑戰(zhàn)性的問題。設(shè)計者需要在ASIP指令集設(shè)計過程中在廣泛的設(shè)計空間進(jìn)行指令集探索，尋找滿足設(shè)計約束的處理器體系結(jié)構(gòu)[1-8]。因此迫切需要可以支持快速ASIP設(shè)計的行為級設(shè)計方法和合適的EDA工具。
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