基于嵌入式TCP/IP軟件體系結(jié)構(gòu)的優(yōu)化設(shè)計(jì)與實(shí)現(xiàn)(06-100)
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作者：北京郵電大學(xué) 電信工程學(xué)院 廖日坤 紀(jì)越峰
時(shí)間：2008-04-03
來(lái)源：電子產(chǎn)品世界
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為了減小RAM使用量，當(dāng)數(shù)據(jù)包需要重新發(fā)送時(shí)，如果能夠重新產(chǎn)生數(shù)據(jù)包所需的數(shù)據(jù)，可以不存儲(chǔ)需要被應(yīng)答的TCP包。圖3給出了嵌入式CPU中TCP/IP的內(nèi)存劃分，以及內(nèi)存中幀的各個(gè)字節(jié)的定義和相對(duì)位置，其中PacketRAM為存放幀的首地址。
發(fā)送TCP/IP過(guò)程中主要的運(yùn)算量集中在三個(gè)部分：應(yīng)用程序?qū)?shù)據(jù)拷貝到RAM、計(jì)算TCP校驗(yàn)和、將RAM中的數(shù)據(jù)包拷貝到網(wǎng)絡(luò)設(shè)備的發(fā)送緩沖區(qū)。對(duì)每一個(gè)字節(jié)數(shù)據(jù)，兩次拷貝大致共使用12×2＝24個(gè)指令周期；計(jì)算TCP校驗(yàn)和使用為16個(gè)指令周期。為提高速度可采用快速CPU或提高晶振頻率。例如采用12M晶振時(shí)，網(wǎng)絡(luò)傳輸速度為25K字節(jié)/s；而在高頻PCB電路板使用233M晶振時(shí)，網(wǎng)絡(luò)傳輸速度能達(dá)到為384K字節(jié)/s。
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