基于EG4A20BG256和AD7403的電流采樣電路設(shè)計

作者簡介：李紹軍（1989—），男，碩士，工程師，研究方向為光電云臺伺服。

0   引言

永磁同步電機電流環(huán)是永磁同步電機控制系統(tǒng)速度環(huán)和位置環(huán)的基礎(chǔ)，對控制系統(tǒng)實現(xiàn)快速響應(yīng)﹑提高動態(tài)性能有重要的影響。電流環(huán)的實現(xiàn)依靠模數(shù)轉(zhuǎn)換電路完成對電機相電流的采集，在很多電機驅(qū)動場合，出于降低干擾提高采樣精度或是保證電路安全的考慮，需要在驅(qū)動電路和信號處理電路間有電氣隔離，常見的隔離式電流采集電路有三種基本形式：霍爾電流傳感器結(jié)合運算放大器﹑采樣電阻結(jié)合隔離式運算放大器﹑采樣電阻結(jié)合Σ-Δ型模數(shù)轉(zhuǎn)換器 ^[1]。前兩種方式一般需要結(jié)合電機驅(qū)動電路控制器（如DSP）的ADC 外設(shè)進行處理，后者則需要通過 FPGA 或具有Δ-Σ調(diào)制器的控制器進行處理。電流環(huán)會對采集到的電流進行一系列的數(shù)學(xué)運算處理，相比DSP 串行運算結(jié)構(gòu)，FPGA 的并行運算結(jié)構(gòu)可減小電流環(huán)路延時，提高電流環(huán)帶寬，進而提高速度環(huán)響應(yīng)速度^[2]。在需要過采樣以及高于16 bit 分辨率的模數(shù)轉(zhuǎn)換器的應(yīng)用領(lǐng)域，Σ-Δ型模數(shù)轉(zhuǎn)換器相比傳統(tǒng)逐次逼近式模數(shù)轉(zhuǎn)換器具有很大優(yōu)勢，應(yīng)用也更為廣泛^[3]。文中通過國產(chǎn)EG4A20BG256 FPGA 結(jié)合采樣電阻以及Σ-Δ型模數(shù)轉(zhuǎn)換器對永磁同步電機相電流進行了采樣，并同時采樣了霍爾電流傳感器結(jié)合運算放大器的結(jié)果，以便對采樣結(jié)果進行分析對比。

1   硬件設(shè)計

實驗電路組成結(jié)構(gòu)如圖1 所示。DSP 通過門極驅(qū)動電路與三相橋電路驅(qū)動永磁同步電機勻速轉(zhuǎn)動，AD7403-8 為AD7403 的8 腳封裝， 通過采集永磁同步電機電樞回路采樣電阻端電壓，輸出數(shù)字碼流給EG4A20BG256 FPGA 解碼處理，處理結(jié)果發(fā)送給DSP；同時DSP 通過霍爾電流傳感器采集永磁同步電機相電流，并經(jīng)運算放大電路信號調(diào)理后通過其內(nèi)部ADC 模塊進行采集作為對比樣本。

EG4A20BG256 是安路科技推出的一款EAGLE 系列國產(chǎn)低成本FPGA，有19 600 個LUT 單元﹑ 156 800 kbit存儲器﹑ 196 個用戶I/O 口﹑ 4 個PLL ﹑還有1 個ADC模塊和多個LVDS 接口，非常適合伺服控制應(yīng)用領(lǐng)域^[4]。AD7403 是一款高性能數(shù)字隔離式模數(shù)轉(zhuǎn)換器，內(nèi)置二階Σ-Δ型調(diào)制器，可以將模擬信號轉(zhuǎn)換為高速單個位數(shù)據(jù)流，滿輸入量程為± 320 mV，可通過調(diào)整輸入端采樣電阻的大小實現(xiàn)采樣電流量程的靈活調(diào)整。AD7403-8 采樣電路如圖2 所示。其兩側(cè)供電電源相互獨立隔離，右側(cè)3.3 V 電源與B0305T 隔離式電源轉(zhuǎn)換器共用，左側(cè)5 V 隔離電源由B0305 輸出提供。左側(cè)VIN+ 和VIN- 引腳通過差分濾波電路采集電機電樞回路采樣電阻兩端的端電壓。AD7403-8 將采樣電壓轉(zhuǎn)換為一組占空比與電壓值相關(guān)的碼流，接收EG4A20BG256 FPGA 提供的碼流時鐘，并將碼流發(fā)送至FPGA 處理。

圖2 AD7403-8采樣電路

2   軟件設(shè)計

Σ-Δ型模數(shù)轉(zhuǎn)換器工作的基本思想是采用高速﹑低位數(shù)（如1 位）的模數(shù)轉(zhuǎn)換器來實現(xiàn)低速﹑高位數(shù)的模數(shù)轉(zhuǎn)換器^[5]。AD7403-8 內(nèi)部通過二階調(diào)制器將采樣電壓轉(zhuǎn)換為對應(yīng)的數(shù)字碼流，為重構(gòu)原始電壓信息，EG4A20BG256 FPGA 需要使用sinc³ 濾波器對該碼流進行數(shù)字濾波和抽取處理。抽取率與模數(shù)轉(zhuǎn)換器吞吐速率和輸出數(shù)據(jù)位數(shù)相關(guān)，本次使用的碼流濾波解碼模塊抽取率為256，AD7403-8 輸入時鐘設(shè)置為10 MHz，則其最大數(shù)據(jù)吞吐速率為：

其中，f_mclk 為模數(shù)轉(zhuǎn)換器輸入時鐘，DR 為抽取率；

最大轉(zhuǎn)換位數(shù)為：

其中，N為sinc 濾波器階數(shù)，此處取值為3，DR為抽取率；

此處僅取高16 bit 作為轉(zhuǎn)換結(jié)果。上電后FPGA 啟動碼流濾波模塊，由于需要和DSP 采樣結(jié)果進行對比，F(xiàn)PGA 采樣時刻需要與DSP 輸出PWM 周期進行同步匹配，當(dāng)?shù)狡銹WM 周期時，將FPGA 采樣觸發(fā)信號置高并發(fā)送給FPGA；FPGA 啟動延時直到延時時間到達后啟動采樣，保證FPGA 與DSP 在PWM 周期中心時刻同步進行采樣；待濾波解碼模塊輸出完成標(biāo)志后，將采樣結(jié)果通過串口發(fā)送至DSP。DSP 輸出PWM 頻率設(shè)置為10 kHz，當(dāng)前AD7403-8 最大吞吐速率遠(yuǎn)高于PWM頻率，可滿足采樣需求，F(xiàn)PGA 工作流程如圖3 所示。

FPGA 開發(fā)環(huán)境為Anlogic TD 5.0.2 64-Bit，F(xiàn)PGA資源消耗情況如圖4 所示。

圖4 FPGA資源消耗

3   實驗分析

在電機輸入端給定電機固定電壓，霍爾傳感器經(jīng)DSP 處理，AD7403-8 經(jīng)FPGA 處理采樣到的電機電樞電流，如圖5 所示。

（a）0 A電流采樣對比

（b）3.22 A電流采樣對比

圖5 固定電流采樣對比

由AD7403 手冊^[6] 可知其輸出單位碼流占空比如表1 所示。

采樣電阻端電壓和輸出碼流占空比關(guān)系如式（3）所示：

其中，x 為輸入電壓；y 為對應(yīng)的占空比；

AD7403-8 輸入端采樣電阻為50 m Ω ，如圖6 所示，AD7403-8 采樣電流分別為0 A 和3.22 A，即輸入端電壓分別為0 mV 和161 mV，參見圖6 的時鐘和數(shù)據(jù)波形圖。其中，通道1 為時鐘波形，通道2 為數(shù)據(jù)波形。0 mV 時數(shù)據(jù)碼流占空比為50%，161 mV 時數(shù)據(jù)碼流占空比為75.16%，占空比符合式（3）。

驅(qū)動電機勻速轉(zhuǎn)動，霍爾傳感器經(jīng)DSP 采集，AD7403-8 經(jīng)FPGA 處理采集到的電機電樞電流如圖7所示。

（a）0 mV電壓對應(yīng)數(shù)據(jù)碼流占空比

（b）161 mV電壓對應(yīng)數(shù)據(jù)碼流占空比

圖6 固定電壓數(shù)據(jù)碼流占空比

圖7 霍爾電流傳感器和AD7403-8動態(tài)電流采集對比

通過兩種方式對上述靜態(tài)和動態(tài)電流采集情況對比可見，EG4A20BG256 FPGA 和AD7403-8 配合有助于獲得更高精度和更低噪聲的采樣結(jié)果，提升電流環(huán)的性能。

4   結(jié)論

本文利用EG4A20BG256 FPGA 設(shè)計了重構(gòu)AD7403-8模數(shù)轉(zhuǎn)換器的輸出碼流的sinc3 濾波器，根據(jù)DSP 觸發(fā)實時采樣重構(gòu)電流值，并通過串口發(fā)送給DSP 處理，實驗驗證了該設(shè)計的可行性，電流采樣精度較高。

參考文獻：

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[3] 陳小梅.適用于Sigma-Delta ADC的512倍數(shù)字抽取濾波器的設(shè)計與研究[D].武漢:華中科技大學(xué), 2016.

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[5] 楊貴杰,崔乃政,周長攀.《電機數(shù)字控制系統(tǒng)集成設(shè)計》系列講座（十三）第6章 基于MCU架構(gòu)交流電機數(shù)字控制系統(tǒng)集成設(shè)計[J]. 伺服控制, 2013, 000(005):88-94.

[6] ADI公司. AD7403中文數(shù)據(jù)手冊[EB/OL]. https://www.analog.com/cn/products/ad7403.html.

（本文來源于《電子產(chǎn)品世界》雜志2021年5月期）