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1553B多功能RT IP核的設(shè)計與實現(xiàn)

作者：時間：2017-06-05 來源：網(wǎng)絡(luò)

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介紹了采用一種自主研發(fā)多功能IP核實現(xiàn)總線全地址響應(yīng)的設(shè)計方案,其可在FPGA中靈活配置,配備外圍電路后可以方便實現(xiàn)各種功能.設(shè)計采用VHDL硬件描述語言進行編程,采用綜合工具ISE Foundation對設(shè)計進行綜合、優(yōu)化,在ModelSim - SE 6.1g中進行時序仿真,并且最后在FPGA上實現(xiàn).

1553B多功能RTIP核的設(shè)計與實現(xiàn).pdf

本文引用地址：http://2s4d.com/article/201706/348882.htm

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關(guān)鍵詞： 多功能IP核 VHDL ModelSim

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