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基于ARM和CPLD的可重構(gòu)檢測系統(tǒng)設(shè)計(jì)

  • 引言
    檢測系統(tǒng)的可重構(gòu)設(shè)計(jì)是檢測技術(shù)的發(fā)展方向。可重構(gòu)設(shè)計(jì)是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計(jì)方法。對(duì)于檢測系統(tǒng)而言，可重構(gòu)可以分為軟件可重構(gòu)和硬件可重
  • 關(guān)鍵字： CPLD  ARM  可重構(gòu)  檢測系統(tǒng)設(shè)計(jì)    

用CPLD和Flash實(shí)現(xiàn)FPGA配置

  • 摘要：FPGA可以通過串行接口進(jìn)行配置。本文對(duì)傳統(tǒng)的配置方法進(jìn)行了研究，并從更新配置文件的方法入手，提出了利用處理機(jī)通過網(wǎng)絡(luò)更新的方法，給出了一個(gè)用CPLD和Flash對(duì)FPGA進(jìn)行配置的應(yīng)用實(shí)例。
    關(guān)鍵詞：現(xiàn)場可編程
  • 關(guān)鍵字： Flash  CPLD  FPGA    

基于Multibus總線的隔離AD／DA模塊設(shè)計(jì)

  • 摘要：AD／DA模塊通過Multibus總線與主機(jī)通訊，通過AD接口采集數(shù)據(jù)，經(jīng)過控制軟件處理，輸出模擬量驅(qū)動(dòng)執(zhí)行機(jī)構(gòu)。本文簡要介紹了AD／DA模塊的設(shè)計(jì)原理和實(shí)現(xiàn)方法，并對(duì)一些關(guān)鍵技術(shù)進(jìn)行介紹。
    關(guān)鍵詞：AD／DA模塊；
  • 關(guān)鍵字： AD／DA  采集數(shù)據(jù)  放大器  CPLD  

FPGA基礎(chǔ)入門（二）

基于CPLD設(shè)計(jì)的電器定時(shí)開關(guān)控制系統(tǒng)

利用CPLD來替代微控制器的6種方法

我學(xué)習(xí)FPGA的總結(jié)

verilog中阻塞賦值和非阻塞復(fù)制的理解

選擇VHDL或者verilog HDL還是System Verilog？

系統(tǒng)級(jí)芯片設(shè)計(jì)語言和驗(yàn)證語言的發(fā)展

FPGA設(shè)計(jì)中關(guān)鍵問題的研究

讓Verilog仿真狀態(tài)機(jī)時(shí)可以顯示狀態(tài)名

基于Nios的DDS高精度信號(hào)源實(shí)現(xiàn)

FPGA系統(tǒng)設(shè)計(jì)實(shí)戰(zhàn)經(jīng)驗(yàn)分享FPGA系統(tǒng)設(shè)計(jì)實(shí)戰(zhàn)經(jīng)驗(yàn)分享

FPGA基礎(chǔ)入門

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