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EEPW首頁 >> 主題列表 >> vhdl-cpld

使用LeonardoSpectrum綜合Xilinx FPGA的VHDL程序

  • 摘   要： 本文總結(jié)了使用LeonardoSpectrum綜合Xilinx FPGA的VHDL程序應(yīng)用，以及在VHDL中使用不同類型RAM的方法。關(guān)鍵詞： LeonardoSpectrum；FPGA；VHDLLeonardoSpectrum 是Mentor Graphics公司設(shè)計(jì)的功能強(qiáng)大的EPLD/FPGA/ASIC綜合工具，支持大部分EPLD/FPGA廠商的產(chǎn)品。LeonardoSpectrum支持VHDL、Verilog、EDIF的綜合、優(yōu)化和定時分析，可
  • 關(guān)鍵字： FPGA  LeonardoSpectrum  VHDL  

PCI總線至UTOPIA接口控制的CPLD設(shè)計(jì)實(shí)現(xiàn)

  • 摘   要： 本文采用Altera的CPLD實(shí)現(xiàn)了PCI總線至UTOPIA接口的邏輯轉(zhuǎn)換控制，為低成本實(shí)現(xiàn)ATM終端奠定了基礎(chǔ)。關(guān)鍵詞： CPLD ;   PCI總線 ; UTOPIA2總線引言  EDA技術(shù)憑借其高速、方便等特點(diǎn)而被廣泛應(yīng)用于通信領(lǐng)域。本文采用Altera的CPLD實(shí)現(xiàn)了PCI總線至UTOPIA接口的邏輯轉(zhuǎn)換控制，該設(shè)計(jì)再配上ATM線路成幀部件即可成為基于個人電腦的ATM終端設(shè)備，從而改善因成本較高、市場需求不足等原因
  • 關(guān)鍵字： CPLD  PCI總線  UTOPIA2總線  

用CPLD和外部SRAM構(gòu)成大容量FIFO的設(shè)計(jì)

  • 摘要：對照一般通用FIFO的外部控制線，以及視頻服務(wù)器應(yīng)用的具體要求，設(shè)計(jì)完成用CPLD和外部SRAM構(gòu)成的大容量、廉價、高速FIFO，除了可以滿足視頻服務(wù)器碼流緩沖的需要外，也可以作為一個通用的大容量FIFO。關(guān)鍵詞：視頻服務(wù)器、碼流平滑、FPGA/CPLD、FIFOThe design of FIFO consisted of CPLD and SRAMRen Sanjun Hu WenjieDSP Center of Institute of Acoustics, Chinese Academy
  • 關(guān)鍵字： 視頻服務(wù)器、碼流平滑、FPGA/CPLD、FIFO  存儲器  

1999年，賽靈思(阿爾伯克基)成立

  • 　　1999年，通過兼并 Philips CoolRunner隊(duì)伍和技術(shù)，賽靈思(阿爾伯克基)成立了。該產(chǎn)品線為用戶提供了新型低功耗、成本更低的 CPLD 產(chǎn)品。
  • 關(guān)鍵字： 賽靈思  CPLD  FPGA  
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