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基于CPLD的數(shù)字電路設(shè)計(jì)

  • 0 引 言

    可編程邏輯器件PLD(Programmable Logic De-vice)是一種數(shù)字電路，它可以由用戶來進(jìn)行編程和進(jìn)行配置，利用它可以解決不同的邏輯設(shè)計(jì)問題。PLD由基本邏輯門電路、觸發(fā)器以及內(nèi)部連接電路構(gòu)成，利用軟件和硬
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基于CPLD的DSP多SPI端口通信設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于DSP和CPLD的光纖陀螺信號采集系統(tǒng)設(shè)計(jì)

  • 基于DSP和CPLD的光纖陀螺信號采集系統(tǒng)設(shè)計(jì),摘要：隨著光纖陀螺在空空導(dǎo)彈中的廣泛應(yīng)用，為了對其特性進(jìn)行深入研究，設(shè)計(jì)了一種光纖陀螺信號采集系統(tǒng)。硬件結(jié)構(gòu)采用了DSP+CPLD的方式，控制AD芯片完成多路光纖陀螺數(shù)據(jù)的采集。為了降低干擾對采集精度的影響，在
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采用CPLD與μC/OS -Ⅱ的斷路器智能控制單元設(shè)計(jì)

  • 采用CPLD與μC/OS -Ⅱ的斷路器智能控制單元設(shè)計(jì),本文介紹的智能控制單元采用數(shù)字信號處理器(DSP)及嵌入式實(shí)時(shí)操作系統(tǒng)完成各種數(shù)據(jù)的處理、通信和算法的設(shè)計(jì)，而狀態(tài)量的采集和執(zhí)行信號輸出將由復(fù)雜可編程邏輯器(CPLD)完成，主要是基于CPLD內(nèi)部硬件電路結(jié)構(gòu)的可靠性
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采用DSP與CPLD的三相五電平變頻器PWM脈沖發(fā)生器

  • 采用DSP與CPLD的三相五電平變頻器PWM脈沖發(fā)生器,1 引言　　近年來,多電平變換器成為電力電子研究的熱點(diǎn)之一,它主要面向中壓大功率的應(yīng)用場合。目前,有三種基本的多電平變換器拓?fù)浣Y(jié)構(gòu)[1]：①二極管箝位型;②飛跨電容型;③級聯(lián)型。　　幾種拓?fù)浣Y(jié)構(gòu)各有其優(yōu)缺點(diǎn),但相
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FPGA驅(qū)動(dòng)LED靜態(tài)顯示和動(dòng)態(tài)顯示的VHDL程序

  • 例1：FPGA驅(qū)動(dòng)LED靜態(tài)顯示　　--文件名：decoder.vhd　　--功能：譯碼輸出模塊，LED為共陽接法　　--最后修改日期：2004.3.24　　library IEEE;　　use IEEE.STD_LOGIC_1164.ALL;　　use IEEE.STD_LOGIC_ARITH.ALL;　
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Linux下CPLD驅(qū)動(dòng)程序

  • Linux下CPLD驅(qū)動(dòng)程序,========================================================================== */
    /* */
    /* Filename.c
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基于VHDL的交通燈控制器設(shè)計(jì)

  • 應(yīng)用VHDL語言設(shè)計(jì)數(shù)字系統(tǒng)，大部分設(shè)計(jì)工作可在計(jì)算機(jī)上完成，從而縮短系統(tǒng)開發(fā)時(shí)間，提高工作效率。下面介紹基于VHDL設(shè)計(jì)交通燈控制器的一種方案，并給出源程序和仿真結(jié)果。　　1 系統(tǒng)功能與要求　　交通燈控制器控
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基于DSP的CPLD軟件更新方案研究

  • 基于DSP的CPLD軟件更新方案研究, 0引言　　在現(xiàn)代導(dǎo)航計(jì)算機(jī)系統(tǒng)朝著微型化發(fā)展的過程中，采用高性能數(shù)字信號處理器和可編程邏輯器件方案實(shí)現(xiàn)的導(dǎo)航計(jì)算機(jī)系統(tǒng)有著很高的性能優(yōu)勢。在本課題組研制的基于浮點(diǎn)型DSP和復(fù)雜可編程邏輯器件(CPLD)結(jié)構(gòu)的嵌
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基于VHDL語言對高速A/D器件TLC5510控制的實(shí)現(xiàn)

  • 基于VHDL語言對高速A/D器件TLC5510控制的實(shí)現(xiàn),--TLC5510 VHDL控制程序　　--文件名：TLC5510.vhd　　--功能：基于VHDL語言，實(shí)現(xiàn)對高速A/D器件TLC5510控制　　--最后修改日期：2004.3.20　　library ieee;　　use ieee.std_logic_1164.all;　　entity tlc5510 is
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基于FPGA的中文字符顯示的VHDL程序

  • 基于FPGA的中文字符顯示的VHDL程序,--文件名：lcd_driver.vhd。　　--功能：FGAD驅(qū)動(dòng)LCD顯示中文字符“年”?！　?-最后修改日期：2004.3.24?！　ibrary IEEE;　　use IEEE.STD_LOGIC_1164.ALL;　　use IEEE.STD_LOGIC_ARITH.ALL;　　use
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基于VHDL的基帶信號的MFSK調(diào)制

  • 基于VHDL的基帶信號的MFSK調(diào)制,--多進(jìn)制數(shù)字頻率調(diào)制(MFSK)系統(tǒng)VHDL程序　　--文件名：MFSK　　--功能：基于VHDL硬件描述語言，完成對基帶信號的MFSK調(diào)制　　--說明：這里MFSK的M為4　　--最后修改日期：2004.2.13　　library ieee;　　use ieee.s
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用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程

  • 用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程為：　　1.文本編輯：用任何文本編輯器都可以進(jìn)行，也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件　　2.功能仿真：將文件調(diào)入HDL仿真
  • 關(guān)鍵字： 完整  流程  PLD/FPGA  開發(fā)  語言  VHDL/VerilogHD  

基于CPLD譯碼的DSP二次Bootloader方法介紹

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于DSP和CPLD的金屬磁記憶檢測儀設(shè)計(jì)

  • 基于DSP和CPLD的金屬磁記憶檢測儀設(shè)計(jì),摘要：設(shè)計(jì)了一種以DSP+CPLD為控制核心的高性能金屬磁記憶檢測儀，用以快速檢測鐵磁材料的漏磁信號，判斷材料應(yīng)力集中區(qū)域。文中簡述了磁記憶檢測儀的主要電路及其工作原理，重點(diǎn)介紹了系統(tǒng)的硬件和軟件設(shè)計(jì)。該檢測
  • 關(guān)鍵字： 檢測儀  設(shè)計(jì)  記憶  金屬  DSP  CPLD  基于  
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