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fpga-pwm 文章 最新資訊

基于FPGA和NiosII的逆變焊接電源控制器

  • 摘要：設(shè)計了基于FPGA和NioslI軟核的全數(shù)字逆變焊接電源控制器，采用變參數(shù)PID和改進的I-I型雙閉環(huán)電流-弧長控制策略，并應(yīng)用于數(shù)字化MIG焊接電源系統(tǒng)中。介紹了該電源控制器各模塊的功能及設(shè)計方案，分析了MIG焊接電
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濾波器對PWM變頻調(diào)速電動機端子上電壓波形的影響

  • 1引言隨著微電子技術(shù)和現(xiàn)代控制理論在交流變頻調(diào)速系統(tǒng)中的應(yīng)用，變頻器(或逆變器)的性能也得到飛躍性的提高，并越來越廣泛地應(yīng)用于工業(yè)生產(chǎn)和日常工作的許多領(lǐng)域之中。但是，變頻器輸出的具有陡上升沿或下降沿的脈沖
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基于PCI接口芯片外擴FIFO的FPGA實現(xiàn)

基于FPGA的MIII總線與RS422通信協(xié)議轉(zhuǎn)換板的設(shè)計

FPGA設(shè)計工具淺談

FPGA硬件電路的調(diào)試

ZVT－PWM移相軟開關(guān)通信基礎(chǔ)--電源模塊的設(shè)計

  • 摘要：簡單介紹ZVT—PWM移相軟開關(guān)變換電路的原理及特點，研究采用移相全橋ZVT－PWM軟開關(guān)變換電路的設(shè)計方法，并給出通信基礎(chǔ)開關(guān)電源整流模塊的設(shè)計實例及試驗結(jié)果。關(guān)鍵詞：開關(guān)電源脈寬調(diào)制移相全橋ZVT軟開
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羅氏諧振器―一種用于DC/DC變換器的PWM信號發(fā)生器

  • 摘要：羅氏諧振器是一種脈寬調(diào)制（PWM）開關(guān)信號發(fā)生器，它可以產(chǎn)生PWM脈沖列來控制DC/DC變換器，如羅氏復(fù)舉電路變換器[1]。這種諧振器僅由三個運算放大器（OA）組成，能產(chǎn)生開關(guān)信號脈沖列來控制靜態(tài)開關(guān)的導(dǎo)通和關(guān)
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FIR濾波器的FPGA實現(xiàn)方法

  • 為了給實際應(yīng)用中選擇合適FIR濾波器的FPGA實現(xiàn)結(jié)構(gòu)提供參考，首先從FIR數(shù)字濾波器的基本原理出發(fā)，分析了FIR濾波器的結(jié)構(gòu)特點，然后分別介紹了基于FPGA的FIR濾波器的串行、并行、轉(zhuǎn)置型、FFT型和分布式結(jié)構(gòu)型的實現(xiàn)方法，對于各種實現(xiàn)的結(jié)構(gòu)做了分析、比較以及優(yōu)化處理，特別是對基于FFT的FIR濾波器與傳統(tǒng)卷積結(jié)構(gòu)進行了精確的數(shù)值計算比較，最后得出滿足于低階或高階的各種FIR濾波器實現(xiàn)結(jié)構(gòu)的適用范圍及其優(yōu)缺點，并針對實際工程應(yīng)用提出了下一步需解決的問題。
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新型ZVZCT軟開關(guān)PWM變換器的研究

  • 摘要:提出一種新型的ZVZCT軟開關(guān)PWM變換器,主開關(guān)管電壓電流為互相錯開的梯形波(4個零、4個斜坡)，輔助管為零電流通斷，特別適用于以IGBT為開關(guān)器件的高壓大功率場合。通過理論分析、參數(shù)選擇、電路仿真和實驗結(jié)果對
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準(zhǔn)固定頻率滯環(huán)PWM電流模式控制方法的研究

  • 摘要:本文針對現(xiàn)有PWM電流模式控制方法的固定開關(guān)頻率與控制快速性之間的矛盾,提出了一種準(zhǔn)固定頻率滯環(huán)PWM電流模式控制方法,這種控制方法在適當(dāng)放寬對開關(guān)頻率的嚴格要求的條件下,使電流控制的快速性大大提高,同時保
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基于FPGA的24×24位低功耗乘法器的設(shè)計

  • 通過對現(xiàn)有編碼算法的改進，提出一種新的編碼算法，它降低功耗的方法是通過減少部分積的數(shù)量來實現(xiàn)的。因為乘法器的運算主要是部分積的相加，因此，減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量，從而實現(xiàn)功耗的減低。在部分積的累加過程中．又對用到的傳統(tǒng)全加器和半加器進行了必要的改進，避免了CMOS輸入信號不必要的翻轉(zhuǎn)，從而降低了乘法器的動態(tài)功耗。通過在Altera公司的FPGA芯片EP2CTOF896C中進行功耗測試，給出了測試結(jié)果，并與現(xiàn)有的兩種編碼算法進行了比較。功耗分別降低3．5％和8．4％。
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基于FPGA的多時鐘片上網(wǎng)絡(luò)設(shè)計

  • 本文介紹了一個基于FPGA 的高效率多時鐘的虛擬直通路由器，通過優(yōu)化中央仲裁器和交叉點矩陣，以爭取較小面積和更高的性能。同時，擴展路由器運作在獨立頻率的多時鐘NoC 架構(gòu)中，并在一個3×3Mesh 的架構(gòu)下實驗，分析其性能特點，比較得出多時鐘片上網(wǎng)絡(luò)具有更高的性能。
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基于DSP Builder數(shù)字信號處理器的FPGA設(shè)計

  • 針對使用硬件描述語言進行設(shè)計存在的問題，提出一種基于FPGA并采用DSP BuildIer作為設(shè)計工具的數(shù)字信號處理器設(shè)計方法。并按照Matlab／Simulink／DSP Builder／QuartusⅡ設(shè)計流程，設(shè)計了一個12階FIR低通數(shù)字濾波器，通過Quaxtus時序仿真及嵌入式邏輯分析儀signalTapⅡ硬件測試對設(shè)計進行了驗證。結(jié)果表明，所設(shè)計的FIR濾波器功能正確，性能良好。
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采用MAX II器件實現(xiàn)FPGA設(shè)計安全解決方案

  • 　本文提供的解決方案可防止FPGA設(shè)計被拷貝，即使配置比特流被捕獲，也可以保證FPGA設(shè)計的安全性。通過在握手令牌由MAX II器件傳送給FPGA之前，禁止用戶設(shè)計功能來實現(xiàn)這種安全性。選用MAX II器件來產(chǎn)生握手令牌，這是因為該器件具有非易失性，關(guān)電時可保持配置數(shù)據(jù)。而且，對于這種應(yīng)用，MAX II器件是最具成本效益的CPLD。本文還介紹了采用這種方案的一個參考設(shè)計。
  • 關(guān)鍵字： FPGA  MAX  器件  方案    
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