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fpga+dsp 文章 最新資訊

NEC推出大規(guī)模集成電路設(shè)計工具CyberWorkBench

  • 近日,NEC 推出了半導(dǎo)體設(shè)計高階綜合工具CyberWorkBench的FPGA專用版。CyberWorkBench是NEC開發(fā)的以C語言為基礎(chǔ)的LSI(注1)設(shè)計工具。該工具以ANSI-C、SystemC等C語言程序作為輸入,以自動生成高性能和高質(zhì)量的電路的合成工具為中心,具備與軟件協(xié)調(diào)的高速驗證環(huán)境、源碼調(diào)試功能、形式屬性驗證等豐富的驗證功能,從而實現(xiàn) All-in-C 。通常在設(shè)計LSI時,要使用硬件專用的描述語言HDL(注2),而使用CyberWorkBench,由于可以輸入C語言,從而使設(shè)計描述
  • 關(guān)鍵字: NEC  FPGA  

基于FPGA的二次群數(shù)字信號分接部分功能實現(xiàn)

  • 基于FPGA的二次群數(shù)字信號分接部分功能實現(xiàn),1.引言  為了提高傳輸速率,擴大通信容量,減少信道數(shù)量,通常把多路信號復(fù)用成一路信號進行傳輸。在多種復(fù)用方式中,時分復(fù)用是一種常用的方式。時分復(fù)用是多路信號按照時間間隔共享一路信道進行傳輸。復(fù)接是把多
  • 關(guān)鍵字: 功能  實現(xiàn)  部分  信號  FPGA  數(shù)字  基于  

基于DSP的SPWM直接面積等效算法分析

  • 基于DSP的SPWM直接面積等效算法分析,開始的SPWM生成技術(shù)是采用模擬電路構(gòu)成三角波和正弦波發(fā)生電路,用比較器來確定他們的交點。這種方法電路復(fù)雜,精度較差,早已淘汰。后來人們采用單片機和微機生成SPWM波,但受硬件計算速度和算法計算量的影響,往往
  • 關(guān)鍵字: 等效  算法  分析  面積  直接  DSP  SPWM  基于  

一種DSP與PCI總線的接口設(shè)計

  • 一種DSP與PCI總線的接口設(shè)計,1 引言  DSP+PCI數(shù)字信號處理方案可利用PC的強大功能實現(xiàn)對DSP的操作控制、數(shù)據(jù)分析和操作監(jiān)視等。DSP+PCI方案能充分滿足數(shù)字圖像、語音處理、高速實時數(shù)據(jù)處理等領(lǐng)域的應(yīng)用,為DSP系統(tǒng)的低成本實現(xiàn)提供了解決方案
  • 關(guān)鍵字: 接口  設(shè)計  總線  PCI  DSP  一種  

一種高速DSP的圖像處理應(yīng)用平臺的設(shè)計

  • 一種高速DSP的圖像處理應(yīng)用平臺的設(shè)計,1 引言  完成某一特定任務(wù)的圖像處理系統(tǒng),其硬件方案大體上有三種:使用通用計算機、使用ASIC和使用DSP。使用通用計算機的方案優(yōu)點在于開發(fā)周期短,費用較低,而且產(chǎn)品易于維護和升級;缺點是運算速度受到限制,對
  • 關(guān)鍵字: 平臺  設(shè)計  應(yīng)用  圖像處理  DSP  高速  

基于DSP雙路音頻信號實時處理系統(tǒng)設(shè)計

  • 基于DSP雙路音頻信號實時處理系統(tǒng)設(shè)計,摘要 采用TMS320C5509A作為核心處理器,給出了一種利用DMA結(jié)合多通道緩沖串口McBSP組成的語音信號采集系統(tǒng)的實現(xiàn)方法。合理分配了數(shù)據(jù)緩沖空間,可靠穩(wěn)定地實現(xiàn)數(shù)據(jù)的實時更新,完成雙路立體聲信號的實時采集、處理和
  • 關(guān)鍵字: 處理  理系  設(shè)計  實時  信號  DSP  雙路  音頻  基于  

基于FPGA直接序列擴頻系統(tǒng)的設(shè)計

  • 摘要 針對一般無線通信系統(tǒng)抗干擾、抗噪聲以及抗多徑性能力差的缺點,提出了一種基于FPGA的直接序列擴頻系統(tǒng)設(shè)計。該設(shè)計采用63位的pn碼作為擴頻調(diào)制的碼序列,在發(fā)送端,對信息碼進行擴頻調(diào)制;在接收端,對收到的擴
  • 關(guān)鍵字: FPGA  直接序列  擴頻系統(tǒng)    

運用SAD算法降低FPGA資源利用率

  • 介紹如何從比RTL更高層次的抽象層分析資源共享,讓資源占用率比依賴RTL設(shè)計中的互斥任務(wù)的方法更低。
  • 關(guān)鍵字: FPGA  SAD  算法  資源利用率    

基于FPGA的高速串行傳輸系統(tǒng)的設(shè)計與實現(xiàn)

  • 摘要:作為高傳輸速率和低設(shè)計成本的傳輸技術(shù),串行傳輸技術(shù)被廣泛應(yīng)用于高速通信領(lǐng)域,并已成為業(yè)界首選。在此基于對高速串行傳輸系統(tǒng)的分析,對實例進行了總體設(shè)計驗證,最終達到高速傳輸?shù)哪康摹?br />關(guān)鍵詞:FPGA;
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基于FPGA的通用異步收發(fā)器設(shè)計

  • 摘要:采用Verilog HDL語言作為硬件功能的描述,運用模塊化設(shè)計方法分別設(shè)計了通用異步收發(fā)器(UART)的發(fā)送模塊、接收模塊和波特率發(fā)生器,并結(jié)合現(xiàn)場可編程門陣列(FPGA)的特點,實現(xiàn)了一個可移植的UART模塊。該設(shè)計不
  • 關(guān)鍵字: FPGA  異步收發(fā)器    

基于FPGA多通道同步數(shù)據(jù)采集系統(tǒng)設(shè)計

  •  引言  數(shù)據(jù)采集在工業(yè)測控領(lǐng)域里有廣泛的應(yīng)用,它已成為計算機測控系統(tǒng)的一個重要的環(huán)節(jié),尤其在設(shè)備故障監(jiān)測系統(tǒng)中,由于各種設(shè)備的結(jié)構(gòu)復(fù)雜,運動形式多種多樣,發(fā)生故障的可能部位很難確定,因此我們需要從設(shè)
  • 關(guān)鍵字: FPGA  多通道  同步數(shù)據(jù)采集  系統(tǒng)設(shè)計    

NEXYS3 FPGA 開發(fā)平臺

  • Digilent公司推出了一款新型的基于FPGA的硬件開發(fā)平臺,NEXYSTM3開發(fā)板。此開發(fā)板采用了Xilinx公司最先進的Spartan6 FPGA芯片,擁有48M字節(jié)大小的外部存儲器(包括2個由Micron公司生產(chǎn)的非易失性的相變存儲器)、USB以及以太網(wǎng)接口,還有其他通用的I/O器件。
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單一DSP控制兩套三相逆變器的實現(xiàn)

  • 迄今為止的設(shè)計經(jīng)驗主張每臺逆變器和電機都擁有專門隸屬于自己的DSP控制器。最近,DSP的處理能力和外圍資源已提升到足以輕松控制兩臺電機的程度,甚至還有潛力處理更多電機。采用單一DSP控制器控  制兩套三相逆變器
  • 關(guān)鍵字: 逆變器  實現(xiàn)  三相  控制  DSP  單一  

基于DSP的聲雷達信號采集系統(tǒng)

  • 基于DSP的聲雷達信號采集系統(tǒng),在聲雷達系統(tǒng)中,發(fā)射機定向發(fā)出不同頻率的聲信號,隨后接收不同距離上的回波信號,利用回波中頻率的偏離可以測定風(fēng)速、風(fēng)向隨高度的變化。本文介紹的基于美國模擬器件公司的DSP ADSP-TS201S和ADC AD7864的信號采集系
  • 關(guān)鍵字: 采集  系統(tǒng)  信號  雷達  DSP  基于  

DSP實現(xiàn)EAS掃頻信號源設(shè)計

  • DSP實現(xiàn)EAS掃頻信號源設(shè)計,1 引言
      商品防竊監(jiān)視器(Electronic Article Surveillance)簡稱EAS,是目前超市普遍使用的安檢防竊設(shè)備。其原理是由發(fā)射電路產(chǎn)生7.8MHz~8.8MHz的掃頻信號,該信號由近場天線發(fā)射,當(dāng)天線附近有標(biāo)簽存在時(標(biāo)簽為
  • 關(guān)鍵字: 設(shè)計  信號源  EAS  實現(xiàn)  DSP  
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