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產(chǎn)品設(shè)計流程究竟有哪些？來看看資深硬件工程師怎么說的

  • 　　硬件設(shè)計就是根據(jù)產(chǎn)品經(jīng)理的需求PRS(Product?Requirement?Specification)，在COGS(Cost?of?Goods?Sale)的要求下，利用目前業(yè)界成熟的芯片方案或者技術(shù)，在規(guī)定時間內(nèi)完成符合PRS功能、性能、電源設(shè)計、功耗、散熱、噪音、信號完整性、電磁輻射、安規(guī)、器件采購、可靠性、可測試性、可生產(chǎn)性等要求的硬件產(chǎn)品?！　】梢钥吹?，一個成功的硬件設(shè)計，主要功能的實現(xiàn)只是所有環(huán)節(jié)中的一小部分，而且基本來說，主要功能的實現(xiàn)主
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FPGA火力支持 百度強化機器學習布局

  • 　　中國搜索引擎大廠百度已將人工智能、機器學習視為公司未來發(fā)展的主要方向，并對相關(guān)領(lǐng)域進行大量投資。為了強化其公有云服務(wù)支持人工智能算法的能力，該公司在其全新公有云加速服務(wù)器中部署了賽靈思(Xilinx)的FPGA。百度FPGA云端服務(wù)器是百度云推出的一項全新服務(wù)，其采用高效的賽靈思Kintex FPGA、工具和軟件，能滿足發(fā)展及部署于包含機器學習和數(shù)據(jù)安全等硬件加速的數(shù)據(jù)中心應(yīng)用需求。 　　百度云聯(lián)合總經(jīng)理兼百度基礎(chǔ)技術(shù)體系負責人劉煬表示，F(xiàn)PGA能為深度學習推論、安全及其它高速發(fā)展的數(shù)據(jù)中心應(yīng)用提供
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百度推出FPGA云服務(wù)器，采用Xilinx FPGA

  • 　　賽靈思公司(Xilinx, Inc.，(NASDAQ:XLNX))今天宣布，百度已在其公有云中部署了基于賽靈思 FPGA 的應(yīng)用加速服務(wù)。百度 FPGA 云服務(wù)器是百度云推出的一項全新服務(wù)，借助高效的賽靈思Kintex® FPGA、工具和軟件，致力于滿足企業(yè)和開發(fā)者開發(fā)和部署機器學習和數(shù)據(jù)安全等硬件加速的數(shù)據(jù)中心應(yīng)用的需求，加速人工智能和大數(shù)據(jù)應(yīng)用。 　　百度云聯(lián)合總經(jīng)理兼百度基礎(chǔ)技術(shù)體系負責人劉煬指出：“FPGA 能為深度學習推斷、安全等各種高速增長的數(shù)據(jù)中心應(yīng)用提供強大的性能
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越被阻越堅定 萊迪思CEO三度送交申請書

  • 　　2016年上半年，紫光在公開市場收購美國可編程邏輯芯片大廠萊迪思半導體(Lattice)股權(quán)6.07%，11月3日萊迪思被Canyon Bridge以13億美元收購，致使萊迪思股價暴漲近20%，但此案一直沒有獲得美國監(jiān)管單位同意。 　　據(jù)彭博(Bloomberg)報導，6月12日萊迪思首席執(zhí)行長Darin Billerbeck為出售給Canyon Bridge資本合伙公司一事，已經(jīng)第三次向美國外商投資委員會(CFIUS)申請批準，報導認為川普行政部門職位空缺也是美國外商投資委員會慢動作的原因之一。B
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“一刀切”時代結(jié)束 芯片設(shè)計有“芯”思路

  • 越來越多的解決方案需要為特定的市場來進行特殊的設(shè)計，比如說不同架構(gòu)、采用軟件定義的組件可能更適合某些特定的市場?！耙坏肚小钡臅r代已經(jīng)結(jié)束了。半導體領(lǐng)域普世的設(shè)計，對于特定市場來說并不是那么重要。
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如何利用FPGA進行時序分析設(shè)計

  • 　　FPGA(Field-Programmable Gate Array)，即現(xiàn)場可編程門陣列，它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。對于時序如何用FPGA來分析與設(shè)計，本文將詳細介紹?！　』镜碾娮酉到y(tǒng)如圖 1所示，一般自己的設(shè)計都需要時序分析，如圖 1所示的Design，上部分為時序組合邏輯，下部分只有組合邏輯。而對其進行時序分析時，一般都以時鐘為參考的，因此一般主要分析
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Achronix的2017年營業(yè)收入將比上年增長7倍并將超過1億美元

  • 　　Achronix Semiconductor公司(Achronix Semiconductor Corporation)今日宣布：其2017年的營業(yè)收入將比上年增長7倍并將超過1億美元。Achronix的超快速成長主要來自于其Speedster22i系列現(xiàn)場可編程門陣列(FPGA)產(chǎn)品的銷售，以及其Speedcore 嵌入式FPGA (eFPGA) 知識產(chǎn)權(quán)(IP)產(chǎn)品的授權(quán)。Achronix的營業(yè)收入從2016年開始顯著增長，并在2017年
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基于FPGA的1553B總線接口板設(shè)計

  • 　　引言　　目前國內(nèi)對1553B總線接口板的設(shè)計一般基于DDC公司BU-61580協(xié)議芯片完成，但只能完成協(xié)議處理部分，應(yīng)用時還需外圍的存貯器和微處理器等輔助芯片。故采用現(xiàn)場可編程門陣列(FPGA)實現(xiàn)整個接口板核心的設(shè)計?！　? 系統(tǒng)總體架構(gòu)　　1553B總線信號進入接口板后，首先通過隔離變壓器進行電平轉(zhuǎn)化，使之匹配后面收發(fā)器的工作電壓。收發(fā)器再把電平轉(zhuǎn)化后1553B差分信號轉(zhuǎn)化為可識別的TTL電平。但此時的信號仍然是曼徹斯特Ⅱ型碼，故需經(jīng)解碼和串并轉(zhuǎn)換，同時完成數(shù)據(jù)字的同步、數(shù)據(jù)、曼徹斯特碼
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差異化定位，Lattice不只是一家 FPGA 公司

  • 　　2016年11月，Canyon Bridge Capital Partners以13億美元的價格溢價30%收購萊迪思半導體，在交易完成以后，Lattice將會繼續(xù)以一間獨立子公司的型態(tài)繼續(xù)運營。目前，這一交易正在接受美國外資審議委員會(CFIUS)的審批中，據(jù)傳該基金的部分資金來自于中國政府，但萊迪思半導體并不向美國軍方出售芯片，雙方預(yù)計交易有望于年內(nèi)完成。 　　在全球 FPGA 廠商中，萊迪思半導體位列全球第三，僅次于賽靈思和英特爾旗下的 Altera，主要提供低功耗 FPGA、視頻 ASSP&a
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電路設(shè)計中的八大誤區(qū)

  • 電路設(shè)計中的八大誤區(qū)：一這板子的PCB設(shè)計要求不高，就用細一點的線，自動布吧；二，這些總線信號都用電阻拉一下，感覺放心些；三，CPU和FPGA的這些不用的I/O口怎么處理呢？先讓它空著吧，以后再說；四，這款FPGA還剩這么多門用不完，可盡情發(fā)揮吧；五，這些小芯片的功耗都很低，不用考慮……
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基于FPGA嵌入式系統(tǒng)的雷達信號模擬器

基于OFDM的電力線載波通信的研究

  • 電力線載波通信是以電力線為傳輸媒介，通過載波方式傳輸模擬或數(shù)字信號的技術(shù)，而且無外架通信線路。介紹正交頻分復用的基本原理，根據(jù)利用正交頻分復用OFDM(Orthogal Frequency Division Multiplexing)技術(shù)能夠較好調(diào)制解調(diào)信號的特性，提出一種基于OFDM的電力線載波通信系統(tǒng)設(shè)計方案，利用電力線實現(xiàn)載波通信。
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HID燈電子鎮(zhèn)流器控制電路和數(shù)字可尋址照明接口(DALI)的通信接口規(guī)范的FPGA實現(xiàn)

  • 1通過A/D采樣電子鎮(zhèn)流器的Buck電路得到電壓和電流的數(shù)字值。運用數(shù)字電路構(gòu)成PID算法，對采樣數(shù)據(jù)進行處理，產(chǎn)生PWM脈沖信號，實現(xiàn)對HID燈的恒流和恒功率控制，以達到精確調(diào)光和穩(wěn)定工作。2)將DALI通訊協(xié)議融合到FPGA中去，達到主計算機對HID燈電子鎮(zhèn)流器組群的控制和通信，以實現(xiàn)根據(jù)實際環(huán)境和需要對HID燈的精確調(diào)光和狀態(tài)查詢。
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FPGA在4G系統(tǒng)中的應(yīng)用

  • 可編程技術(shù)的特點是能夠跟隨基站設(shè)計的演進，因為通常設(shè)計在規(guī)范被完全批準之前就開始了?；拘枰罅康腁SIC器件，F(xiàn)PGA通常被用作接口和粘合邏輯：能夠快速修正設(shè)計錯誤，或支持專門的DSP器件的功能。
  • 關(guān)鍵字： 規(guī)范  FPGA  4G  

基于FPGA的存儲解決方案——外部SRAM

  • 所謂外部SRAM是指連接在FPGA外部的靜態(tài)RAM（SRAM）。外部SRAM存儲器也有不少種類。對于外部SRAM的選擇是由應(yīng)用需求的性質(zhì)決定的。使用外部SRAM存儲器既有優(yōu)點又有缺點。
  • 關(guān)鍵字： SRAM  存儲器  RAM  FPGA  
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