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雷達信號處理:FPGA還是GPU?

- FPGA和CPU一直是雷達信號處理不可分割的組成部分。傳統(tǒng)上FPGA用于前端處理,CPU用于后端處理。隨著雷達系統(tǒng)的處理能力越來越強,越來越復(fù)雜,對信息處理的需求也急劇增長。為此,F(xiàn)PGA不斷在提高處理能力和吞吐量,CPU也在發(fā)展以滿足下一代雷達的信號處理性能需求。這種努力發(fā)展的趨勢導(dǎo)致越來越多的使用CPU加速器,如圖形處理單元(GPU)等,以支持較重的處理負載。 本文對比了FPGA和GPU浮點性能和設(shè)計流程。最近幾年,GPU已經(jīng)不僅能完成圖形處理功能,而且成為強大的浮點處理平臺,被稱之為GP-
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基于FPGA 的太陽能并網(wǎng)逆變器的研究

- 系統(tǒng)概述 新能源發(fā)電成為21世紀解決能源危機的必經(jīng)出路,光伏發(fā)電、風(fēng)電、核電等新能源發(fā)電是目前新能源發(fā)電研究的幾大方向。這幾種新能源各有各的特點,我們選擇了最靠近我們的光伏發(fā)電作為研究出發(fā)點。 目前光伏發(fā)電并網(wǎng)技術(shù)的研究愈加深入成熟,而關(guān)于光伏發(fā)電技術(shù)的具體應(yīng)用環(huán)節(jié)還是有著許多發(fā)揮余地。光伏發(fā)電的優(yōu)點是清潔安全、分布相對較為均勻、可持續(xù)利用。同時光伏發(fā)電也存在自己的問題,其中一個很重要的問題是光伏發(fā)電需要做的是收集輻射到地表的太陽能,這個環(huán)節(jié)需要占用大量的空間,這個問題使光伏發(fā)電的應(yīng)用有著
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混合信號IC──復(fù)雜電源管理組件的設(shè)計挑戰(zhàn)及解決方案

- 隨著系統(tǒng)內(nèi)電源數(shù)量的增多,為了確保其安全、經(jīng)濟、持續(xù)和正常的工作,對電源軌進行監(jiān)測和控制變得非常重要,特別是在使用微處理器時。確定電壓軌是否處于工作范圍內(nèi),以及該電壓相對于其它電壓軌是否按照正確的時序上電或斷電,這些對于系統(tǒng)執(zhí)行的可靠性和安全性來說都是至關(guān)重要的。例如FPGA,在向組件提供5V I/O(輸入/輸出)電壓之前,必須先施加3.3V的核心電壓,并持續(xù)至少20ms,以避免組件上電時受到損壞。對于系統(tǒng)的可靠性來說,滿足這樣的時序要求就像要保證組件在規(guī)定的電源電壓和溫度范圍內(nèi)工作一樣至關(guān)重要。
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混合信號FPGA實現(xiàn)真正單芯片SOC

- 要實現(xiàn)能夠?qū)⑺兄匾δ芗稍趩我黄骷脑O(shè)計理由很簡單,因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外,相較于多芯片解決方案,單芯片方案的功耗也較低,同時也有助于提高對知識產(chǎn)權(quán)的保護。如果一項設(shè)計功能的精髓能夠深植于單一芯片上,將會大大增加第三方取得這項設(shè)計的困難度。 單芯片系統(tǒng)對嵌入式系統(tǒng)設(shè)計師來說,往往會隨著其面對的不同的系統(tǒng)設(shè)計而各有不同。例如,在龐大的娛樂或通信消費產(chǎn)品市場中,SoC意味著一顆具有數(shù)百萬邏輯門的集成電路(IC),其中包含許多大型定制邏輯模塊,并有將芯片的數(shù)字處
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混合信號SoC在雙色LED屏中的應(yīng)用

- 1 高速SoC單片機C8051F040特征 C8051F040系列器件是完全集成的混合信號片上系統(tǒng)型MCU,具有64個數(shù)字I/O 引腳,片內(nèi)集成了1個CAN2.0B控制器。其主要特性有: (1)高速流水線結(jié)構(gòu)的8051兼容的CIP-51內(nèi)核(可達25 MIPS);(2)全速非侵入式的在系統(tǒng)調(diào)試接口(片內(nèi)) 64 KB(C8051F040/1/2/3/4/5)可在系統(tǒng)編程的Flash存儲器,(4K+256)B的片內(nèi)RAM,尋址空間為64 KB的外部數(shù)據(jù)存儲器接口和硬件實現(xiàn)的SPI、SMBus/I2
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Synopsys宣布推出用于移動SoC的業(yè)界最低功耗PCI Express 3.1 IP解決方案
- 新思科技(Synopsys,Inc)日前宣布:推出業(yè)界功耗最低的、兼容PCI Express®(PCIe®)3.1規(guī)范的控制器和PHY知識產(chǎn)權(quán)(IP)解決方案,它們可以同時極大地降低移動系統(tǒng)級芯片(SoC)的工作和待機功耗。經(jīng)硅驗證的Synopsys DesignWare® PCIe 3.1 IP支持L1低功耗狀態(tài),并采用電源開關(guān)、分段電源層以及低待機功耗等電源門控技術(shù),使待機功耗低于10 uW/lane。此外,正常供電時,這種新型發(fā)送器設(shè)計和均衡旁路方案使工作功耗低于5mW/
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Mentor Graphics 宣布推出旨在提升測試平臺效率的 EZ-VIP 包
- Mentor Graphics公司今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗證團隊,可將創(chuàng)建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上,從而顯著提高效率。這就意味著,驗證團隊可以將更多的時間花在 QVIP 上,以驗證他們的設(shè)計在功能上是否正確。 EZ-VIP 包由 QVIP 配置軟件、一個 VIP 調(diào)通服務(wù)包和一個全新的 EZ-VIP API 組成。其中,QVI
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【從零開始走進FPGA】 玩轉(zhuǎn)VGA

- 一、VGA的誘惑 首先,VGA的驅(qū)動,這事,一般的單片機是辦不到的;由于FPGA的速度,以及并行的優(yōu)勢,加上可現(xiàn)場配置的優(yōu)勢,VGA的配置,只有俺們FPGA可以勝任,也只有FPGA可以隨心所欲地配置(當(dāng)然ARM也可以,應(yīng)用比較高吧)。 初學(xué)者就是喜歡看炫的效果,往往會忍不住想玩。尤其玩FPGA的,沒玩VGA就感到跟單片機沒啥提升,因此VGA的驅(qū)動也不得不講。Bingo當(dāng)年也是如此。擋不住VGA的誘惑,初學(xué)者問Bingo VGA問題的人也是灰常的多,也許一般教科書理論太強,實際應(yīng)用不是很身后
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Altera宣布Stratix 10的創(chuàng)新全面刷新高端FPGA和SoC業(yè)界性能指標記錄
- Altera公司今天發(fā)布其Stratix® 10 FPGA和SoC體系結(jié)構(gòu)和產(chǎn)品細節(jié),這一下一代高端可編程邏輯器件在性能、集成度、密度和安全特性方面實現(xiàn)全面突破,勢必將云時代的網(wǎng)絡(luò)通信技術(shù)推向又一個巔峰。 Stratix 10 FPGA和SoC采用了Altera革命性的HyperFlex™ FPGA架構(gòu),由Intel® 14 nm三柵極工藝技術(shù)制造,內(nèi)核性能是前一代FPGA的2倍。業(yè)界性能最好、密度最高、具有先進的嵌入式處理功能的FPGA與GPU級別浮點計算性能和異構(gòu)
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FPGA開發(fā)外設(shè)子板模塊電路設(shè)計詳解

- FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA的開發(fā)相對于傳統(tǒng)PC、單片機的開發(fā)有很大不同。FPGA以并行運算為主,以硬件描述語言來實現(xiàn);相比于PC或單片機(無論是馮諾依曼結(jié)構(gòu)還是哈佛結(jié)構(gòu))的順序操作有很大區(qū)別,也造成了FPGA開發(fā)入門較難。目前國內(nèi)有專
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非接觸式讀卡器設(shè)計方案匯總,包括RFID,磁卡等
- 讀卡器(Card Reader)是一種讀卡設(shè)備,由于卡片種類較多,所以讀卡器的含義覆蓋范圍比較廣。根據(jù)卡片類型的不同,可以將其分為IC卡讀卡器,包括接觸式IC卡,遵循ISO7816接口標準;非接觸式IC卡讀卡器,遵循ISO14443接口標準,遠距離讀卡器,遵循ETC國標GB20851接口標準。本文主要介紹非接觸式讀卡器的設(shè)計方案,供大家參考。 一種極具成本效益的磁卡讀卡器設(shè)計 通過磁性圖案存儲信息的技術(shù)最早出現(xiàn)在音頻記錄領(lǐng)域。從那以后,這個概念已被擴展應(yīng)用于許多不同產(chǎn)品,如軟盤、音頻/視頻
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fpga soc介紹
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歡迎您創(chuàng)建該詞條,闡述對fpga soc的理解,并與今后在此搜索fpga soc的朋友們分享。 創(chuàng)建詞條
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