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EEPW首頁 >> 主題列表 >> fpga soc

精確估算SoC設(shè)計動態(tài)功率的新方法

  • 　　通過省去基于文件的流程，新工具可提供完整的 RTL 功率探測和精確的門級功率分析流程。 　　在最近發(fā)布的一篇文章中，筆者強調(diào)了當(dāng)前動態(tài)功耗估算方法的內(nèi)在局限性。簡單來說，當(dāng)前的方法是一個基于文件的流程，其中包括兩個步驟。第一步，軟件模擬器或硬件仿真器會在一個交換格式 (SAIF) 文件中跟蹤并累積整個運行過程中的翻轉(zhuǎn)活動，或在快速信號數(shù)據(jù)庫 (FSDB) 文件中按周期記錄每個信號的翻轉(zhuǎn)活動。第二步，使用一個饋入 SAIF 文件的功率估算工具計算整個電路的平均功耗，或使用 FSDB 文件計算設(shè)計時間和
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將家用電器主要功能集成到可編程SoC

  • 　　大型家電通常利用一些集成電路(IC)實現(xiàn)不同的功能，包括用戶界面(UI)、感應(yīng)和過程控制等。美觀的用戶界面是烤箱、洗衣機、冰箱等家用電器的一個重要區(qū)分特性。電容式觸摸感應(yīng)是家用電器用戶界面的常用功能，因為它們非常穩(wěn)健可靠，而且其“外觀和手感”是機械按鍵無可匹敵的。除了觸摸感應(yīng)功能，用戶界面還提供聲音和視覺反饋。大型家電也需要額外集成電路，用于感應(yīng)/測量物理量，完成過程和功能選擇，以及驅(qū)動最終控制元件。本文介紹了另一種將眾多家用電器功能集成到一個可編程片上系統(tǒng)(PSoC)控制器的
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如何用賽靈思FPGA實現(xiàn)4G無線球形檢測器

  • 　　MIMO無線系統(tǒng)最佳硬判決檢測方式是最大似然(ML)檢測器。ML檢測因為比特誤碼率 (BER)性能出眾，非常受歡迎。不過，直接實施的復(fù)雜性會隨著天線和調(diào)制方案的增加呈指數(shù)級增強，使ASIC或FPGA僅能用于使用少數(shù)天線的低密度調(diào)制方案。 　　WiMAX對寬帶互聯(lián)網(wǎng)接入如同手機對語音通信一樣意義非凡。它可以取代DSL和有線服務(wù)，隨時隨地提供互聯(lián)網(wǎng)接入。只需要打開計算機，連接到最近的WiMAX天線，就可以暢游全世界的網(wǎng)絡(luò)了。 　　寬帶互聯(lián)網(wǎng)接入遇到的最大挑戰(zhàn)之一就是移動性，而這正是最新的WiMAX標(biāo)準(zhǔn)
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美高森美推出汽車等級SoC FPGA和FPGA器件

  • 　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布提供全新汽車等級現(xiàn)場可編程門陣列(FPGA)和系統(tǒng)級芯片(SoC) FPGA器件?；陂W存的下一代低功率 FPGA和ARM® Cortex®-M3使能SoC FPGA器件已經(jīng)獲得AEC-Q100等級2認(rèn)證，這是概述電子元器件標(biāo)準(zhǔn)以期確保最終系統(tǒng)可滿足汽車可靠性水平要求的行業(yè)標(biāo)準(zhǔn)規(guī)范。新的汽車等級合格 SmartFusion®2和 IGLOO&re
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FPGA+CPU：并行處理大行其道

  • 　　深亞微米時代，傳統(tǒng)材料、結(jié)構(gòu)乃至工藝都在趨于極限狀態(tài)，摩爾定律也已有些捉襟見肘。而步入深亞納米時代，晶體管的尺寸就將接近單個原子，無法再往下縮減。傳統(tǒng)ASIC和ASSP設(shè)計不可避免地遭遇了諸如設(shè)計流程復(fù)雜、生產(chǎn)良率降低、設(shè)計周期過長，研發(fā)制造費用劇增等難題，從某種程度上大大放緩了摩爾定律的延續(xù)。 　　顯而易見的是，在巨額的流片成本面前，很多中小規(guī)模公司不得不改變策略，更多的轉(zhuǎn)向FPGA的開發(fā)和設(shè)計。反觀FPGA市場，即便是5年前，其相對于ASIC的市場增速還是相當(dāng)遲緩的，但在近些年，尤其是邁進(jìn)90n
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Altera將舉辦技術(shù)大會分享最新解決方案

  • 　　Altera宣布將主辦2015年Altera技術(shù)大會(Altera Technology Day，ATD)活動，這是橫跨亞太地區(qū)八個地點的一系列以技術(shù)為導(dǎo)向的研討會，包括臺灣、印度、新加坡、馬來西亞、韓國與中國，時間將從2015年8月6日至9月23日。 　　Altera技術(shù)及市場專家將會分享在電子系統(tǒng)設(shè)計上的最新趨勢， Terasic、MathWorks與Tektronix等合作夥伴也將展示在電子設(shè)計與產(chǎn)品上使用Altera的FPGA、SoC、IP與電源解決方案，以提供加速產(chǎn)品上市的價值。關(guān)于研討會
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利用SoC設(shè)計簡化可穿戴設(shè)備的開發(fā)

  • 　　可穿戴技術(shù)受到了用戶的追捧，因為這些設(shè)備有助于分析人們的日?；顒樱⒖赏ㄟ^一種直觀的方式交換信息，極大改善我們的生活方式，給我們帶來便利。市場上有各種各樣的可穿戴電子設(shè)備，最有名的是智能手表、活動監(jiān)測器和健身手環(huán)。這些高度便攜式設(shè)備被戴在用戶身上，或以其它方式附著在人身上，能夠通過一個或多個傳感器測量和捕獲信息(參見圖1)。 　　   　　圖1：一個典型的可穿戴設(shè)備能夠整合用戶數(shù)據(jù)和外部數(shù)據(jù)，它與一個外部設(shè)備配合工作，分析并向用戶顯示信息。 　　   　　這些設(shè)
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國產(chǎn)嵌入式微處理器的探索與開拓

  • 嵌入式微處理器(CPU)是數(shù)字信息產(chǎn)品的核心引擎，其市場格局伴隨市場環(huán)境的變遷而變化。國產(chǎn)嵌入式CPU在市場浪潮中經(jīng)歷過洗禮和磨礪，因互聯(lián)網(wǎng)而興起，為物聯(lián)網(wǎng)而發(fā)力。作為本土CPU設(shè)計公司的代表，北京君正集成電路股份有限公司創(chuàng)業(yè)十年，已走出一條具有中國特色的創(chuàng)新型嵌入式CPU平臺的道路。本文通過采訪君正副總經(jīng)理周生雷，剖析國產(chǎn)嵌入式CPU市場化的探索與開拓。
  • 關(guān)鍵字： 君正  MIPS  XBurst  SOC  可穿戴設(shè)備   201508  

全新CSR SoC助力高端打印機顯著降低成本

  • 　　CSR公司日前宣布推出一款集成式片上系統(tǒng)(SOC)Quatro 5500，進(jìn)一步豐富其打印機SOC產(chǎn)品線，以推進(jìn)新一代工作組級多功能打印機(MFP)與移動設(shè)備、云端、傳統(tǒng)PC及服務(wù)器之間的無縫連接，從而實現(xiàn)快速、高品質(zhì)打印。Quatro 5500系列為傳統(tǒng)MFP解決方案提供了低成本SOC替代方案，它將分立CPU與具有打印機專用功能的定制ASIC結(jié)合起來，并為MFP制造商顯著降低物料成本。 　　Quatro 5500系列每款SOC均集成了雙ARM Cortex-A15 內(nèi)核和一個Cortex-A7
  • 關(guān)鍵字： CSR  SoC  

設(shè)計成本低、可重復(fù)使用的配電架構(gòu)

  • 　　最近，航天子系統(tǒng)采用的先進(jìn)半導(dǎo)體最底限是需有多個低電壓、具高電流軌條件，例如核心電壓小于1伏特(V)/30安培(A)的現(xiàn)場可編程門陣列(FPGA)。此外，各個負(fù)載也須具有獨特的排序、暫瞬、線路與負(fù)載調(diào)節(jié)的要求，這樣會讓配電網(wǎng)絡(luò)的設(shè)計變得更復(fù)雜。 　　目前航天總線提供28和100伏特不穩(wěn)定的電源軌，可用于為最新的航天級半導(dǎo)體生成隔離的、有效率的穩(wěn)壓電源。為滿足未來航天子系統(tǒng)的需求，開發(fā)一個低成本、可擴展的配電架構(gòu)，且可重復(fù)的設(shè)計是尋求從28或100伏特兩種輸入中，可有效地生成多個較小的電軌，并同時限制
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FPGA實戰(zhàn)演練邏輯篇：FPGA與CPLD

  • 　　盡管很多人聽說過FPGA和CPLD，但是關(guān)于FPGA與CPLD之間的區(qū)別，了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”，但是在技術(shù)上卻有一些差異。簡單地說，F(xiàn)PGA就是將CPLD的電路規(guī)模、功能、性能等方面強化之后的產(chǎn)物。(特權(quán)同學(xué)版權(quán)所有) 　　一般而言， FPGA與CPLD之間的區(qū)別如表1.1所示。(特權(quán)同學(xué)版權(quán)所有) 　　表1.1 FPGA和CPLD的比較 　　 ? 　　總而言之，F(xiàn)PGA和CPLD最大的區(qū)別是他們的存儲
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物聯(lián)網(wǎng)芯片一哥必備大招：高整合SoC

  • 　　物聯(lián)網(wǎng)晶片市場將呈現(xiàn)新戰(zhàn)局。物聯(lián)網(wǎng)應(yīng)用風(fēng)潮帶動超低功耗、少量多樣設(shè)計趨勢，激勵許多微控制器(MCU)開發(fā)商乘勢大展拳腳，并提出整合MCU、無線通訊、嵌入式記憶體、射頻(RF)、感測器及電源管理的物聯(lián)網(wǎng)系統(tǒng)單晶片(SoC)解決方案，期在產(chǎn)業(yè)典范轉(zhuǎn)移之際，取得更有利的市場立足點，進(jìn)而搶下物聯(lián)網(wǎng)晶片市場一哥寶座。 　　芯科實驗室副總裁暨M(jìn)CU與無線產(chǎn)品部門總經(jīng)理Daniel Cooley認(rèn)為，Thread同時擁有低功耗、長距離傳輸和IP網(wǎng)狀網(wǎng)路支援等優(yōu)勢，發(fā)展?jié)摿Σ蝗莺鲆暋? 　　芯科實驗室(Silico
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基于FPGA與PCI總線的并行計算平臺設(shè)計實現(xiàn)

  • 　　當(dāng)前對于各種加密算法。除了有針對性的破解算法，最基本的思想就是窮舉密鑰進(jìn)行匹配，通常稱為暴力破解算法。由于暴力破解算法包含密鑰個數(shù)較多，遍歷的時間超過實際可接受的范圍。如果計算速度提高到足夠快。這種遍歷的算法因結(jié)構(gòu)設(shè)計簡便而具有實際應(yīng)用的前景。 　　PCI總線(外設(shè)互聯(lián)總線)與傳統(tǒng)的總線標(biāo)準(zhǔn)——ISA總線(工業(yè)標(biāo)準(zhǔn)結(jié)構(gòu)總線)相比，具有更高的傳輸率(132MBps)、支持32位處理器及DMA和即插即用等優(yōu)點，用于取代ISA總線而成為目前臺式計算機的事實I/O總線標(biāo)準(zhǔn)，在普通PC
  • 關(guān)鍵字： FPGA  PCI  

基于千兆網(wǎng)的FPGA多通道數(shù)據(jù)采集系統(tǒng)設(shè)計

  • 　　FPGA豐富的邏輯資源、充沛的I/O引腳以及較低的功耗，被廣泛應(yīng)用于嵌入式系統(tǒng)和高速數(shù)據(jù)通信領(lǐng)域?，F(xiàn)如今，各大FPGA生產(chǎn)廠商為方便用戶的設(shè)計和使用，提供了較多的、可利用的IP核資源，極大地減少了產(chǎn)品的開發(fā)周期和開發(fā)難度，從而使用戶得以更專注地構(gòu)思各種各樣創(chuàng)意且實用的功能，而不是把大量時間浪費在產(chǎn)品的調(diào)試和驗證中。 　　千兆以太網(wǎng)技術(shù)在工程上的應(yīng)用是當(dāng)前的研究熱點之一。相比于其他RS-232或RS-485等串口通信，千兆以太網(wǎng)更加普及和通用，可以直接與Internet上的其他終端相連;相比于百兆網(wǎng)絡(luò)
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為什么硬件設(shè)計容易軟件難？

  • 因為硬件有了更多的模塊，及其解決方案，給人一種假象：硬件設(shè)計好像很簡單的一樣，實際呢，硬件設(shè)計才真正是考驗功底的。
  • 關(guān)鍵字： 硬件設(shè)計  FPGA  
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fpga soc介紹

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