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dsp+fpga 文章 最新資訊

基于DSP芯片TMS320C5402的數(shù)字壓縮語(yǔ)音錄放系統(tǒng)

  • 基于DSP芯片TMS320C5402的數(shù)字壓縮語(yǔ)音錄放系統(tǒng),系統(tǒng)簡(jiǎn)介

    本系統(tǒng)的主要功能是通過(guò)對(duì)語(yǔ)音信號(hào)進(jìn)行壓縮,以實(shí)現(xiàn)高效率數(shù)字錄音,可用于電話留言,語(yǔ)聲應(yīng)答等場(chǎng)合。采用磁帶錄音實(shí)現(xiàn)電話留言,雖然錄音的時(shí)間較長(zhǎng),但不便于查找和保存。數(shù)字錄音可以克服磁帶錄音的
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DSP芯片TMS320C6712的外部?jī)?nèi)存自引導(dǎo)功能的實(shí)現(xiàn)

  • DSP芯片TMS320C6712的外部?jī)?nèi)存自引導(dǎo)功能的實(shí)現(xiàn),TMS320C6000系列與TMS320C54系列的引導(dǎo)方式有很大差別。在開(kāi)發(fā)應(yīng)用TMS320C6000系列DSP時(shí),許多開(kāi)發(fā)者,尤其是初涉及者對(duì)DSP ROM引導(dǎo)的實(shí)現(xiàn)有些困難,花費(fèi)許多時(shí)間和精力摸索。筆者結(jié)合開(kāi)發(fā)實(shí)例,介紹了實(shí)現(xiàn)外部存儲(chǔ)器
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賽靈思與VSofts演示基于賽靈思FPGA的低延時(shí)實(shí)時(shí)H.264/AVC-I IP核壓縮解決方案

  •   球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司與Vanguard Software Solutions 公司 (VSofts) 在 IBC2010 大會(huì)上聯(lián)合演示了 VSofts H.264/AVC-I IP 核的強(qiáng)大功能:能實(shí)現(xiàn)超低延時(shí),且其現(xiàn)場(chǎng)可編程門(mén)陣列 (FPGA) 實(shí)施方案不僅符合國(guó)際電信聯(lián)盟 (ITU) 和 Panasonic AVC-Intra 標(biāo)準(zhǔn),而且還支持業(yè)界標(biāo)準(zhǔn)的編解碼器,能在實(shí)時(shí)視頻廣播應(yīng)用中確保源視頻到編碼視頻的最小延遲。   VSofts 市場(chǎng)營(yíng)銷(xiāo)副總裁 Felix Nemirovsky
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NI全新高通道數(shù)擴(kuò)展機(jī)箱幫助LabVIEW FPGA和C系列產(chǎn)品擴(kuò)展I/O數(shù)

  •   美國(guó)國(guó)家儀器有限公司(National Instruments,簡(jiǎn)稱(chēng)NI)近日發(fā)布NI 9157和NI 9159 MXI-Express RIO機(jī)箱,以及NI 9148以太網(wǎng)RIO機(jī)箱,這三款新產(chǎn)品在現(xiàn)有的NI 9144 EtherCAT機(jī)箱基礎(chǔ)上,進(jìn)一步擴(kuò)展了NI基于各種總線的高通道數(shù)擴(kuò)展機(jī)箱系列產(chǎn)品。利用NI可重配置I/O(RIO)技術(shù),這些機(jī)箱將基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的硬件和C系列I/O應(yīng)用到了需要數(shù)百甚至數(shù)千通道數(shù)的應(yīng)用。每一個(gè)擴(kuò)展機(jī)箱含有一個(gè)可用NI LabVIEW FPGA模塊編
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基于FPGA的DDS設(shè)計(jì)及實(shí)現(xiàn)

  • 針對(duì)DDS頻率轉(zhuǎn)換時(shí)間短,分辨率高等優(yōu)點(diǎn),提出了基于FPGA芯片設(shè)計(jì)DDS系統(tǒng)的方案。該方案利用A1tera公司的QuartusⅡ開(kāi)發(fā)軟件,完成DDS核心部分即相位累加器和ROM查找表的設(shè)計(jì),可得到相位連續(xù)、頻率可變的信號(hào),并通過(guò)單片機(jī)配置FPGA的E2PROM完成對(duì)DDS硬件的下載,最后完成每個(gè)模塊與系統(tǒng)的時(shí)序仿真。經(jīng)過(guò)電路設(shè)計(jì)和模塊仿真,驗(yàn)證了設(shè)計(jì)的正確性。由于FPGA的可編程性,使得修改和優(yōu)化DDS的功能非常快捷。
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基于電源監(jiān)控芯片TPS3307的DSP圖像處理系統(tǒng)設(shè)計(jì)

  •  電源在所設(shè)計(jì)系統(tǒng)的設(shè)備中可以說(shuō)是最簡(jiǎn)單的器件,但卻必須放在整機(jī)設(shè)計(jì)的最后考慮。為了保證整機(jī)的可靠運(yùn)轉(zhuǎn),對(duì)供電系統(tǒng)的要求越來(lái)越高?! ≡诟咚匐娐钒逯校缫曨l處理卡,由于電路的高頻特性,開(kāi)關(guān)的電磁輻射
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低功耗DSP市場(chǎng)升級(jí)在即,ADI TI相繼發(fā)力

  •   對(duì)于任何半導(dǎo)體廠商來(lái)講,低功耗永遠(yuǎn)是其追求的目標(biāo),DSP廠商也是如此。ADI及TI兩大DSP主要供貨商日前先后推出了其最新的低功耗DSP處理器,瞄準(zhǔn)滿(mǎn)足移動(dòng)、工業(yè)等對(duì)于功耗及價(jià)格敏感的應(yīng)用。   ADI公司處理器及DSP技術(shù)部市場(chǎng)總監(jiān)Colin Duggan表示,ADI BF592目標(biāo)市場(chǎng)主要包括,條碼掃描儀、智能計(jì)算、音頻處理、手持式設(shè)備、自動(dòng)外部除顫器及駕駛員輔助系統(tǒng)等,而尤其適用于目前的智能儀表中。   “由于不同國(guó)家有不同的要求,且軟件無(wú)線電標(biāo)準(zhǔn)正在制定之中,因此需要具備足夠的
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Actel FPGA現(xiàn)可配合加密內(nèi)核對(duì)抗DPA攻擊

  •   愛(ài)特公司(Actel CorporaTIon) 宣布其多種FPGA產(chǎn)品現(xiàn)可搭配使用加密內(nèi)核,對(duì)抗差分功率分析(differential Power analysis, DPA)攻擊。采用SmartFusion、Fusion、ProASIC3和 IGLOO的設(shè)計(jì)人員現(xiàn)可通過(guò)使用IP Cores公司(IP Cores, Inc.)的AES、GCM或ECC IP內(nèi)核,保護(hù)其密鑰不受DPA攻擊。IP Cores是專(zhuān)業(yè)提供主要用于安全和加密領(lǐng)域的半導(dǎo)體用IP內(nèi)核的供應(yīng)商,而這些內(nèi)核則是首次商業(yè)化地用于FPGA的
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ADI公司以超低成本、800 MMAC DSP擴(kuò)展Blackfin系列

  •   ADI),全球領(lǐng)先的高性能信號(hào)處理解決方案供應(yīng)商,最近推出800MMAC/400MHz性能的Blackfin ADSP-BF592,萬(wàn)片訂量售價(jià)僅3美元/片。Blackfin BF592的活動(dòng)功耗低至88 mW,采用小型9 mm x 9 mm 64引腳LFCSP封裝,該產(chǎn)品的問(wèn)世使得許多具有功耗限制的小尺寸應(yīng)用也能集成高性能DSP(數(shù)字信號(hào)處理器),充分滿(mǎn)足工業(yè)、醫(yī)療、視頻、音頻和通用市場(chǎng)的需求。   ADI公司DSP處理器核心技術(shù)部門(mén)業(yè)務(wù)開(kāi)發(fā)經(jīng)理Richard Murphy表示:“低成
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基于DSP的機(jī)器人視覺(jué)伺服系統(tǒng)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字: DSP  機(jī)器人  伺服系統(tǒng)  機(jī)器視覺(jué)  TMS320C6201  圖像處理  

球形檢測(cè)器在空分復(fù)用MIMO通信系統(tǒng)中的應(yīng)用及FPGA實(shí)現(xiàn)

  •  空分復(fù)用 (SDM) MIMO 處理可顯著提高頻譜效率,進(jìn)而大幅增加無(wú)線通信系統(tǒng)的容量。空分復(fù)用 MIMO 通信系統(tǒng)作為一種能夠大幅提升無(wú)線系統(tǒng)容量和連接可靠性的手段,近來(lái)吸引了人們的廣泛關(guān)注?! IMO 無(wú)線系統(tǒng)最
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基于Java的FPGA可編程嵌入式系統(tǒng)

  • 基于Java的FPGA可編程嵌入式系統(tǒng),  傳統(tǒng)的嵌入式產(chǎn)品只能實(shí)現(xiàn)某種特定的功能,不能滿(mǎn)足用戶(hù)可變的豐富多彩的應(yīng)用需求。為解決這個(gè)問(wèn)題,本文設(shè)計(jì)并實(shí)現(xiàn)了一種使用Java作為軟件平臺(tái)的基于FPGA的可編程嵌入式系統(tǒng),以實(shí)現(xiàn)系統(tǒng)對(duì)多種本地應(yīng)用和網(wǎng)絡(luò)的
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FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計(jì)

  • FPGA/CPLD狀態(tài)機(jī)的穩(wěn)定性設(shè)計(jì),  隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語(yǔ)言)為工具、FPGA/CPLD器件為載體的EDA技術(shù)的應(yīng)用越來(lái)越廣泛.從小型電子系統(tǒng)到大規(guī)模SOC(Systemonachip)設(shè)計(jì),已經(jīng)無(wú)處不在.在FPGA/CPLD設(shè)計(jì)中,狀
  • 關(guān)鍵字: 設(shè)計(jì)  穩(wěn)定性  狀態(tài)  FPGA/CPLD  

FPGA全局時(shí)鐘資源相關(guān)原語(yǔ)及使用

  • FPGA全局時(shí)鐘資源相關(guān)原語(yǔ)及使用, FPGA全局時(shí)鐘資源一般使用全銅層工藝實(shí)現(xiàn),并設(shè)計(jì)了專(zhuān)用時(shí)鐘緩沖與驅(qū)動(dòng)結(jié)構(gòu),從而使全局時(shí)鐘到達(dá)芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時(shí)延和抖動(dòng)都為最小。為了適應(yīng)復(fù)雜
  • 關(guān)鍵字: 相關(guān)  使用  資源  時(shí)鐘  全局  FPGA  
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