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dsp＋fpga 文章 最新資訊

FPGAs的DSP性能分析

  • FPGAs的DSP性能分析,　FPGA在高性能數(shù)字信號處理領(lǐng)域越來越受關(guān)注，如無線基站。在這些應(yīng)用中， FPGAs通常被用來和DSP處理器并行工作。有更多的選擇當(dāng)然是好的，但這也意味著系統(tǒng)設(shè)計師需要一個確切的FPGAs及高端DSP信號處理器性能參數(shù)圖
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德州儀器推出兩款免費(fèi)軟件開發(fā)工具

  • 　　日前，德州儀器 (TI) 宣布推出兩款免費(fèi)軟件開發(fā)工具，幫助 ARM?、Linux? 以及系統(tǒng)開發(fā)人員便捷地利用 TI 集成型浮點(diǎn)與定點(diǎn) DSP + ARM 處理器旗下 TMS320C6000? 數(shù)字信號處理器 (DSP) 的實(shí)時高密度信號處理功能。C6EZRun 與 C6EZAccel 軟件開發(fā)工具可幫助 ARM 開發(fā)人員便捷地進(jìn)行 DSP 編程，不但可簡化和加速開發(fā)進(jìn)程，而且還可縮短 DSP 的開發(fā)啟動時間與產(chǎn)品的上市時間，并降低開發(fā)成本。 　　
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基于FPGA的PCIE總線擴(kuò)展卡的設(shè)計

  • 基于FPGA的PCIE總線擴(kuò)展卡的設(shè)計,　PCIE(PCI express)是用來互聯(lián)諸如計算機(jī)和通信平臺應(yīng)用中外圍設(shè)備的第三代高性能I/0總線。PCIE體系結(jié)構(gòu)繼承了第二代總線體系結(jié)構(gòu)最有用的特點(diǎn)，采用與PCI相同的使用模型和讀/寫通信模型，支持各種常見的事務(wù)。其存
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FPGA 28納米市場戰(zhàn)火升溫 晶圓代工巨頭激烈角逐

  • 　　可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉 (Altera)先后推出28納米FPGA產(chǎn)品，不僅使FPGA市場戰(zhàn)火升溫，也讓晶圓代工市場激烈角逐，在Xilinx首度與臺積電攜手合作后，Altera在28納米產(chǎn)品的布局上亦相當(dāng)積極，近期亦展示在28納米 FPGA平臺上的25-Gbps收發(fā)器，F(xiàn)PGA雙雄的激烈競賽，預(yù)料臺積電將成為最大受惠者。 　　Altera指出，在28納米FPGA中展示25-Gbps收發(fā)器，是收發(fā)器產(chǎn)品的里程碑，該芯片是Altera用于在28納米FPGA上，
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FPGA 是實(shí)現(xiàn)綠色搜索技術(shù)的關(guān)鍵

  • 無論為數(shù)以百萬計的用戶搜索請求提供服務(wù)還是處理超大量的信息，都需要數(shù)量龐大的計算資源，進(jìn)而消耗大量能源。事實(shí)上，用于計算與冷卻的能耗費(fèi)用是數(shù)據(jù)中心運(yùn)營的最大成本 [1]。隨著數(shù)據(jù)中心的數(shù)量和規(guī)模不斷增長，
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基于FPGA的?？臻g管理器的研究和設(shè)計

  • 摘 要： 提出了一種將堆棧空間劃分為任務(wù)棧和中斷嵌套棧的設(shè)計結(jié)構(gòu)，使堆?？臻g最小化。采用VHDL硬件語言，在FPGA設(shè)備上模擬實(shí)現(xiàn)了具有自動檢驗功能的棧空間管理器。?？臻g管理器由不同功能的邏輯模塊組成，主要闡
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基于FPGA的恒溫晶振頻率校準(zhǔn)系統(tǒng)的設(shè)計

  • 摘 要: 為滿足三維大地電磁勘探技術(shù)對多個采集站的同步需求，基于FPGA設(shè)計了一種晶振頻率校準(zhǔn)系統(tǒng)。系統(tǒng)可以調(diào)節(jié)各采集站的恒溫壓控晶體振蕩器同步于GPS，從而使晶振能夠輸出高準(zhǔn)確度和穩(wěn)定度的同步信號。系統(tǒng)中
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基于VHDL和FPGA的多種分頻的實(shí)現(xiàn)方法

  • 基于VHDL和FPGA的多種分頻的實(shí)現(xiàn)方法,分頻器是數(shù)字系統(tǒng)設(shè)計中的基本電路，根據(jù)不同設(shè)計的需要，我們會遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等，有時要求等占空比，有時要求非等占空比。在同一個設(shè)計中有時要求多種形式的分頻。通常由計數(shù)器或計數(shù)器的級聯(lián)
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基于DSP芯片TMS320LF2407的人機(jī)界面設(shè)計

  • 基于DSP芯片TMS320LF2407的人機(jī)界面設(shè)計, 筆者采用TMS320LF2407作為系統(tǒng)的控制芯片，通過選擇合適的液晶顯示模塊在3V電平構(gòu)建了一個低功耗的中文人機(jī)界面。此中文人機(jī)顯示界面是以TMS320LF2407為核心的運(yùn)動控制系統(tǒng)中的重要組成部分。　　一、TMS320LF240
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基于System ACE的DSP文件系統(tǒng)設(shè)計

  • 基于System ACE的DSP文件系統(tǒng)設(shè)計,引 言　　目前，對圖像處理系統(tǒng)的速度和精度要求越來越高，采樣的數(shù)據(jù)量也越來越大。而嵌入式系統(tǒng)中的硬件資源環(huán)境一般比較苛刻，嵌入式微處理器和微控制器的內(nèi)存一般都不大。為了能夠?qū)崿F(xiàn)DSP(Digital Signal Proce
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基于VHDL 的矩陣鍵盤及顯示電路設(shè)計

  • 摘　要:為了有效防止機(jī)械式鍵盤按鍵抖動帶來的數(shù)據(jù)錯誤,這里在Quartus Ⅱ開發(fā)環(huán)境下,采用VHDL 語言設(shè)計了一種能夠?qū)C(jī)械式4 times;4 矩陣鍵盤的按鍵值依次顯示到8 個7 段數(shù)碼管上的矩陣鍵盤及顯示電路。仿真結(jié)果表
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賽靈思聯(lián)手四川虹視成立FPGA聯(lián)合實(shí)驗室

  • 　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司，2010年9月14日宣布與四川虹視顯示技術(shù)有限公司(簡稱四川虹視)在成都高新區(qū)共同成立FPGA聯(lián)合實(shí)驗室, 致力于推動虹視公司最新的OLED產(chǎn)品技術(shù)研發(fā)，賽靈思全球消費(fèi)市場總監(jiān)Harry Raftopoulos，高級技術(shù)市場經(jīng)理酆毅，四川虹視總經(jīng)理郎豐偉，技術(shù)總監(jiān)文東星、產(chǎn)品研發(fā)中心部長田朝勇等出席了簽字揭牌儀式。 　　根據(jù)雙方當(dāng)天簽署的協(xié)議，賽靈思公司計劃向四川虹視提供技術(shù)培訓(xùn)，以及多套開發(fā)工具，如Spartan®-6 消費(fèi)視頻開發(fā)套件，Spart
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FPGA全局時鐘資源相關(guān)原語及其使用

  • FPGA全局時鐘資源一般使用全銅層工藝實(shí)現(xiàn)，并設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時鐘到達(dá)芯片內(nèi)部的...
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基于FPGA的雙通道旋轉(zhuǎn)變壓器測角系統(tǒng)

  • 提出了一種基于FPGA的雙通道旋轉(zhuǎn)變壓器測角電路設(shè)計方案，通過FPGA來控制AD2S82A、AD2S80A的解碼和同步問題。同時用FPGA對轉(zhuǎn)換后數(shù)據(jù)進(jìn)行誤差補(bǔ)償和組合，以及二進(jìn)制角度值的轉(zhuǎn)換，提高了整個系統(tǒng)的集成度和可靠度。整個電路在Altium Designer 9．O設(shè)計環(huán)境下設(shè)計實(shí)現(xiàn)。采用Altera公司的EP2C35F484C6型FPGA芯片進(jìn)行FPGA部分的仿真，實(shí)驗和仿真的結(jié)果很好地實(shí)現(xiàn)了該方案的設(shè)計功能，并滿足高精度、高速度轉(zhuǎn)換的設(shè)計要求。
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基于FPGA的復(fù)數(shù)浮點(diǎn)協(xié)方差矩陣實(shí)現(xiàn)

  • 基于FPGA的協(xié)方差矩陣運(yùn)算的實(shí)現(xiàn)大多采用的是定點(diǎn)計算方式，在運(yùn)算過程中，存在數(shù)據(jù)處理動態(tài)范圍小，容易溢出，截斷誤差等問題。加之以空間譜估計為研究背景的協(xié)方差矩陣運(yùn)算，大多得到的是針對特殊陣列模型的實(shí)對稱矩陣，不具備通用性。針對定點(diǎn)運(yùn)算的不足和該運(yùn)算的適用范圍，研究了浮點(diǎn)運(yùn)算和復(fù)數(shù)運(yùn)算的特點(diǎn)，提出了基于復(fù)數(shù)矢量的浮點(diǎn)協(xié)方差運(yùn)算的FPGA實(shí)現(xiàn)方案。在Altera＼stratix＼EP1S20F780C7中的仿真和調(diào)試結(jié)果表明了該方案的有效性。
  • 關(guān)鍵字： FPGA  浮點(diǎn)  協(xié)方差矩陣    
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