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DSP架構(gòu)應(yīng)對智能電網(wǎng)諧波污染分析的挑戰(zhàn)

  • 21ic智能電網(wǎng)：在過去，諧波分析儀不僅非常昂貴，而且難以集成到大規(guī)模制造的電表中。因此，對電網(wǎng)進(jìn)行諧波污染分析是一件非常困難的事情，只能偶爾由專業(yè)操作員在某些特定位置進(jìn)行。如今，芯片不僅可以集成更多的信
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基于FPGA核心的數(shù)字化儀模塊設(shè)計

  • PXI總線是NI公司在計算機外設(shè)總線PCI的基礎(chǔ)上實現(xiàn)的新一代儀器總線，已經(jīng)成為業(yè)界開放式總線的標(biāo)準(zhǔn)，基于PXI總線的數(shù)字化儀模塊是現(xiàn)代測 試系統(tǒng)中重要的一種數(shù)據(jù)記錄與處理設(shè)備。設(shè)計一個雙通道12 bit/250 MHz采樣頻
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Renesas采用Tensilica HiFi音頻/語音DSP

  • Tensilica日前宣布與Renesas Electronics簽署協(xié)議，授權(quán)該公司使用HiFi音頻/語音DSP(數(shù)字信號處理器)。Renesas Electronics將使用HiFi DSP開發(fā)一系列SOC(片上系統(tǒng))，這些SOC將用于手機、平板電腦、汽車和其他多媒體設(shè)備上。
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Altera通過早期使用計劃，讓客戶提前了解面向FPGA的OpenCL效能優(yōu)勢

  • 　　Altera公司(NASDAQ: ALTR)今天發(fā)布其面向FPGA的OpenCL (開放計算語言)早期使用計劃(EAP)，支持客戶提前了解Altera面向FPGA的OpenCL解決方案。采用這一開放標(biāo)準(zhǔn)，設(shè)計團隊可以在高級C語言框架中面向FPGA設(shè)計他們自己的系統(tǒng)和算法，大大簡化了FPGA的開發(fā)。作為EAP計劃的一部分，客戶能夠預(yù)先了解Altera的OpenCL解決方案，參加面向FPGA的OpenCL培訓(xùn)課程，獲得相關(guān)資料，觀看其技術(shù)演示。 　　OpenCL是一種開放編程標(biāo)準(zhǔn)，能夠跨CPU、GPU和
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基于FPGA嵌入式系統(tǒng)的雷達(dá)信號模擬器設(shè)計

  • 摘 要： 結(jié)合FPGA嵌入式系統(tǒng)具有硬件電路高并行度和軟件編程控制簡單的特點，設(shè)計了一套基于FPGA嵌入式系統(tǒng)的雷達(dá)信號模擬器，能夠完成雷達(dá)中頻和視頻信號、雜波和干擾信號的模擬，實現(xiàn)雷達(dá)系統(tǒng)在不具備實際接收前端
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基于FPGA在彈上信息處理機中的應(yīng)用

  • 引言信息處理機(圖1)用于完成導(dǎo)彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā) 、422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其
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基于Spartan-3 FPGA的視頻采集系統(tǒng)設(shè)計

  • 引言視頻采集的主流實現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進(jìn)行視頻信號的采集壓
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利用C和匯編語言混合編程實現(xiàn)DSP軟件設(shè)計

  • 眾所周知，匯編語言具有更高的性能優(yōu)勢，而用C語言編碼則能更容易和快速地實現(xiàn)。DSP處理器功能的不斷增強以及編譯器優(yōu)化技術(shù)的提高，使得傳統(tǒng)的用匯編語言編寫DSP應(yīng)用程序的做法逐漸被淘汰。現(xiàn)在的DSP應(yīng)用程序幾乎都
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基于DSP／BIOS的多信號并行處理軟件架構(gòu)設(shè)計

  • 基于DSP／BIOS的多信號并行處理軟件架構(gòu)設(shè)計,摘要 利用DSP芯片設(shè)計出能夠支持多類信號多路并行處理的軟件，可減少外圍專用算法芯片的使用，降低設(shè)計成本、縮小印制板尺寸、縮短開發(fā)周期。文中介紹了一種利用DSP／BIOS操作系統(tǒng)進(jìn)行快速開發(fā)設(shè)計的軟件架構(gòu)，不僅滿
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NI基于FPGA的控制系統(tǒng)為智能電網(wǎng)電力電子系統(tǒng)帶來革新

高速DSP系統(tǒng)的電路板級電磁兼容性分析與設(shè)計

  • 高速DSP系統(tǒng)的電路板級電磁兼容性分析與設(shè)計,隨著高速DSP技術(shù)的廣泛應(yīng)用，相應(yīng)的高速DSP的PCB設(shè)計就顯得十分重要。由于DSP是一個相當(dāng)復(fù)雜、種類繁多并有許多分系統(tǒng)的數(shù)、?；旌舷到y(tǒng)，所以來自外部的電磁輻射以及內(nèi)部元器件之間、分系統(tǒng)之間和各傳輸通道間的串?dāng)_
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基于FPGA的IRIG-B編碼器的設(shè)計

  • 我國靶場測量、工業(yè)控制、電力系統(tǒng)測量與保護、計算、通信、氣象等測試設(shè)備均采用國際標(biāo)準(zhǔn)IRIG-B格式的時間碼(簡稱B碼)作為時間同步標(biāo)準(zhǔn)。B碼是一種串行的時間格式，分為直流碼(DC碼)和交流碼(AC碼)兩種，其格式和碼
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大容量無線傳輸技術(shù)中DSP的啟動方法

  • 大容量無線傳輸技術(shù)中DSP的啟動方法,1 引言

    在極低譜密度，高頻譜利用率的大容量

    如果DSP 的程序小于1K 字節(jié)，那么上述ROM 啟動機制已經(jīng)可以完成程序的加載。然而事實上大部分DSP 的程序會大于1K 字節(jié)，這時就需要創(chuàng)建一個特定啟動程序來完成更多
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基于FPGA的可復(fù)用通信接口設(shè)計

  • 摘要：集成電路設(shè)計越來越向系統(tǒng)級的方向發(fā)展，解決模塊間的接口問題顯得尤為重要。 SPI 串行總線是一種常用的標(biāo)準(zhǔn)接口，其使用簡單方便而且占用系統(tǒng)資源少，應(yīng)用相當(dāng)廣泛。 本文將介紹一種新的通用的SPI 總線的FPGA
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基于FPGA的數(shù)字中頻接收和恢復(fù)系統(tǒng)設(shè)計

  • 摘要 介紹一種數(shù)字中頻恢復(fù)系統(tǒng)，該系統(tǒng)分為光纖接收單元、FPGA核心單元和QDUC單元。光纖接收單元采用高速串行器／解串器TLK1501，完成高速串行數(shù)據(jù)的串行轉(zhuǎn)換。FPGA核心單元對數(shù)據(jù)進(jìn)行解碼、檢驗、配置TLK1501和AD9
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