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零基礎(chǔ)學(xué)FPGA（二）關(guān)于觸發(fā)器

　　太書(shū)面化的話我就不說(shuō)了啊，有些東西就像書(shū)上寫(xiě)的，真的看著看著就想睡覺(jué)了，還是大白話直白哈。　　1、關(guān)于觸發(fā)器的分類(lèi) 　　觸發(fā)器呢大體可以按這幾個(gè)部分分類(lèi)：1、按晶體管性質(zhì)分，可以分為BJT集成電路觸發(fā)器和MOS型集成電路觸發(fā)器。2、按工作方式分，可分為異步工作方式和同步工作方式，異步工作方式也就是不受時(shí)鐘控制，像基本RS觸發(fā)器，同步方式就是受時(shí)鐘控制，稱(chēng)為時(shí)鐘觸發(fā)器。3、按結(jié)構(gòu)方式分，可分為維持阻塞觸發(fā)器，延邊觸發(fā)器，主從觸發(fā)器等。4、按邏輯功能分，可分為RS觸發(fā)器，JK觸發(fā)器，D觸發(fā)器，T觸發(fā)
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零基礎(chǔ)學(xué)FPGA (一) 關(guān)于我和FPGA

　　剛開(kāi)始也不知道寫(xiě)點(diǎn)什么，畢竟我才剛剛認(rèn)識(shí)FPGA不久，也寫(xiě)不出什么東西，就寫(xiě)點(diǎn)關(guān)于我的經(jīng)歷吧，反正又不是寫(xiě)書(shū)~就隨便扯點(diǎn)，就當(dāng)是我的博客的開(kāi)篇吧! 　　我現(xiàn)在是一名大二的學(xué)生，讀的是一所普通重點(diǎn)本科，也就是非211啦!專(zhuān)業(yè)呢，是通信工程。在大學(xué)待了也差不多一年半了，給我的整體感覺(jué)是，大學(xué)豐富的生活是有了，豐富的課余活動(dòng)甚至沖散了當(dāng)時(shí)我念高中時(shí)對(duì)理想的追求。一年前，我抱著對(duì)大學(xué)的無(wú)比崇敬邁進(jìn)了大學(xué)校門(mén)，剛來(lái)嘛，當(dāng)然要做個(gè)乖孩子，每天早上起很早去早讀，每次上課都坐第一排，下了課去自習(xí)室寫(xiě)個(gè)作業(yè)，晚上回去
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基于藍(lán)牙和DSP的家用醫(yī)療保健智能機(jī)器人設(shè)計(jì)

　　1引言　　數(shù)字化家庭是未來(lái)智能小區(qū)系統(tǒng)的基本單元。所謂“數(shù)字化家庭”就是基于家庭內(nèi)部網(wǎng)絡(luò)提供覆蓋整個(gè)家庭的智能化服務(wù),包括數(shù)據(jù)通信、家庭娛樂(lè)和信息家電控制功能。　　數(shù)字化家庭設(shè)計(jì)的一項(xiàng)主要內(nèi)容是通信功能的實(shí)現(xiàn),包括家庭與外界的通信及家庭內(nèi)部相關(guān)設(shè)施之間的通信。從現(xiàn)在的發(fā)展來(lái)看,外部的通信主要通過(guò)寬帶接入Internet,而家庭內(nèi)部的通信,筆者采用目前比較具有競(jìng)爭(zhēng)力的藍(lán)牙(Bluetooth)無(wú)線接入技術(shù)。　　傳統(tǒng)的數(shù)字化家庭采用PC進(jìn)行總體控制,缺乏人性化。筆者根據(jù)
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迎向SDN與NFV FPGA早已做好準(zhǔn)備

　　網(wǎng)路速度與資料訊息呈現(xiàn)暴炸性的成長(zhǎng)，從資料中心、網(wǎng)通乃至于電信業(yè)者無(wú)不被這樣的發(fā)展洪流所影響，這也使得晶片業(yè)者們開(kāi)始采取了一些動(dòng)作，F(xiàn)PGA(可編程邏輯閘陣列)領(lǐng)導(dǎo)供應(yīng)商Xilinx(賽靈思)可以說(shuō)是其中之一。　　 ? 　　Xilinx有線通訊部門(mén)總監(jiān)Gilles Garcia指出，近年來(lái)相當(dāng)熱門(mén)的SDN(軟體定義網(wǎng)路)與NFV(網(wǎng)路功能虛擬化)預(yù)計(jì)將在2015年創(chuàng)造近100億美金的產(chǎn)值，這對(duì)于相關(guān)產(chǎn)業(yè)而言，無(wú)疑是相當(dāng)大的機(jī)會(huì)。他進(jìn)一步談到，看待SDN或是NFV，還是可以分成軟體
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用可編程模擬器件實(shí)現(xiàn)直流伺服電機(jī)的速度控制

　　1　引　言　　直流伺服電機(jī)具有響應(yīng)快、低速平穩(wěn)性好、調(diào)速范圍寬等特點(diǎn)，因而常常用于實(shí)現(xiàn)精密調(diào)速和位置控制的隨動(dòng)系統(tǒng)中，在工業(yè)、國(guó)防和民用等領(lǐng)域內(nèi)得到廣泛應(yīng)用，特別是在火炮穩(wěn)定系統(tǒng)、艦載平臺(tái)、雷達(dá)天線、機(jī)器人控制等場(chǎng)合。盡管交流伺服電機(jī)的發(fā)展相當(dāng)迅速，但在這些領(lǐng)域內(nèi)還難以取代直流伺服電機(jī)。　　傳統(tǒng)的直流調(diào)速系統(tǒng)包含2個(gè)反饋環(huán)路，即速度環(huán)和電流環(huán)，采用測(cè)速機(jī)、電流傳感器(霍爾器件)及模擬電子線路實(shí)現(xiàn)速度的閉環(huán)控制?，F(xiàn)代數(shù)字直流伺服控制則采用高速數(shù)字信號(hào)處理器(DSP)，直接對(duì)速度和電流信號(hào)進(jìn)行采樣
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基于DSP的無(wú)刷直流電機(jī)伺服系統(tǒng)設(shè)計(jì)

　　O 引言　　無(wú)刷直流電機(jī)(簡(jiǎn)稱(chēng)BLDCM)是一種用電子換向器取代機(jī)械電刷和機(jī)械換向器的新型直流電動(dòng)機(jī)，具有結(jié)構(gòu)簡(jiǎn)單，調(diào)速性好，效率高等優(yōu)點(diǎn)，目前已經(jīng)得到廣泛應(yīng)用。TMS320F2812數(shù)字信號(hào)處理器是TI公司最新推出的32位定點(diǎn)DSP控制器，器件上集成了多種先進(jìn)的外設(shè)，具有靈活可靠的控制和通信模塊，完全可以實(shí)現(xiàn)電機(jī)系統(tǒng)的控制和通信功能，為電機(jī)伺服系統(tǒng)的實(shí)現(xiàn)提供了良好的平臺(tái)。本文設(shè)計(jì)了以高性能TMS-320F2812DSP芯片為核心的無(wú)刷直流電機(jī)伺服控制系統(tǒng)。　　1 伺服控制系統(tǒng)硬件構(gòu)成及其工作
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基于DSP的高精度伺服位置環(huán)設(shè)計(jì)方案

　　機(jī)床是裝備制造業(yè)的母機(jī)，也是裝備制造業(yè)的引擎。我國(guó)“十一五”發(fā)展規(guī)劃明確規(guī)定：國(guó)產(chǎn)數(shù)控機(jī)床國(guó)內(nèi)市場(chǎng)占有率要達(dá)到60%，高端產(chǎn)品與國(guó)際先進(jìn)水平的差距縮小到5年以?xún)?nèi)。　　作為數(shù)控機(jī)床的重要功能部件，永磁同步電機(jī)伺服驅(qū)動(dòng)裝置是數(shù)控機(jī)床向高速度、高精度、高效率邁進(jìn)的關(guān)鍵基礎(chǔ)技術(shù)之一。隨著新的微處理器、電力電子技術(shù)和傳感器技術(shù)在伺服驅(qū)動(dòng)裝置的應(yīng)用，伺服驅(qū)動(dòng)器的性能獲得極大的提高。如日本的安川公司利用新的微處理器，以及通過(guò)擴(kuò)充新的控制算法，速度頻率響應(yīng)提高到了1.6kHz，具有自動(dòng)測(cè)定
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基于DSP的穩(wěn)定平臺(tái)伺服系統(tǒng)的設(shè)計(jì)研究

　　在伺服電機(jī)和伺服驅(qū)動(dòng)器組成的高性能穩(wěn)定平臺(tái)伺服系統(tǒng)中，需要實(shí)時(shí)地獲得伺服電機(jī)的轉(zhuǎn)角和轉(zhuǎn)速信息，高速高精度的傳感器以及相應(yīng)的外圍電路設(shè)計(jì)是必不可少的。由于單片機(jī)自身資源的局限性，難以滿足現(xiàn)在伺服系統(tǒng)高精度、高運(yùn)算率以及快速實(shí)時(shí)性的要求。在穩(wěn)定平臺(tái)伺服控制系統(tǒng)中，DSP已經(jīng)逐漸取代單片機(jī)，成為主流芯片。本設(shè)計(jì)采用TI公司的32 bit浮點(diǎn)型DSP芯片TMS320F28335，其工作時(shí)鐘頻率高達(dá)150 MHz，具有強(qiáng)大的運(yùn)算能力，能夠?qū)崟r(shí)地完成復(fù)雜的控制算法。片內(nèi)集成了豐富的電機(jī)控制外圍部件和電路，簡(jiǎn)化了控
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美高森美與 New Wave DV合作開(kāi)發(fā)用于以太網(wǎng)和光纖通道解決方案的創(chuàng)新網(wǎng)絡(luò)產(chǎn)品和IP內(nèi)核

　　致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation) 宣布與New Wave Design & Verification (New Wave DV)合作開(kāi)發(fā)網(wǎng)絡(luò)硬件和光纖通道IP內(nèi)核?，F(xiàn)在，PMC/XMC 卡和IP內(nèi)核均可用于美高森美的SmartFusion2® SoC FPGA和IGLOO2® FPGA器件，能夠?yàn)橛靡蕴W(wǎng)和/或光纖通道的新型國(guó)防、航空航天、企業(yè)網(wǎng)絡(luò)和存儲(chǔ)應(yīng)用加快開(kāi)發(fā)周期。　　美高
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京微雅格：打破高端通用芯片“硅谷神話”

　　4家美國(guó)公司用近9000項(xiàng)專(zhuān)利構(gòu)筑的知識(shí)產(chǎn)權(quán)壁壘，讓60多家企業(yè)先后折戟，巨額投入付之東流……這樣的領(lǐng)域，足以讓后來(lái)者望而卻步。然而，一家中國(guó)公司卻另辟蹊徑，精研知識(shí)產(chǎn)權(quán)規(guī)則，自主開(kāi)發(fā)出FPGA芯片并實(shí)現(xiàn)了量產(chǎn)，成為世界上硅谷以外唯一成功的挑戰(zhàn)者。　　FPGA，現(xiàn)場(chǎng)可編程邏輯門(mén)陣列，代表了國(guó)家重大科技專(zhuān)項(xiàng)“核高基”中的“高”——高端通用芯片中的一種，京微雅格的董事長(zhǎng)兼CEO劉明博士更愿意叫它&ldq
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DSP編程技巧之31---答疑解惑哪家強(qiáng)之（6）

　　答疑解惑哪家強(qiáng)?當(dāng)屬我們EEPW最強(qiáng)。。。接下來(lái)繼續(xù)我們的答疑解惑。　　35. 雖然可用的存儲(chǔ)空間看起來(lái)比section的長(zhǎng)度要大，但是鏈接器為何提示“placement fails for object”? 　　這種情況一般是因?yàn)槎蔚目臻g的分配是并不是我們想象中的連續(xù)的一個(gè)緊挨一個(gè)，而是被編譯器給“分塊”管理了。在內(nèi)存地址分配時(shí)，一個(gè)段需要完全適配到頁(yè)(page)中，或者從頁(yè)的邊界開(kāi)始連續(xù)分配;為了滿足這個(gè)要求，段在分配到頁(yè)中時(shí)，可能無(wú)法完全利用
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Altera演示FPGA中業(yè)界性能最好的DDR4存儲(chǔ)器數(shù)據(jù)速率

　　Altera公司今天宣布，在硅片中演示了DDR4存儲(chǔ)器接口，其工作速率是業(yè)界最高的2，666 Mbps。Altera的Arria® 10 FPGA和SoC是目前業(yè)界唯一能夠支持這一速率DDR4存儲(chǔ)器的FPGA，存儲(chǔ)器性能比前一代FPGA提高了43%，比競(jìng)爭(zhēng)20 nm FPGA高出10%。硬件設(shè)計(jì)人員現(xiàn)在可以使用最新的Quartus® II軟件v14.1，在Arria 10 FPGA和SoC設(shè)計(jì)中實(shí)現(xiàn)2，666 Mbps DDR4存儲(chǔ)器數(shù)據(jù)速率。視頻演示表明，魯棒的存儲(chǔ)器接口能夠工作在2
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一種基于DSP控制的液晶顯示屏的設(shè)計(jì)及實(shí)現(xiàn)

　　近年來(lái)，隨著低價(jià)格、高性能DSP芯片的出現(xiàn)，DSP已越來(lái)越多地被應(yīng)用于高速信號(hào)采集、語(yǔ)音處理、圖像分析處理等領(lǐng)域中，并且日益顯示其巨大的優(yōu)越性。而液晶顯示屏更以其顯示直觀、便于操作的特點(diǎn)被用作各種便攜式系統(tǒng)的顯示前端。傳統(tǒng)的液晶顯示往往采用單片機(jī)控制。但在系統(tǒng)有大量高速實(shí)時(shí)數(shù)據(jù)的情況下，單片機(jī)由于受到處理速度的限制就顯得力不從心。為了解決這些問(wèn)題，本文提出了一種基于DSP控制的液晶顯示屏的設(shè)計(jì)，有效地解決以上所遇到的問(wèn)題。　　1 SED1335控制器的介紹　　AT-320240Q1型液晶顯示屏
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基于FPGA的數(shù)字日歷設(shè)計(jì)

　　基于FPGA設(shè)計(jì)數(shù)字日歷可以實(shí)現(xiàn)以軟件方式設(shè)計(jì)硬件的目的，無(wú)需購(gòu)買(mǎi)專(zhuān)用數(shù)字芯片，從而克服了傳統(tǒng)利用多片數(shù)字集成電路設(shè)計(jì)數(shù)字日歷存在焊接麻煩、調(diào)試繁瑣、成本較高等問(wèn)題。而且，基于FPGA的數(shù)字日歷與傳統(tǒng)系統(tǒng)相比，在設(shè)計(jì)靈活、開(kāi)發(fā)速度、降低成本、計(jì)時(shí)精度、功能實(shí)現(xiàn)上都得到大幅度提升，能夠更好地滿足人們?nèi)粘Ｉ畹男枰? 　　本文介紹如何利用VHDL硬件描述語(yǔ)言設(shè)計(jì)一個(gè)具有年、月、日、星期、時(shí)、分、秒計(jì)時(shí)顯示功能，時(shí)間調(diào)整功能和整點(diǎn)報(bào)時(shí)功能的數(shù)字日歷。在QuartusⅡ開(kāi)發(fā)環(huán)境下，采用自頂向下的設(shè)計(jì)方法，建
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Altera Quartus II軟件v14.1支持業(yè)界第一款具有硬核浮點(diǎn)DSP模塊的FPGA實(shí)現(xiàn)TFLOP性能

　　Altera公司今天發(fā)布其Quartus II軟件v14.1，擴(kuò)展支持Arria 10 FPGA和SoC——FPGA業(yè)界唯一具有硬核浮點(diǎn)DSP模塊的器件，也是業(yè)界唯一集成了ARM處理器的20 nm SoC FPGA。Altera最新的軟件版本可立即支持集成在Arria 10 FPGA和SoC中的硬核浮點(diǎn)DSP模塊。用戶現(xiàn)在可以選擇三種獨(dú)特的DSP設(shè)計(jì)輸入流程，DSP性能達(dá)到業(yè)界領(lǐng)先的1.5 TFLOPS。軟件還包括多項(xiàng)優(yōu)化，加速Arria 10 FPGA和SoC設(shè)計(jì)時(shí)間，提高了
關(guān)鍵字： Altera Quartus II FPGA