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EEPW首頁 >> 主題列表 >> avant fpga

面向FPGA的ESL工具

  • 邏輯設計領域正在發(fā)生根本變化。新一代設計工具幫助軟件開發(fā)者將其算法表達直接轉(zhuǎn)換成硬件，而無需學習傳統(tǒng)的硬件設計技術(shù)。 這些工具及相關(guān)設計方法學一起被歸類為電子系統(tǒng)級 (ESL) 設計，廣泛地指從比目前主流的寄存器傳輸級 (RTL) 更高的抽象級別上開始的系統(tǒng)設計與驗證方法學。與硬件語言如 Verilog 和 VHDL比起來，ESL 設計語言在語法和語義上與流行的 ANSI C 比較接近。 ESL 與 FPGA 有何關(guān)系？ ESL 工具已經(jīng)存在了一段時間，而許多人覺得這些工具主要專注于 ASIC 設計
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賽靈思宣布SPARTAN-3A I/O優(yōu)化FPGA全線產(chǎn)品實現(xiàn)量產(chǎn)

  • 　　賽靈思公司（Xilinx, Inc. ）今天宣布90nm I/O優(yōu)化的Spartan™-3A平臺全線產(chǎn)品實現(xiàn)量產(chǎn)。這些產(chǎn)品包括Spartan-3A平臺的全部五款器件：XC3S50A、XC3S200A、XC3S400A、XC3S700A和XC3S1400A。 　　隨著產(chǎn)品架構(gòu)的不斷演進和成本的迅速降低，賽靈思Spartan系列FPGA自從1998年推出以來，應用范圍不斷擴展，目前已經(jīng)成為全球消費電子和汽車應用設計人員的首選器件平臺。其主要應用包括數(shù)字顯示、手機、PDA、汽車后座娛樂系統(tǒng)和
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采用靈活的汽車FPGA來提高片上系統(tǒng)級集成和降低物料成本

  • 汽車制造商們堅持不懈地改進車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應用。然而，汽車業(yè)較長的開發(fā)周期卻很難跟上最新技術(shù)的發(fā)展，尤其是一直處于不斷變化中的車內(nèi)聯(lián)網(wǎng)規(guī)范，以及那些來自消費市場的快速興起和消失的技術(shù)，從而造成了較高的工程設計成本和大量過時。向這些組合因素中增加低成本目標、擴展溫度范圍、高可靠性與質(zhì)量目標和有限的物理板空間，以及汽車設計中存在的挑戰(zhàn)，最多使人進一步感到沮喪?？删幊踢壿嬈骷?nbsp;(PLD)，如現(xiàn)場可編程門陣列 (FPGA)
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Actel推出業(yè)界最低功耗的FPGA系列——IGLOO

  • 　　Actel 公司宣布推出業(yè)界最低功耗的現(xiàn)場可編程門陣列 (FPGA) -- IGLOO™ 系列。這個以 Flash 為基礎的產(chǎn)品系列的靜態(tài)功耗為5µW，是最接近競爭產(chǎn)品功耗的四分之一；與目前領先的PLD產(chǎn)品比較，更可延長便攜式應用的電池壽命達5倍，因而奠定了低功耗的新標準。 　　由于便攜式產(chǎn)品的生命周期短及市場競爭激烈，設計人員必需不斷增加新的功能和復雜性，但卻不能耗用更多的電池能量。這個需求使到可重編程及全功能的Actel IGLOO 方案別具吸引力，足以取代ASIC和 C
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基于 FPGA 的 MPEG-4 編解碼器

  • 您是否曾想在您的FPGA設計中使用先進的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實現(xiàn)起來太過復雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。 視頻和多媒體系統(tǒng)正變得日益復雜，因此能否獲得適用于您的系統(tǒng)的低成本的可靠 IP 核對您的產(chǎn)品上市極為關(guān)鍵。特別是，視頻壓縮算法與標準已變成極為復雜的電路，需要花費很長時間來設計，并且常常成為系統(tǒng)測試和發(fā)貨的瓶頸。這些 MPEG-4 簡易 (simple profile) 編碼器/解碼器核也許正好
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Altera推出低成本Arria GX FPGA系列

  • Altera公司(NASDAQ: ALTR)今天宣布推出低成本Arria™ GX系列，繼續(xù)擴大了公司在收發(fā)器FPGA市場上的領先優(yōu)勢。Arria GX FPGA經(jīng)過優(yōu)化，支持速率高達2.5Gbps的PCI Express (PCIe)、千兆以太網(wǎng)(GbE)和Serial RapidIO™ (SRIO)標準；這些標準迅速成為很多市場和應用領域的主流協(xié)議。Arria GX系列的特性包括成熟的Str
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亞科鴻禹發(fā)布新版FPGA原型驗證板StarFire6S-DARM

  • 　　亞科鴻禹科技有限公司（HyperSilicon）于近日在北京推出了名為StarFire6S-DARM的系列新型FPGA原型驗證系統(tǒng)。該公司原有的StarFire5S-V系列主要針對各類視音頻SOC的設計驗證，被國內(nèi)設計公司廣泛采用累計達20多套。這款新的StarFire6S-DARM系列繼承了StarFire5S-V系列的大部分優(yōu)點，在容量、靈活性和性能指標方面有了進一步提高，同時支持采用各類型ARMTM處理器的SOC驗證，從而適應更廣泛的SOC/ASIC/IP/FPGA的原型驗證和算法實現(xiàn)的要求。
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基于CPCI總線架構(gòu)設計的實時圖像信號處理平臺

  • 摘要:  本文主要介紹了基于CPCI 總線設計的實時信號處理業(yè)務所需的一種專用設備平臺。關(guān)鍵詞： CPCI BUS；平臺；實時信號處理；DSP+FPGA 系統(tǒng)設計DSP+FPGA混用設計為了提高算法效率，實時處理圖像信息，本處理系統(tǒng)是基于DSP+FPGA混用結(jié)構(gòu)設計的。業(yè)務板以FPGA為處理核心，實現(xiàn)數(shù)字視頻信號的實時圖像處理，DSP實現(xiàn)了部分的圖像處理算法和FPGA的控制邏輯，并響應中斷，實現(xiàn)數(shù)據(jù)通信和存儲實時信號。首先，本系統(tǒng)要求DSP可以滿足算法控制結(jié)構(gòu)復雜、運算速度高、尋址靈
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基于FPGA的高階全數(shù)字鎖相環(huán)的設計與實現(xiàn)

  • 本文提出了一種基于PI 控制算法的三階全數(shù)字鎖相環(huán)，采用EDA 技術(shù)進行系統(tǒng)設計，并用可編程邏輯器件予以實現(xiàn)。
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FPGA與DS18B20型溫度傳感器通信的實現(xiàn)

  • DS18B20是DALLAS公司生產(chǎn)的一線式數(shù)字溫度傳感器，采用3引腳TO-92型小體積封裝；溫度測量范圍為-55℃～+125℃，可編程為9位～12位A/D轉(zhuǎn)換精度，測溫分辨率可達0.0625℃，被測溫度用符號擴展的16位數(shù)字量方式串行輸出。  一線式(1-WIRE)串行總線是利用1條信號線就可以與總線上若干器件進行通信。具體應用中可以利用微處理器的I/O端口對DS18B20直接進行通信，也可以通過現(xiàn)場可編程門陣列(FPGA)等可編程邏輯器件(PLD)實現(xiàn)對1-WIRE器件的通信。 
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基于ADSP-BF537的視頻SOC驗證方案

  • 本文介紹一種利用嵌入Blackfin處理器的ADSP-BF537作為處理器進行SoC的FPGA實時驗證的方案及其總線接口轉(zhuǎn)換...
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基于IP核的FPGA設計方法

  • 前　言 幾年前設計專用集成電路(ASIC) 還是少數(shù)集成電路設計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設計能力跟不上制造能力的矛盾也日益突出?，F(xiàn)在設計人員已不必全部用邏輯門去設計ASIC, 類似于用集成電路( IC) 芯片在印制板上的設計,ASIC 設計人員可以應用等
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基于FPGA的MPEG-4編解碼器

  • 您是否曾想在您的 FPGA 設計中使用先進的視頻壓縮技術(shù)，卻發(fā)現(xiàn)實現(xiàn)起來太過復雜？現(xiàn)在您無需成為一名視頻專家就能在您的系統(tǒng)中使用視頻壓縮。賽靈思新推出的 MPEG-4 編碼器/解碼器核可以幫助您滿足視頻壓縮需求。

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基于并行流水線結(jié)構(gòu)的可重配FIR濾波器的FPGA實現(xiàn)

  • 1 并行流水結(jié)構(gòu)FIR的原理 在用FPGA或?qū)Ｓ眉呻娐穼崿F(xiàn)數(shù)字信號處理算法時，計算速度和芯片面積是兩個相互制約的主要問題。實際應用FIR濾波器時，要獲得良好的濾波效果，濾波器的階數(shù)可能會顯著增加，有時可能會多達幾百階。因此，有必要在性能和實現(xiàn)復雜性之間做出選擇，也就是選擇不同的濾波器實現(xiàn)結(jié)構(gòu)。這里運用并行流水線結(jié)構(gòu)來實現(xiàn)速度和硬件面積之間的互換和折衷。 在關(guān)鍵路徑插入寄存器的流水線結(jié)構(gòu)是提高系統(tǒng)吞吐率的一項強大的實現(xiàn)技術(shù)，并且不需要大量重復設置硬件。流水線的類型主要分為兩種：算術(shù)流水線和指令流水線
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FPGA設計的驗證技術(shù)及應用原則

  • FPGA設計和驗證工程師當今面臨的最大挑戰(zhàn)之一是時間和資源制約。隨著FPGA在速度、密度和復雜性方面的增加，完成一個完整時序驗證對人力和計算機處理器、存儲器提出了更多更高的要求。 　　隨著FPGA器件體積和復雜性的不斷增加，設計工程師越來越需要有效的驗證方。時序仿真可以是一種能發(fā)現(xiàn)最多問題的驗證方法，但對許多設計來說，它常常是最困難和費時的方法之一。過去，采用標準臺式計算機的時序仿真是以小時或分鐘計算的，但現(xiàn)在對某些項目來說，在要求采用高性能64位服務器的情況下，其測試時間卻要幾天甚至幾周。這樣，這種
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