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EEPW首頁 >> 主題列表 >> avant fpga

直擴(kuò)系統(tǒng)PN碼捕獲和跟蹤的FPGA實現(xiàn)

  • 摘要：在數(shù)字匹配濾波器和超前滯后鑒相環(huán)路的理論基礎(chǔ)上，采用VHDL編程，在FPGA芯片上實現(xiàn)PN碼捕獲和跟蹤的電路。詳細(xì)討論了各電路模塊的設(shè)計實現(xiàn)方法。完成電路的仿真驗證，給出了仿真波形。結(jié)果表明電路工作正常可
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基于FPGA的電梯控制系統(tǒng)設(shè)計

  • 摘要：介紹了基于FPGA的四層電梯控制系統(tǒng)的設(shè)計。該系統(tǒng)采用Altera公司的CycloneⅡ系列FPGA芯片EP2C5T144作為主控制芯片，采用Verilog-HDL編程描述，實現(xiàn)對電梯的智能控制，經(jīng)仿真驗證，完成所要求功能。該設(shè)計采用模
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用LabVIEW FPGA模塊實現(xiàn)不同時鐘域的數(shù)據(jù)連續(xù)傳輸

  • 摘要：為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實驗表明，采用該方法設(shè)定的FIFO深
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基于FPGA的高速自適應(yīng)格型濾波器的實現(xiàn)

  • 摘要：針對高速高靈敏度數(shù)字信號處理時對于自適應(yīng)濾波器的數(shù)值特性和實時性的要求，在一種自適應(yīng)格型聯(lián)合濾波器的基礎(chǔ)上提出算法改進(jìn)，采用馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù)，在損失較小濾波性能的情況下，在FPGA中
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cpld fpga 區(qū)別

  • 系統(tǒng)的比較,與大家共享：盡管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點,但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點:①ＣＰＬＤ更適 ...
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用一個時鐘在FPGA中計算直方圖

  • 直方圖對數(shù)字?jǐn)?shù)據(jù)的分析通常是一種有用的工具。不過，要從一個直方圖獲得可靠的結(jié)果，必須獲得大量數(shù)據(jù)，通常是要...
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基于FPGA的UART接口開發(fā)方案

  • 由于FPGA的功能日益強(qiáng)大，開發(fā)周期短、可重復(fù)編程等優(yōu)點也越來越明顯，可以在FPGA芯片上集成UART功能模塊，從...
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基于FPGA的UART接口模塊設(shè)計

  • 基于FPGA的UART接口模塊設(shè)計,UART（UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器）是廣泛應(yīng)用的串行數(shù)據(jù)傳輸協(xié)議之一，其應(yīng)用范圍遍及計算機(jī)外設(shè)、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能，但電路復(fù)雜開發(fā)難
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一種基于FPGA的高速誤碼測試儀的設(shè)計

  • 摘要：誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設(shè)備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作，不僅結(jié)構(gòu)復(fù)雜，價格昂貴，而且不方便攜帶?；贔PGA的高速誤碼測試儀，采用FPGA來完成控制和測試模塊的一體化設(shè)計，提高了
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基于FPGA的FIR濾波器的性能研究

  • 摘要：目前FIR濾波器的一般設(shè)計方法比較繁瑣，開發(fā)周期長，如果采用設(shè)計好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
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基于FPGA的幅值可調(diào)信號發(fā)生器設(shè)計

  • 摘要：針對信號發(fā)生器時輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號發(fā)生器設(shè)計方案。采用AT89S52單片機(jī)為控制器，控制FPGA產(chǎn)
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基于FPGA的QDPSK調(diào)制器的設(shè)計與實現(xiàn)

  • 摘要：介紹了QDPSK信號的優(yōu)點，并分析了其實現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實現(xiàn)方案。采用自頂向下的設(shè)計思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
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紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn)

  • 紅外目標(biāo)識別跟蹤系統(tǒng)的DSP+FPGA實現(xiàn),現(xiàn)場可編程門陣列(FPGA)是在專用ASIC的基礎(chǔ)上發(fā)展出來的，它克服了專用ASIC不夠靈活的缺點。與其他中小規(guī)模集成電路相比，其優(yōu)點主要在于它有很強(qiáng)的靈活性，即其內(nèi)部的具體邏輯功能可以根據(jù)需要配置，對電路的修改和
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FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步

  • FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引 言　　正交頻分復(fù)用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進(jìn)行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
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S2C為Xilinx原型驗證系統(tǒng)提供突破性驗證模塊技術(shù)

  • S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗證系統(tǒng)中。V6 TAI Verification Module可以實現(xiàn)在FPGA原型驗證環(huán)境和用戶驗證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時查看4個FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設(shè)計。V6 TAI Verification Module具有PCIe G
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