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asic-to-fpga 文章 最新資訊

基于CPLD的壓電生物傳感器檢測(cè)電路設(shè)計(jì)

  • 介紹了一種基于復(fù)雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測(cè)電路。該檢測(cè)電路以高性能CPLD(MAX7128)...
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基于FPGA及DSP Builder的VGA接口設(shè)計(jì)

  • 基于FPGA及DSP Builder的VGA接口設(shè)計(jì),本文基于DSP Builder的VGA接口設(shè)計(jì)方法，對(duì)VGA接口時(shí)序和系統(tǒng)設(shè)計(jì)需求進(jìn)行了介紹，并在硬件平臺(tái)下實(shí)現(xiàn)一維與二維信號(hào)的顯示。

    VGA接口標(biāo)準(zhǔn)

    VGA顯像原理

    顯示器通過(guò)光柵掃描的方式，電子束在顯示屏幕上
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基于SRAM工藝FPGA的保密性問(wèn)題

  • 在現(xiàn)代電子系統(tǒng)設(shè)計(jì)中，由于可編程邏輯器件的卓越性能、靈活方便的可升級(jí)特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對(duì)FPGA器件進(jìn)行重配置，這就使得可以通過(guò)監(jiān)視配置
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基于FPGA的快速9／7整形離散小波變換系統(tǒng)

  • 美國(guó)空間數(shù)據(jù)系統(tǒng)咨詢(xún)委員會(huì)(簡(jiǎn)稱(chēng)CCSDS)于2005年推出一套適用于空間領(lǐng)域的圖像壓縮標(biāo)準(zhǔn)，標(biāo)準(zhǔn)使用了離散...
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軟件無(wú)線電設(shè)計(jì)中ASIC、FPGA和DSP的選擇

  • ASIC、FPGA和DSP的應(yīng)用領(lǐng)域呈現(xiàn)相互覆蓋的趨勢(shì)，使設(shè)計(jì)人員必須在軟件無(wú)線電結(jié)構(gòu)設(shè)計(jì)中重新考慮器件選擇...
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Modbus通信協(xié)議的FPGA實(shí)現(xiàn)

  • Modbus協(xié)議是一個(gè)應(yīng)用廣泛的工業(yè)現(xiàn)場(chǎng)總線協(xié)議，鑒于其簡(jiǎn)單、開(kāi)放、幀格式緊湊等優(yōu)點(diǎn)，于2008年正式成為我國(guó)國(guó)家標(biāo)準(zhǔn)。介紹一種通過(guò)Cyclone系列FPGA實(shí)現(xiàn)Modbus RTU模式的方法，首先給出一個(gè)可以通用于Modbus主設(shè)備和從設(shè)備的協(xié)議接口單元，然后基于該接口設(shè)計(jì)了一個(gè)通用的Modbus從設(shè)備協(xié)處理器。實(shí)踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求，此外，該方法在其他FPGA上也具有一定通用性和推廣價(jià)值。
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Altera Stratix V FPGA提供RLDRAM 3存儲(chǔ)器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時(shí)DRAM (RLDRAM® 3存儲(chǔ)器)。Stratix V FPGA采用新的存儲(chǔ)器體系結(jié)構(gòu)，降低延時(shí)，高效實(shí)現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲(chǔ)器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語(yǔ)音和數(shù)據(jù)。 　　Micron公司業(yè)務(wù)開(kāi)發(fā)高級(jí)經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲(chǔ)器專(zhuān)門(mén)設(shè)
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歐勝myZone技術(shù)為耳機(jī)和耳麥提供數(shù)字環(huán)境噪聲消除專(zhuān)用電路

  • 　　歐勝微電子有限公司今日宣布推出編號(hào)為WM2002的創(chuàng)新型立體聲耳機(jī)驅(qū)動(dòng)器，它是全球第一款可商業(yè)應(yīng)用的環(huán)境噪聲消除(ANC)特定用途集成電路(ASIC)。WM2002帶有歐勝革命性的myZone™數(shù)字環(huán)境噪音消除(ANC)技術(shù)，它將確保全球電子制造商們?yōu)橄M(fèi)者提供高性?xún)r(jià)比的、針對(duì)主流市場(chǎng)的、帶噪音消除的耳機(jī)和耳麥。 　　WM2002采用獨(dú)有的前饋噪音消除技術(shù)，可提供同類(lèi)最佳的數(shù)字ANC性能，最高的峰值主動(dòng)環(huán)境噪音消除可達(dá)30dB。通過(guò)聲學(xué)實(shí)現(xiàn)手段，WM2002可主動(dòng)消除頻率高達(dá)3.5K
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ARM920T基于Linux平臺(tái)下的FPGA驅(qū)動(dòng)開(kāi)發(fā)

  • ARM920T基于Linux平臺(tái)下的FPGA驅(qū)動(dòng)開(kāi)發(fā),Linux操作系統(tǒng)的全稱(chēng)是GNU／Linux，它是由GNU工程和Linux內(nèi)核兩個(gè)部分共同組成的一個(gè)操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的，可以有效保護(hù)學(xué)習(xí)成果，因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

    FPGA是英文Field
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基于FPGA的線性卷積的實(shí)時(shí)實(shí)現(xiàn)

  • 摘要：從實(shí)際工程應(yīng)用出發(fā)，研究了在基于FPGA上快速傅里葉變換實(shí)現(xiàn)線性卷積的方法，并搭建了一個(gè)基于Altera的EP2S60硬件處理平臺(tái)，利用Altera提供的FFT IP核，在100 MHz系統(tǒng)時(shí)鐘下，數(shù)據(jù)吞吐率可達(dá)100 Ms／s，
    關(guān)鍵
  • 關(guān)鍵字： FPGA  線性卷積    

基于FPGA的快速9／7整形離散小波變換系統(tǒng)設(shè)計(jì)

  • 摘要：CCSDS圖像數(shù)據(jù)壓縮標(biāo)準(zhǔn)中采用9／7整形離散小波變換為核心算法，該算法結(jié)構(gòu)簡(jiǎn)單，易于硬件設(shè)計(jì)實(shí)現(xiàn)。文中基于FPGA設(shè)計(jì)實(shí)現(xiàn)了9／7整數(shù)離散小波變換系統(tǒng)，設(shè)計(jì)中使用內(nèi)部RAM存儲(chǔ)方式，減小了對(duì)存儲(chǔ)器的需求量，同
  • 關(guān)鍵字： FPGA  離散小  波變換  系統(tǒng)設(shè)計(jì)    

如何選用軟件無(wú)線電結(jié)構(gòu)設(shè)計(jì)器件

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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Altera公布第二季度業(yè)績(jī)，季度股利增長(zhǎng)

  • 　　Altera公司今天宣布，第二季度銷(xiāo)售達(dá)到4.693億美元，比2010年第一季度增長(zhǎng)17%，比2009年第二季度增長(zhǎng)68%。新產(chǎn)品銷(xiāo)售持續(xù)增長(zhǎng)36%。2010年第二季度凈收入為1.806億美元，每股攤薄后收益0.58美元，與之相比，2010年第一季度凈收入為1.532億美元，每股攤薄后收益0.50美元，2009年第二季度凈收入達(dá)到0.474億美元，每股攤薄后收益為0.16美元。 　　本年度到目前為止，運(yùn)營(yíng)現(xiàn)金流為3.786億美元。Altera本季度末流動(dòng)資金和短期投入達(dá)到21億美元。 　　Alte
  • 關(guān)鍵字： Altera  28nm  FPGA  

賽靈思28納米FPGA明年量產(chǎn)　強(qiáng)攻ASIC陣地

  • 　　現(xiàn)場(chǎng)可編程邏輯閘陣列芯片(FPGA)近年來(lái)加速取代特殊應(yīng)用芯片(ASIC)市場(chǎng)，F(xiàn)PGA雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品，可望加速FPGA取代ASIC市場(chǎng)，賽靈思亞太區(qū)營(yíng)銷(xiāo)及應(yīng)用總監(jiān)張宇清指出，28納米FPGA可大幅提升效能，并降低功耗與價(jià)格，拓展以往FPGA無(wú)法取代的ASIC市場(chǎng)，加速FPGA 市場(chǎng)的成長(zhǎng)力道。 　　張宇清指出，F(xiàn)PGA要取代ASIC市場(chǎng)有4大障礙，包括需要提高更大的容量、更高的系統(tǒng)效能、更低的功耗與更低的成本，過(guò)去在40納米雖然已有
  • 關(guān)鍵字： FPGA  ASIC  28納米  
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