asic ip核 文章 進(jìn)入asic ip核技術(shù)社區(qū)
基于Wishbone總線的UART IP核的設(shè)計(jì)
- 隨著集成電路與嵌入式技術(shù)的發(fā)展與廣泛應(yīng)用，許多嵌入式系統(tǒng)都需要進(jìn)行串行通信，因此在片上嵌入式系統(tǒng)芯片中集...
- 關(guān)鍵字： Wishbone總線 UART IP核
基于H.264的Exp-Golomb解碼器ASIC設(shè)計(jì)
- 本文的研究目標(biāo)是設(shè)計(jì)H．264標(biāo)準(zhǔn)中的Exp-Golomb解碼器，在對(duì)其算法進(jìn)行深入探討的基礎(chǔ)上，提出了一種高效且低成本的ASIC實(shí)現(xiàn)方案。
Exp-Golomb編碼原理及解碼算法分析
在H．264基本規(guī)范中，除了殘差變 - 關(guān)鍵字： ASIC 設(shè)計(jì) 解碼器 Exp-Golomb H.264 基于
基于DDR3存儲(chǔ)器接口控制器IP核的視頻數(shù)據(jù)處理
- 引言與過去幾代（DDR和DDR2）器件相比，DDR3存儲(chǔ)器器件有了明顯的進(jìn)步。DDR3存儲(chǔ)器系統(tǒng)可以大大提升各...
- 關(guān)鍵字： DDR3存儲(chǔ)器接口 IP核 視頻數(shù)據(jù)處理
博世授予ADI 公司2009-2010年度最佳供應(yīng)商稱號(hào)
- Analog Devices, Inc. (NYSE:ADI)，全球領(lǐng)先的高性能信號(hào)處理解決方案供應(yīng)商及汽車行業(yè)的長(zhǎng)期合作伙伴，近日榮獲2009-2010年度“博世最佳供應(yīng)商大獎(jiǎng)”。此項(xiàng)殊榮源于 ADI 在電子產(chǎn)品領(lǐng)域（ASIC 和 ASSP）的杰出服務(wù)，尤其是其所提供的模擬和混合信號(hào)產(chǎn)品專門針對(duì)具體應(yīng)用而設(shè)計(jì)，完全符合汽車工業(yè)極高的質(zhì)量和可靠性標(biāo)準(zhǔn)。
- 關(guān)鍵字： ADI ASIC
一種高速I2C總線從器件接口IP核的設(shè)計(jì)與實(shí)現(xiàn)
- I2C總線作為一種事實(shí)上的國(guó)際標(biāo)準(zhǔn)，在超過100種不同的IC上實(shí)現(xiàn)并且得到超過50家公司的許可。它具有連線少，結(jié)構(gòu)簡(jiǎn)單的特點(diǎn)。本文介紹了一種高速I2C從器件接口電路IP核設(shè)計(jì)。在系統(tǒng)應(yīng)用中，單片機(jī)作為主控器件，本IP核作為從器件中的接口電路，它們通過I2C總線相連，實(shí)現(xiàn)MCU對(duì)IC或FPGA中相關(guān)寄存器的訪問。從而代替了MCU通用的地址數(shù)據(jù)接口，大大減少了IC或FPGA的管腳數(shù)量，節(jié)省了I/O資源，這對(duì)于I/O資源緊張的IC設(shè)計(jì)和FPGA開發(fā)是非常有意義的。
- 關(guān)鍵字： FPGA I2C總線 IP核 201107
基于FPGA IP核的線性調(diào)頻信號(hào)脈沖壓縮
- 近年來，隨著現(xiàn)場(chǎng)可編程門陣列(FPGA)在雷達(dá)信號(hào)處理中的廣泛應(yīng)用以及FPGA芯片技術(shù)的發(fā)展，為大家提供了一種較好...
- 關(guān)鍵字： 調(diào)頻信號(hào) IP核 脈沖壓縮
一種ASIC硬件圖像匹配最大互相關(guān)算法的設(shè)計(jì)和實(shí)現(xiàn)
- 一種ASIC硬件圖像匹配最大互相關(guān)算法的設(shè)計(jì)和實(shí)現(xiàn),圖像匹配是指通過一定的匹配算法在兩幅或多幅圖像之間識(shí)別同名點(diǎn)，如二維圖像匹配中通過比較目標(biāo)區(qū)和搜索區(qū)中相同大小的窗口的相關(guān)系數(shù)，取搜索區(qū)中相關(guān)系數(shù)最大所對(duì)應(yīng)的窗口中心點(diǎn)作為同名點(diǎn)。其實(shí)質(zhì)是在基元相似性
- 關(guān)鍵字： 相關(guān) 算法 設(shè)計(jì) 實(shí)現(xiàn) 最大 匹配 ASIC 硬件 圖像 一種
線性調(diào)頻信號(hào)基于FPGA IP核的脈沖壓縮設(shè)計(jì)
- 摘要：為實(shí)現(xiàn)線性調(diào)頻信號(hào)的數(shù)字脈沖壓縮，設(shè)計(jì)一個(gè)FPGA硬件平臺(tái)，并著重提出一種基于FPGA IP核的脈沖壓縮設(shè)計(jì)方法。針對(duì)脈沖壓縮進(jìn)行了理論分析和Matlab仿真，設(shè)計(jì)完成后對(duì)系統(tǒng)軟、硬件進(jìn)行了全面測(cè)試，并根據(jù)實(shí)測(cè)數(shù)
- 關(guān)鍵字： FPGA 線性調(diào)頻信號(hào) IP核 脈沖壓縮
萊迪思和FLEXIBILIS推出首個(gè)FPGA以太網(wǎng)交換IP核
- 萊迪思半導(dǎo)體公司（NASDAQ: LSCC）和Flexibilis Oy今日宣布了即可獲取Flexibilis以太網(wǎng)交換（FES）IP核。三速（10Mbps/100Mbps/1Gbps）FES IP核工作在以太網(wǎng)第2層，每個(gè)端口具有Gigabit的轉(zhuǎn)換能力。支持Gigabit光纖和Gigabit雙絞線銅以太網(wǎng)接口。支持的服務(wù)質(zhì)量高達(dá)每端口四個(gè)隊(duì)列。
- 關(guān)鍵字： LSCC FES – HSR IP核
數(shù)字下變頻器中坐標(biāo)變換模塊的ASIC實(shí)現(xiàn)
- 1．引言數(shù)字下變頻(DDC)技術(shù)是軟件無線電接收機(jī)的核心技術(shù)。其基本功能是從輸人的寬帶高速數(shù)字信號(hào)...
- 關(guān)鍵字： 數(shù)字下變頻 DDC ASIC 坐標(biāo)變換
asic ip核介紹
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