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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列（fpga）

現(xiàn)場可編程門陣列（fpga） 文章 進入現(xiàn)場可編程門陣列（fpga）技術(shù)社區(qū)

SOPC實現(xiàn)4路高清攝像頭視頻處理的方案設(shè)計，軟硬件架構(gòu)

  • 本項目基于高性能FPGA開發(fā)平臺，實現(xiàn)4路高速CCD攝像頭視頻數(shù)據(jù)采集，采用基于SIFT特征點提取算法進行圖像特征提取與匹配，并采用了加權(quán)平均方法對視頻進行拼接，實現(xiàn)4路視頻的實時拼接的環(huán)視SOC系統(tǒng)設(shè)計。
  • 關(guān)鍵字： SOPC  視頻處理  SIFT算法  FPGA  Spartan-6  

DIY你的體感游戲：人體動作識別系統(tǒng)的設(shè)計，提供軟硬件實現(xiàn)方案

  • 本項目使用Virtex-5 OpenSPARC評估平臺，首先通過VGA解碼芯片，將PC機中的視頻流數(shù)據(jù)解碼出R、G、B信號值和場、行信號。然后使用OV7670數(shù)字攝像頭，攝取人體的手部動作，運用一定的算法，對攝像頭數(shù)據(jù)進行處理，判定此時的人體動作，然后將其與RGB分量信號進行疊加，通過配置DVI接口芯片，將疊加后的圖像送至顯示器顯示。
  • 關(guān)鍵字： Virtex-5  動作識別  DIY  數(shù)字攝像頭  FPGA  

大熱的虹膜身份識別系統(tǒng)設(shè)計，提供軟硬件參考解決方案

  • 使用FPGA進行虹膜特征的提取和匹配計算。將用戶的虹膜特征數(shù)據(jù)事先存儲在數(shù)據(jù)庫中，捕獲測試者的虹膜圖像，通過預處理以及特征提取，得到待測特征數(shù)據(jù)，與數(shù)據(jù)庫中的特征數(shù)據(jù)進行模式匹配，根據(jù)Bayes最大后驗概率準則判斷測試者的身份。
  • 關(guān)鍵字： 虹膜身份識別  Spartan3E  攝像頭  虹膜圖像  FPGA  

DIY小發(fā)明：打造你自己的流媒體播放器，解決方案、硬件框圖

  • 主要內(nèi)容為利用Xilinx的Virtex-2 Pro FPGA 上豐富的邏輯資源來實現(xiàn)一個自定義的模塊，該模塊能作為流媒體播放過程中的一個功能部件。
  • 關(guān)鍵字： DIY  流媒體播放器  Virtex-2Pro  FPGA  

基于FPGA的IIR數(shù)字濾波器的設(shè)計方案

  • 用FPGA實現(xiàn)數(shù)字濾波器具有實時性強、靈活性高、處理速度快以及小批量生產(chǎn)成本低等優(yōu)點，所以得到了較為廣泛的應用。本文以巴特沃思數(shù)字帶通濾波器為例，較為詳細地介紹了其設(shè)計和實現(xiàn)方法。給定巴特沃茲數(shù)字帶通濾波器的抽樣頻率為500Hz，上、下邊帶截止頻率分別為150Hz和30Hz。
  • 關(guān)鍵字： IIR數(shù)字濾波器  雙線性變換法  FPGA  matlab  

FPGA設(shè)計頻率計算方法

  • 我們的設(shè)計需要多大容量的芯片？我們的設(shè)計能跑多快？這是經(jīng)常困擾工程師的兩個問題。對于前一個問題，我們可能還能先以一個比較大的芯片實現(xiàn)原型，待原型完成再選用大小合適的芯片實現(xiàn)。對于后者，我們需要一個比較精確的預估。
  • 關(guān)鍵字： 頻率計算  D觸發(fā)器  FPGA  Tlogic  

基于FPGA平臺構(gòu)建汽車輔助駕駛系統(tǒng)算法(圖)

  • 汽車輔助駕駛(DA)系統(tǒng)工程師通常使用 PC 模型來創(chuàng)建復雜的處理算法，以便實現(xiàn)高度可靠的自適應巡航控制、車道偏離警告及行人檢測等功能。開發(fā)人員高度重視PC算法模型，因為這種模型使他們能夠嘗試使用并快速評估不同的處理算法。不過，說到底，還是需要一款設(shè)計合理的電子硬件解決方案，來實現(xiàn)經(jīng)濟有效的大規(guī)模生產(chǎn)與部署。
  • 關(guān)鍵字： 汽車輔助駕駛  算法  FPGA  

14nm的FPGA需要什么樣的電源管理IC？

  • 現(xiàn)在的FPGA不僅僅是一個邏輯器件，它現(xiàn)在更加像一個平臺，在一個FPGA中常常會包含有數(shù)字信號處理、嵌入式處理、高速串行和其他高端技術(shù)模塊。那么，這樣的FPGA需要什么樣的電源管理IC來與之配合呢？
  • 關(guān)鍵字： 電源管理IC  14nm  FPGA  Enpirion  CycloneVSoC  

分析FPGA的基本結(jié)構(gòu)

  • FPGA由6部分組成，分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。
  • 關(guān)鍵字： 硬核  輸入/輸出  FPGA  邏輯單元  RAM  

如何通過RTL分析、SDC約束和綜合向?qū)Ц焱瞥鯢PGA設(shè)計

  • EDA 公司和 FPGA 廠商不斷開發(fā)新的工具和方法，推進繁瑣任務的自動化，幫助設(shè)計團隊集中精力做好創(chuàng)造性工作。下面我們就來看看 FPGA 工具流程的演進發(fā)展，了解一下現(xiàn)代 FPGA 團隊是如何利用 RTL分析、約束生成和綜合導向來減少設(shè)計迭代的。
  • 關(guān)鍵字： RTL  SDC  綜合向?qū)?/a>  FPGA  

基于FPGA的視頻信號發(fā)生器設(shè)計與應用研究

  • 本文介紹了一種基于FPGA的新型視頻信號發(fā)生器，它可以滿足多種被測系統(tǒng)對輸入視頻信號制式的要求。該系統(tǒng)利用USB總線與上位機進行通信，同時解決了系統(tǒng)供電的問題。在FPGA內(nèi)部，通過軟件編程的方法生成視頻信號的圖像和時序控制信號，并送入視頻D /A模塊。
  • 關(guān)鍵字： 視頻信號發(fā)生器  視頻采集卡  FPGA  

用智能的調(diào)試與綜合技術(shù)隔離FPGA設(shè)計中的錯誤

  • Synopsys公司的Synplify Premier 和Synplify Pro FPGA設(shè)計工具以及Identify RTLDebugger 等產(chǎn)品能幫助設(shè)計人員完成上述工作。這些工具的特性使得設(shè)計人員能快速隔離錯誤，有效縮短運行時間，并減少開發(fā)板啟動所需的迭代次數(shù)。
  • 關(guān)鍵字： 智能調(diào)試  SynplifyPremier  FPGA  SynplifyProFPGA  

信號去直流方法

  • 本文介紹一種根據(jù)Xilinx FPGA中DSP48E1資源設(shè)計的去直流模塊，其基本原理采用一階濾波器，如圖1所示，通過一個一階RC電路，在V0端可等效一個低通濾波器，得到直流分量。
  • 關(guān)鍵字： 信號去直流  DSP48E1  FPGA  一階濾波器  

用于實現(xiàn)嵌入式安全的開源硬件

  • 想像一下你正在排隊等待參加一個重要活動。門票是通過網(wǎng)上購買的，存儲在你的智能手機中。你需要將手機放到某個指定區(qū)域上，建立起NFC連接，門票隨之得到確認，大門開啟允許你進入。好消息是，所有這一切都是在匿名情況下發(fā)生的。
  • 關(guān)鍵字： 嵌入式安全  開源硬件  零知識證明  ZKPK  FPGA  
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現(xiàn)場可編程門陣列（fpga）介紹

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