脈沖壓縮技術(shù)簡介及其基于FPGA的設(shè)計
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本文引用地址：http://2s4d.com/article/246042.htm
圖4 1024點脈沖壓縮狀態(tài)FPGA計算結(jié)果與MATLAB計算結(jié)果對比圖
圖5 512點脈沖壓縮狀態(tài)FPGA計算結(jié)果與MATLAB計算結(jié)果對比圖
圖6 256點脈沖壓縮狀態(tài)FPGA計算結(jié)果與MATLAB計算結(jié)果對比圖
圖4至圖6分別對應(yīng)時寬為60μs、20μs、6μs，帶寬均為5M的線性調(diào)頻信號。其中，左圖對應(yīng)MATLAB的計算結(jié)果，右圖為 FPGA芯片的輸出結(jié)果?？梢钥吹?，F(xiàn)PGA芯片的輸出結(jié)果和MATLAB仿真結(jié)果吻合。經(jīng)測試驗證結(jié)果良好，最大誤差不超過-76db，在內(nèi)部時鐘頻率 80MHz條件下，完成1024點FFT 運行時間為146μs ，滿足了雷達系統(tǒng)實時處理要求，達到了滿意的效果。
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