基于FPGA的光纖通信系統(tǒng)的設(shè)計與實現(xiàn)
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NRZI編碼器ModelSim仿真波形如圖8所示。data_in輸入數(shù)據(jù)分別為D30．0和D7．1。本文引用地址：http://2s4d.com/article/190204.htm
4．2 NRZI解碼器設(shè)計
NRZI解碼器設(shè)計是NRZI編碼器的逆過程。圖9為本設(shè)計采用的NRZI解碼電路。其中，DFF為D觸發(fā)器，XOR為異或門。NRZI_data為信號輸入端，數(shù)據(jù)來自經(jīng)光纖傳輸?shù)腘RZI碼；clock時鐘頻率同編碼起時鐘頻率，即為NRZI_data碼元速率的2倍(由FPGA倍頻電路實現(xiàn))；data_out為解碼器輸出。
NRZI解碼器ModelSim仿真波形如圖10所示。NRZI_data輸入數(shù)據(jù)分別為D30．0和D7．1編碼后的數(shù)據(jù)。
5 結(jié)束語
文中主要用Verilog語言編寫了位同步時鐘提取模塊、8B／10B編解碼模塊、NRZI編解碼模塊等來實現(xiàn)光纖通信。8B／10B編碼很好地平衡了位流中0和1的個數(shù)，特別適合光纖介質(zhì)的信息傳輸；NRZI編碼使信號的狀態(tài)變化更加頻繁，進(jìn)一步增強了發(fā)送設(shè)備與接收設(shè)備的可同步性；位同步時鐘提取使得發(fā)送設(shè)備與接收設(shè)備保持同步，同時為接收端解碼器提供可靠的時鐘參考。這幾大模塊相輔相成，共同維持光纖通信系統(tǒng)可靠、高效的運行。
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