針對未來十年 “All Programmable”器件的顛覆之作

　　歷經(jīng)四年的開發(fā)和一年的試用版本測試，賽靈思可編程顛覆之作 Vivado 設計套件終于震撼登場，并通過其早期試用計劃開始向客戶隆重推出。新的工具套件面向未來十年 “All Programmable”器件而精心打造， 致力于加速其設計生產(chǎn)力。

　　賽靈思市場營銷與公司戰(zhàn)略高級副總裁Steve Glaser表示：“在過去的幾年中，賽靈思把??半導體技術的創(chuàng)新推向了一個新的高度，并釋放了可編程器件全面的系統(tǒng)級能力。隨著賽靈思在獲獎的Zynq™-7000 EPP(可 擴展式處理平臺)器件、革命性的3D Virtex -7堆疊硅片互聯(lián)(SSI)的技術器件上的部署， 除了我們在FPGA技術上的不斷創(chuàng)新之外， ，我們正開啟著一個令人興奮的新時代——一個“All Programmable”器件的時代。”

　　“All Programmable”器件，將使設計團隊不僅能夠為他們的設計編程定制邏輯，而且也可以基于ARM®和賽靈思處理子系統(tǒng)、算法和I / O進行編程?？傊?，這是一個全面的系統(tǒng)級的器件。Steve Glaser說“未來“All Programmable”器件要比可編程邏輯設計更多。他們將是可編程的系統(tǒng)集成，投入的芯片越來越少，而集成的系統(tǒng)功能卻越來越多。”

　　Steve Glaser還表示，在利用“All Programmable”器件創(chuàng)建系統(tǒng)的時候，設計者所面臨的是一套全新的集成和實現(xiàn)設計生產(chǎn)力的瓶頸問題。一方面從集成的角度講，其中包括集成算法C和寄存器傳輸級(RTL)的IP;混合了DSP、嵌入式、連接和邏輯域;驗證模塊和“系統(tǒng)”，以及設計和IP的重用等。實現(xiàn)的瓶頸包括芯片規(guī)劃和分層;多領域和大量的物理優(yōu)化;多元的“設計”與“時序”收斂;和后期的ECO和設計變更的連鎖效應。

　　正是為了解決集成和實現(xiàn)的瓶頸，使用戶能夠充分利用這些“All Programmable”器件的系統(tǒng)集成能力，賽靈思打造了全新Vivado設計套件。

　　在Vivado 設計套件這一以系統(tǒng)為中心的工具套件的開發(fā)過程中，賽靈思以業(yè)界標準為標桿并采用了先進的 EDA 技術與方法。為此，無論是需要高度自動化按鍵式流程的客戶，還是需要實際操作性極強的可修改流程的客戶，他們現(xiàn)在能夠比以往更快更高效地進行設計(甚至包括賽靈思最大型的 FPGA 設計)，同時還是在一個熟悉而直觀的先進的 EDA 環(huán)境下工作。

　　賽靈思開發(fā) Vivado 設計套件的目的是為客戶提供一種具有完整系統(tǒng)可編程功能的新型工具套件，該套件遠遠超越了賽靈思為時甚久的旗艦型 ISE 設計套件。為幫助客戶順利過渡到Vivado 設計套件的使用，賽靈思將繼續(xù)堅定地為采用 7 系列及更早期的賽靈思 FPGA 技術的客戶提供 ISE 支持。今后 Vivado 設計套件將成為賽靈思的旗艦設計環(huán)境，支持所有 7 系列器件及賽靈思未來器件。

　　賽靈思公司設計方法市場營銷高級總監(jiān) Tom Feist 預計，一旦客戶啟用 Vivado 設計套件，就會立即體會到其相對于 ISE 的優(yōu)勢。

　　Feist說：“與同類競爭工具相比，Vivado 設計套件的運行時間可縮短高達 4 倍，能夠顯著提升用戶的設計生產(chǎn)力。同時該設計套件純熟地運用了多種業(yè)界標準，諸如 System Verilog、SDC(Synopsys 設計約束)、C/C++/System C、ARM AMBA AXI-4互聯(lián)、互動 TCL(工具命令語言)腳本。Vivado 設計套件的其它突出優(yōu)勢包括為 Vivado 的眾多報告和設計視圖提供全面的交叉探測功能、預計將于 2012 年推出的高級圖形化 IP 集成功能、首款得到 FPGA 廠商全面支持的商用高層次綜合技術(C++ 到 HDL綜合)。

　　一個面向新一代可編程設計的設計工具

　　賽靈思早在 1997 年就推出了 ISE 設計套件。ISE套件采用了當時非常具有創(chuàng)新性的基于時序的布局布線引擎，這是1995 年 4 月賽靈思收購 NeoCAD 獲得的。在其后 15 年的時間里，隨著 FPGA 能夠執(zhí)行日趨復雜的功能，賽靈思為 ISE 套件增添了許多新技術，包括多語言綜合與仿真、IP 集成以及眾多編輯和測試實用功能，努力不斷從各個方面改進 ISE 設計套件。Feist 表示，賽靈思通過借鑒 ISE 設計套件的所有經(jīng)驗、注意事項和關鍵技術，并充分利用最新 EDA 算法、工具和技術，才打造出了這一顛覆性的全新 Vivado 設計套件。

　　Feist 表示：“Vivado 設計套件將顯著提升當今設計的生產(chǎn)力，且能夠輕松實現(xiàn)升級擴展，應對20nm 芯片及更小工藝技術所帶來的容量和設計復雜性挑戰(zhàn)。在過去 15 年時間里，EDA 技術取得了長足的發(fā)展。我們是從頭開始開發(fā)這套工具的，所以我們能夠在套件中采用最先進的 EDA 技術和標準，讓其具有很強的前瞻性。”

　　確定性的設計收斂

　　任何 FPGA 廠商的集成設計套件的核心都是物理設計流程，包括綜合， 布局規(guī)劃、布局、布線、功耗和時序分析、優(yōu)化和ECO。 有了Vivado，賽靈思打造了一個最先進的設計實現(xiàn)流程，可以讓客戶更快地達到設計收斂的目標。