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mcu-fpga 文章 最新資訊

基于CORDIC算法和FPGA的數(shù)字頻率校正的實現(xiàn)

  • 本文通過對CORDIC算法的工作原理進(jìn)行分析，給出了基于CORDIC算法和FPGA實現(xiàn)數(shù)字頻率校正的實現(xiàn)方案。仿真結(jié)果證明，該方法可以實現(xiàn)標(biāo)準(zhǔn)的正弦波和余弦波信號，可以直接作為頻偏校正單元來對數(shù)字頻率信號進(jìn)行校正。
  • 關(guān)鍵字： CORDIC  FPGA  算法  數(shù)字頻率    

基于FPGA-NIOS的多功能留言機(jī)設(shè)計

  • 摘要：隨著科技的進(jìn)步，人們生活中對于聯(lián)絡(luò)的需求越來越高，而傳統(tǒng)基于電話的留言機(jī)在沒有手機(jī)或電話的情況下具有諸多不便。針對上述需求，設(shè)計了一款應(yīng)用于家庭用戶中的多功能留言機(jī)。考慮到FPGA的諸多特點，采用可
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基于FPGA的倏逝波型光纖氣體檢測研究

  • 摘要：文章就光纖氣體傳感器的背景和發(fā)展進(jìn)行了介紹，并且對倏逝波型的光纖氣體檢測原理進(jìn)行了分析與研究。設(shè)計了一款基于FPGA的倏逝波型的光纖氣體檢測系統(tǒng)。通過模擬與實驗，提高了檢測靈敏度和響應(yīng)時間，可進(jìn)行多
  • 關(guān)鍵字： FPGA  倏逝波型  光纖氣體  檢測    

基于單片機(jī)的自動血壓監(jiān)控系統(tǒng)設(shè)計原理

基于MCGS的電動汽車充電站監(jiān)控系統(tǒng)設(shè)計

MCU設(shè)計向左走向右走？選MIPS還是ARM

  • 　　MCU(Micro Control Unit)中文名稱為微控制單元，又稱單片微型計算機(jī)(Single Chip Microcomputer)或者單片機(jī)，是指隨著大規(guī)模集成電路的出現(xiàn)及其發(fā)展，將計算機(jī)的CPU、RAM、ROM、定時計數(shù)器和多種I/O接口集成在一片芯片上，形成芯片級的計算機(jī)，為不同的應(yīng)用場合做不同組合控制常見存儲器件。
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賽靈思強(qiáng)化通信市場競爭力 欲成為FPGATOP1供應(yīng)商

  • 　　一直以來，通信都是賽靈思整體業(yè)務(wù)的中流砥柱。今年年初，賽靈思專門成立通信事業(yè)部，并成功完成三起在光網(wǎng)絡(luò)領(lǐng)域的收購，更好地布局通信市場，他們的目標(biāo)是成為華為、中興等通信廠商的FPGATOP1供應(yīng)商。 　　2011年發(fā)生的那些兒事和即將發(fā)生的那些事兒無不顯示著賽靈思在通信市場的持續(xù)專注和深耕。
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基于FPGA短波差分跳頻信號發(fā)生器的設(shè)計與實現(xiàn)

  • 摘要：差分跳頻(DFH)是一種新的短波跳頻技術(shù)，它主要歸結(jié)為一種G函數(shù)算法，這種G函數(shù)集跳頻圖案、信息調(diào)制與解調(diào)于一體。它的通信機(jī)理與常規(guī)跳頻完全不同，較好的解決了數(shù)據(jù)速率和跟蹤、干擾等問題，代表了當(dāng)前短波通
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大眾“帕薩特”D級車：實現(xiàn)18.4km/L燃效，標(biāo)配駕駛員疲勞警告功能

低成本是關(guān)鍵 解讀通用eAssist混動系統(tǒng)

賽靈思Spartan-6 FPGA助力最新NI CompactRIO系統(tǒng)

  • 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 （Xilinx, Inc. (NASDAQ:XLNX) ）在 2011 年 NIWeek 大會期間宣布，美國國家儀器公司 (NI) 推出采用賽靈思旗艦型Spartan?-6 FPGA的業(yè)界首款多核、性能最高的 NI CompactRIO 系統(tǒng)和最小型化的 NI Single-Board RIO器件，進(jìn)一步豐富了其可重配置 I/O (RIO) 高級控制與監(jiān)控產(chǎn)品系列。
  • 關(guān)鍵字： 賽靈思  Spartan-6 FPGA  

基于Verilog簡易UART的FPGA/CPLD實現(xiàn)

  • 基于Verilog簡易UART的FPGA/CPLD實現(xiàn),目標(biāo)：在xo640上實現(xiàn)一個簡單的Uart，能夠解析串口數(shù)據(jù)，并在寄存器中存儲，用FIFO實現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過開發(fā)板上的串口經(jīng)CPLD訪問各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等，極大方便后期的開發(fā)和調(diào)試。
  • 關(guān)鍵字： FPGA/CPLD  實現(xiàn)  UART  簡易  Verilog  基于  

基于FPGA的漢明距離電路的實現(xiàn)

  • 摘要：FPGA既具有門陣列的高邏輯密度和高可靠性，又具有可編程邏輯器件的用戶可編程性，可以減少系統(tǒng)的設(shè)計和維護(hù)風(fēng)險，降低產(chǎn)品成本，縮短設(shè)計周期。文中給出了利用FPGA設(shè)計漢明距離的計算電路，同時給出與通過有效
  • 關(guān)鍵字： FPGA  漢明距離  電路    

基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計

  • 基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計,人為地對雷達(dá)進(jìn)行測試時，有時只對雷達(dá)的某個和某些參數(shù)感興趣，希望在回波中表征感興趣的參數(shù)強(qiáng)一些，這時就應(yīng)該在回波中去掉雜波和噪聲的影響，而這在實際的外場試飛過程中是不可能實現(xiàn)的，這也是雷達(dá)信號模擬器對
  • 關(guān)鍵字： 目標(biāo)  模擬器  設(shè)計  雷達(dá)  系統(tǒng)  FPGA  嵌入式  基于  

MCU+DSP雙處理器的嵌入式平臺構(gòu)建

  • MCU+DSP雙處理器的嵌入式平臺構(gòu)建,自動化控制要求實時采集數(shù)據(jù)，快速控制，多樣分析，通信靈活，雖然采用單個處理器構(gòu)成的硬件平臺不能滿足要求。采用以MCU+DSP雙處理器為核心的硬件平臺則是較合理的設(shè)計方案。利用DSP實現(xiàn)數(shù)據(jù)實時采集、分析、計算;M
  • 關(guān)鍵字： 平臺  構(gòu)建  嵌入式  處理器  DSP  MCU  
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