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EEPW首頁(yè) >> 主題列表 >> lattice(萊迪思)半導(dǎo)體公司

萊迪思宣布首個(gè)符合PCI Express 2.0規(guī)范的低成本FPGA

  • 　　萊迪思半導(dǎo)體公司日前宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對(duì)最近PCI – SIG研討會(huì)上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express(PCIe)IP核通過(guò)了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測(cè)試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
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萊迪思獲得Flexibilis以太網(wǎng)交換IP核

  • 　　萊迪思半導(dǎo)體公司和FLEXIBILIS Oy日前宣布了即可獲取Flexibilis以太網(wǎng)交換(FES)IP核。三速(10Mbps/100Mbps/1Gbps)FES IP核工作在以太網(wǎng)第2層，每個(gè)端口具有Gigabit的轉(zhuǎn)換能力。支持Gigabit光纖和Gigabit雙絞線(xiàn)銅以太網(wǎng)接口。支持的服務(wù)質(zhì)量高達(dá)每端口四個(gè)隊(duì)列。這些以太網(wǎng)交換IP核有五個(gè)版本，根據(jù)端口數(shù)和功能而不同：　
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萊迪思推出適用于MachXO2 PLD系列的可編程支持

  • 　　萊迪思半導(dǎo)體公司(NASDAQ: LSCC)和器件編程工具的領(lǐng)先供應(yīng)商System General今天宣布推出了自動(dòng)和手動(dòng)編程系統(tǒng)，現(xiàn)已全面支持MachXO2? PLD系列的第一個(gè)成員，1200 LUT的LCMXO2-1200。兩家公司之間的合作確保正在進(jìn)入新的電子系統(tǒng)的生產(chǎn)階段的用戶(hù)使用System General編程設(shè)備，將不會(huì)發(fā)生開(kāi)發(fā)延遲，或產(chǎn)生額外的NRE成本用以支持MachXO2 PLD。
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萊迪思推出MachXO2 PICO開(kāi)發(fā)套件

  • 　　萊迪思半導(dǎo)體公司今日宣布即可獲取新的29美元的MachXO2? Pico開(kāi)發(fā)套件，可用于低功耗，空間受限的消費(fèi)電子設(shè)計(jì)的樣機(jī)研制。采用嵌入式閃存技術(shù)的低功耗65納米工藝的MachXO2器件為低密度PLD設(shè)計(jì)人員提供了在單個(gè)器件中前所未有的低成本，低功耗和高系統(tǒng)集成的特性。這些器件是低功耗應(yīng)用的理想選擇，如智能手機(jī)、移動(dòng)計(jì)算、GPS設(shè)備和數(shù)碼相機(jī)，以及在終端市場(chǎng)的控制PLD的應(yīng)用，如電信基礎(chǔ)設(shè)施、計(jì)算，高端產(chǎn)業(yè)和高端醫(yī)療設(shè)備。　
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萊迪思參考設(shè)計(jì)實(shí)現(xiàn)了圖像信號(hào)處理器與APTINA HiSPi CMOS傳感器的連接

  • 　　萊迪思半導(dǎo)體公司今日宣布全面支持使用LatticeXP2TM FPGA的Aptina的高速串行像素接口(HiSPi)。LatticeXP2 HiSPi橋參考設(shè)計(jì)實(shí)現(xiàn)了任意帶有傳統(tǒng)CMOS并行總線(xiàn)的圖像信號(hào)處理器(ISP)與Aptina HiSPi CMOS傳感器的連接。HiSPi橋解決方案是使用更高分辨率和更高的幀速率的CMOS傳感器的理想選擇，如安防攝像、汽車(chē)應(yīng)用、高端消費(fèi)攝像和其他攝像應(yīng)用等?！　?/li>
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萊迪思和HELION TECHNOLOGY發(fā)布了適用于LatticeECP3 FPGA系列的壓縮和加密IP核

  • 　　萊迪思半導(dǎo)體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現(xiàn)已上市。該系列具有有效載荷壓縮系統(tǒng)核，提高了有限信道帶寬的利用率，因此非常適合微波回程應(yīng)用、寬帶無(wú)線(xiàn)接入適用于802.16e（WiMAX）以及潛在的其他多鏈路多輸入-多輸出（MIMO）應(yīng)用中的使用。在LatticeECP3器件中，IP核可以從500Mbps無(wú)縫擴(kuò)展至超過(guò)3Gbps，并可用于典型的網(wǎng)絡(luò)應(yīng)用中的第2層或第3層。IP核采用了非常強(qiáng)大和成熟的LZRW無(wú)損壓縮算法，它
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萊迪思Platform Manager器件開(kāi)始量產(chǎn)

  • 　　萊迪思半導(dǎo)體公司(NASDAQ: LSCC)今天宣布，其屢獲殊榮的Platform Manager?系列產(chǎn)品完全合格并進(jìn)入量產(chǎn)階段。與此量產(chǎn)信息發(fā)布相配合的是更新的PAC-Designer? 6.0.1設(shè)計(jì)軟件，它使模擬和電路板設(shè)計(jì)師將電路板的電源管理和數(shù)字板的管理功能集成至Platform Manager器件系列。此外，現(xiàn)在即可獲取另外11個(gè)參考設(shè)計(jì)(包括風(fēng)扇控制器，邊界掃描端口連接器和GPIO擴(kuò)展器)，這些都為使用Platform Manager產(chǎn)品而進(jìn)行了專(zhuān)門(mén)的測(cè)試。
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萊迪思半導(dǎo)體宣布推出印刷版的書(shū)“Power 2 You”

  • 　　萊迪思半導(dǎo)體公司今天宣布推出印刷版的書(shū)“Power 2 You”， 針對(duì)電路板的電源管理功能，為設(shè)計(jì)人員提供150頁(yè)的技術(shù)細(xì)節(jié)和設(shè)計(jì)考慮。作者是Srirama(“Shyam”) Chandra，他是電源管理領(lǐng)域被認(rèn)可的專(zhuān)家，發(fā)表了多篇有關(guān)電源管理的文章。 　　電源管理的挑戰(zhàn) 　　現(xiàn)代電路板使用CPU，F(xiàn)PGA和ASIC這樣的超大規(guī)模集成電路，用它們實(shí)施主要的處理功能。這些超大規(guī)模集成電路需要多個(gè)安裝在電路板上的電源，并以一個(gè)特定的序列打開(kāi)，還要對(duì)故障
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萊迪思宣布出版名為“POWER 2 YOU”參考書(shū)

  • 　　萊迪思半導(dǎo)體公司今天宣布推出印刷版的書(shū)“Power 2 You”， 針對(duì)電路板的電源管理功能，為設(shè)計(jì)人員提供150頁(yè)的技術(shù)細(xì)節(jié)和設(shè)計(jì)考慮。作者是Srirama(“Shyam”) Chandra，他是電源管理領(lǐng)域被認(rèn)可的專(zhuān)家，發(fā)表了多篇有關(guān)電源管理的文章。
  • 關(guān)鍵字： 萊迪思  電源管理  

Lattice的另類(lèi)生存模式

  • 　　在FPGA行業(yè)，Lattice等中小公司為了避免和大型FPGA公司直接競(jìng)爭(zhēng)，通常推出一些具有差異化的產(chǎn)品，例如在可編程混合信號(hào)芯片，使FPGA涉足傳統(tǒng)模擬領(lǐng)地。 　　為改善電路板的電源與數(shù)字化管理，Lattice于10月12日發(fā)布了Platfrom Manager。該產(chǎn)品已是Lattice電源管理產(chǎn)品的第三代了—Lattice早在2003年推出了第一代產(chǎn)品—Power Manager，主要功能是排序和監(jiān)控;2006年推出Power Manager II，增加了熱插拔、電壓測(cè)量、微調(diào)閾度。
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萊迪思推出新的MachXO2 PLD系列

  • 　　萊迪思半導(dǎo)體公司今天宣布推出其新的MachXO2? PLD系列，為低密度PLD的設(shè)計(jì)人員提供了在單個(gè)器件中前所未有的低成本，低功耗和高系統(tǒng)集成。嵌入式閃存技術(shù)采用了低功耗65納米工藝，與MachXO? PLD系列相比，MachXO2系列提供了3倍的邏輯密度、10倍的嵌入式存儲(chǔ)器、降低了100倍以上的靜態(tài)功耗并減少了高達(dá)30%的成本。
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萊迪思今日發(fā)布改進(jìn)了綜合和功耗優(yōu)化的CPLD設(shè)計(jì)工具

  • 　　萊迪思半導(dǎo)體公司今日發(fā)布了ispLEVER? Classic設(shè)計(jì)工具套件1.4版。ispLEVER Classic設(shè)計(jì)軟件已經(jīng)升級(jí)，添加了帶有HDL Analyst功能集的Synopsys Synplify Pro，以及改進(jìn)的ispMACH? 4000ZE CPLD Fitter，具有更好的功耗優(yōu)化功能。 　　Synplify Pro HDL Analyst為設(shè)計(jì)師們提供了快速直觀地實(shí)現(xiàn)高階寄存器傳輸級(jí)(RTL)Verilog或VHDL的方法。設(shè)計(jì)師可以在圖和源代碼之間進(jìn)行交叉查詢(xún)，
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用PLD簡(jiǎn)化邊界掃描測(cè)試

  • 　　引言 　　隨著JTAG標(biāo)準(zhǔn)IEEE1149.1的定型，及隨后開(kāi)始在集成電路Intel 80486中采用，邊界掃描測(cè)試已被廣泛應(yīng)用于測(cè)試印刷電路板的連接，以及在集成電路內(nèi)進(jìn)行測(cè)試。邊界掃描測(cè)試受到設(shè)計(jì)人員的歡迎，因?yàn)樗軌蛟诰€(xiàn)測(cè)試，而無(wú)需昂貴的釘床在線(xiàn)測(cè)試設(shè)備。然而，在大的電路板上，邊界掃描鏈路很長(zhǎng)，電路板設(shè)計(jì)人員面臨著多種挑戰(zhàn)，諸如故障檢測(cè)和隔離、測(cè)試時(shí)間、物理布線(xiàn)，同時(shí)還要管理偏移，電壓轉(zhuǎn)換和滿(mǎn)足各種特殊需要。傳統(tǒng)上使用ASSP來(lái)應(yīng)對(duì)這些挑戰(zhàn)，然而基于ASSP的解決方案更為昂貴，有固定的電平和一些
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萊迪思推出針對(duì)MachXO和ispMACH 4000ZE PLD而優(yōu)化的參考設(shè)計(jì)

  • 　　萊迪思半導(dǎo)體公司今天宣布已經(jīng)推出了針對(duì)MachXO™和ispMACH® 4000ZE PLD而優(yōu)化的超過(guò)90個(gè)參考設(shè)計(jì)。參考設(shè)計(jì)能夠幫助設(shè)計(jì)人員快速和高效地進(jìn)行設(shè)計(jì)，并能有效使用這些常用功能，諸如通用I/O擴(kuò)展、I2C總線(xiàn)主/從、LCD控制器、SD閃存控制器，以及其他接口，這些功能廣泛地用于各種市場(chǎng)，包括消費(fèi)、通訊、計(jì)算機(jī)，工業(yè)和醫(yī)療等。這些參考設(shè)計(jì)與完整的文檔和設(shè)計(jì)源代碼結(jié)合在一起完全可以適應(yīng)客戶(hù)的需求，使設(shè)計(jì)人員縮短設(shè)計(jì)時(shí)間，提高工作效率并加快產(chǎn)品的上市。 　　&ldqu
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萊迪思半導(dǎo)體與Helion發(fā)布用于視頻安全和監(jiān)控?cái)z像機(jī)的IP核

  • 　　萊迪思半導(dǎo)體公司(NASDAQ: LSCC)與Helion今天宣布他們已經(jīng)發(fā)布知識(shí)產(chǎn)權(quán)(IP)核用于視頻安全和監(jiān)控?cái)z像機(jī)市場(chǎng)。針對(duì)LatticeXP2™、LatticeECP2M™和LatticeECP3™FPGA系列，Helion展示了其IONOS流水線(xiàn)型視頻IP和Vesta評(píng)估平臺(tái)。Helion Vesta評(píng)估平臺(tái)是一個(gè)完全獨(dú)立的平臺(tái)，能夠開(kāi)發(fā)和實(shí)現(xiàn)針對(duì)攝像機(jī)系統(tǒng)的圖像流水線(xiàn)技術(shù)，尤其是緊湊形式的視頻安全應(yīng)用，如網(wǎng)絡(luò)IP和球型攝像機(jī)。 　　Helion的Ves
  • 關(guān)鍵字： Lattice  視頻監(jiān)控  視頻安全  IP核  
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lattice(萊迪思)半導(dǎo)體公司介紹

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