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Mentor Graphics 提供對 TSMC 集成扇出型 (Integrated Fan-Out InFO) 封裝技術(shù)的支持

  • 　　Mentor Graphics公司(納斯達(dá)克代碼：MENT)今天發(fā)布了一款結(jié)合設(shè)計(jì)、版圖布局和驗(yàn)證的解決方案，為TSMC集成扇出型 (InFO) 晶圓級封裝技術(shù)的設(shè)計(jì)應(yīng)用提供支持。該解決方案包含 Calibre? nmDRC 物理驗(yàn)證產(chǎn)品、Calibre RVE? 結(jié)果查看平臺和Xpedition? Package Integrator 流程。它讓共同客戶能夠?qū)SMC InFO技術(shù)
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Mentor Graphics 發(fā)布 Veloce Apps: 開啟硬件仿真新紀(jì)元

  • 　　Mentor Graphics 公司今天宣布， 推出用于 Veloce® 硬件仿真平臺的新型應(yīng)用程序，自此開辟了硬件仿 真的新紀(jì)元。新型 Veloce Apps 包括 Veloce Deterministic ICE、 Veloce DFT 和 Veloce FastPath，可以解決復(fù)雜 SoC 和系統(tǒng)設(shè)計(jì)中的關(guān)鍵系統(tǒng)級驗(yàn)證難題。這些應(yīng)用程序在升 級的 Veloce OS3 操作系統(tǒng)上運(yùn)行，而新的操作系統(tǒng)極大加快了設(shè)計(jì)編譯周期、門級流 程和結(jié)果重新檢查( “ 可見性時(shí)間&rdqu
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Mentor Graphics Veloce VirtuaLAB增加針對領(lǐng)先網(wǎng)絡(luò)設(shè)計(jì)的下一代協(xié)議

  • 　　2015年10月19日，Mentor Graphics公司今天宣布，推出支持25G、50G和100G以太網(wǎng)的Veloce® VirtuaLAB Ethernet環(huán)境。這種支持有助于實(shí)現(xiàn)今天正在創(chuàng)建的基于大規(guī)模以太網(wǎng)設(shè)計(jì)的高效的、基于仿真的驗(yàn)證。 　　連接需求的激增對交換機(jī)和路由器設(shè)計(jì)的尺寸有著深遠(yuǎn)的影響，使之成為了今天開發(fā)的最大的IC設(shè)計(jì)。設(shè)計(jì)的絕對尺寸、早期發(fā)布的壓力，以及需要驗(yàn)證所有路徑，都推動著將驗(yàn)證從模擬轉(zhuǎn)向基于仿真流程方法的轉(zhuǎn)變。 　　Juniper Networks硅和系統(tǒng)工程
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Mentor Graphics 宣布正式啟動第26屆年度

  • 　　Mentor Graphics公司今天正式發(fā)出第 26 屆年度技術(shù)領(lǐng)導(dǎo)獎 (TLA) 大賽的參賽邀請，這一大賽延續(xù)了該公司一直以來表彰卓越印刷電路板 (PCB) 設(shè)計(jì)的傳統(tǒng)。本大賽始于 1988 年，現(xiàn)已成為電子設(shè)計(jì)自動化 (EDA) 行業(yè)持續(xù)時(shí)間最長的競賽評比項(xiàng)目。大賽設(shè)立的獎項(xiàng)旨在表彰通過采用 Mentor Graphics 公司的創(chuàng)新技術(shù)來解決當(dāng)今復(fù)雜 PCB 系統(tǒng)設(shè)計(jì)的難題，并制造出業(yè)界領(lǐng)先產(chǎn)品的工程師和 CAD 設(shè)計(jì)師。 　　本次大賽的評審由 PCB 業(yè)內(nèi)的杰出專家擔(dān)任，包括：Michae
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Mentor Graphics發(fā)布《讓你的工程師自由創(chuàng)新》研究報(bào)告

  • 　　電子設(shè)計(jì)自動化技術(shù)的領(lǐng)導(dǎo)廠商Mentor Graphics近日發(fā)布一份《讓你的工程師自由創(chuàng)新》的研究報(bào)告。中文版的報(bào)告全文可在Mentor Graphics的官方網(wǎng)站閱讀和下載。 　　今天是你的最后期限，不完成設(shè)計(jì)是不能回家了。已經(jīng)是晚上10點(diǎn)，孩子已經(jīng)入睡，晚飯已經(jīng)冷掉，配偶也因此不悅。你剛剛完成你的設(shè)計(jì)，但是卻不知道是否理想。你原計(jì)劃利用去年創(chuàng)建的一個(gè)花哨的電子表格運(yùn)行它，因?yàn)槟阏J(rèn)為你應(yīng)該可以通過執(zhí)行今早在上班路上想到的一個(gè)變更來減少一些重量。但是這就要多花一小時(shí)，而且如果變更更好，則需要多花兩
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Mentor Graphics新型PADS和XPI工具滿足當(dāng)今設(shè)計(jì)需要

  • 　　近日，Mentor Graphics在京舉辦PCB Forum(印制電路板論壇)，公司SDD部門業(yè)務(wù)發(fā)展經(jīng)理David Wiens介紹了PCB設(shè)計(jì)的新理念及其創(chuàng)新產(chǎn)品。PADS重新定義PCB市場格局　　不久前，Mentor宣布以較低價(jià)位推出三款全新PADS系列產(chǎn)品。除了具備以前PADS產(chǎn)品的易學(xué)易用等特點(diǎn)之外，新的PADS系列還融合了高效設(shè)計(jì)與分析技術(shù)，性價(jià)比更高，可以處理各種復(fù)雜的電子問題。在某些情況下，該系列還利用了領(lǐng)先市場的Mentor高端PCB工具——Xpedition產(chǎn)品中的某些技術(shù)。　　過
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Mentor Graphics玩跨界混搭，為獨(dú)立工程師和IC界帶來福音

  • 　　全球的電子產(chǎn)品越來越復(fù)雜、精細(xì)，但是依然要求低成本和快速上市。全球的企業(yè)都多了很多稱為“獨(dú)立工程師”的人群，但依然要滿足企業(yè)的需求。在日前舉辦的Mentor Graphics技術(shù)巡回研討會上，Mentor Graphics系統(tǒng)設(shè)計(jì)部門業(yè)務(wù)發(fā)展經(jīng)理David Wiens、Mentor Graphics亞太區(qū)PCB資深業(yè)務(wù)發(fā)展總監(jiān)孫自君先生向記者詳細(xì)介紹了Mentor Graphics如何通過自己的設(shè)計(jì)軟件幫助獨(dú)立工程師，并幫助企業(yè)節(jié)省成本、提高效率。 　　為獨(dú)立設(shè)計(jì)師定制的PC
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Mentor Graphics 宣布推出旨在提升測試平臺效率的 EZ-VIP 包

  • 　　Mentor Graphics公司今天宣布即時(shí)推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗(yàn)證團(tuán)隊(duì)，可將創(chuàng)建、實(shí)例化、配置和連接 QVIP 測試平臺的時(shí)間縮短 5 倍以上，從而顯著提高效率。這就意味著，驗(yàn)證團(tuán)隊(duì)可以將更多的時(shí)間花在 QVIP 上，以驗(yàn)證他們的設(shè)計(jì)在功能上是否正確。 　　EZ-VIP 包由 QVIP 配置軟件、一個(gè) VIP 調(diào)通服務(wù)包和一個(gè)全新的 EZ-VIP API 組成。其中，QVI
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全新Calibre xACT 產(chǎn)品可滿足先進(jìn)工藝廣泛的寄生電路參數(shù)提取需求

  • 　　Mentor Graphics 公司今天宣布推出全新 Calibre® xACT™ 寄生電路參數(shù)提取平臺，該平臺可滿足包括 14nm FinFET 在內(nèi)廣泛的模擬和數(shù)字電路參數(shù)提取需求，同時(shí)最大限度地減少 IC 設(shè)計(jì)工程師的猜測和設(shè)置功夫。 Calibre xACT 平臺可借由自動優(yōu)化電路參數(shù)提取技術(shù)，針對客戶特定的工藝節(jié)點(diǎn)、產(chǎn)品應(yīng)用、設(shè)計(jì)尺寸大小及電路參數(shù)提取目標(biāo)，實(shí)現(xiàn)精準(zhǔn)度和周轉(zhuǎn)時(shí)間 (TAT) 的最佳組合。 采用 Calibre xACT 平臺進(jìn)行電路寄生參數(shù)提取在滿足最嚴(yán)格
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法院駁回Synopsys申請延后執(zhí)行Mentor Graphics 硬件仿真器專利案禁制令的訴求

  • 　　Mentor Graphics 公司今日宣布，美國聯(lián)邦巡回上訴法院已駁回 Synopsys 申請延后執(zhí)行俄勒岡州聯(lián)邦地區(qū)法院就 Synopsys 硬件仿真器發(fā)布的禁制令(待決上訴)的訴求。該禁制令發(fā)布于3 月 12 日，禁止 Synopsys 公司在美國制造、使用、銷售、提供銷售、許可或租賃任何涵蓋 Mentor Graphics 專利硬件仿真技術(shù)(美國專利號為 6,240,376)的硬件仿真器或軟件。 　　該禁制令還禁止 Synopsys 從美國境外將任何涵蓋 Mentor 專利技術(shù)的硬件仿真器進(jìn)
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TSMC 認(rèn)證 Mentor Graphics軟件可應(yīng)用于TSMC 10nm FinFET 技術(shù)早期設(shè)計(jì)開發(fā)

  • 　　Mentor Graphics公司今天宣布，TSMC和Mentor Graphics已經(jīng)達(dá)到在 10nm EDA認(rèn)證合作的第一個(gè)里程碑。 Calibre® 實(shí)體驗(yàn)證和可制造性設(shè)計(jì) (DFM) 平臺以及 Analog FastSPICE™ (AFS™) 電路驗(yàn)證平臺(包括AFS Mega)已由TSMC依據(jù)最新版本的10nm設(shè)計(jì)規(guī)則和 SPICE模型認(rèn)證。經(jīng)TSMC驗(yàn)證的Olympus-SoC™ 數(shù)字設(shè)計(jì)平臺已依據(jù)10nm制程要求補(bǔ)強(qiáng)新工具功能，同時(shí)，全芯片等級
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Mentor Graphics推出用于芯片-封裝-電路板設(shè)計(jì)的Xpedition Package Integrator流程

  • 　　Mentor Graphics 公司今天宣布推出最新 Xpedition® Package Integrator 流程，這是業(yè)內(nèi)用于集成電路 (IC)、封裝和印刷電路板 (PCB) 協(xié)同設(shè)計(jì)與優(yōu)化的最廣泛的解決方案。Package Integrator 解決方案可自動規(guī)劃、裝配和優(yōu)化當(dāng)今復(fù)雜的多芯片封裝。它采用一種獨(dú)特的虛擬芯片模型概念，可真正實(shí)現(xiàn) IC 到封裝協(xié)同優(yōu)化。為了支持對計(jì)劃的新產(chǎn)品進(jìn)行早期的營銷層面研究，用戶現(xiàn)在只需使用最少的源數(shù)據(jù)即可以規(guī)劃、裝配和優(yōu)化復(fù)雜的系統(tǒng)。這款新的 Pac
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Mentor Graphics 任命 Paul Mascarenas 為董事會成員

  • 　　Mentor Graphics公司今天宣布，福特汽車公司前首席技術(shù)官, 也是英國官佐勛章 (OBE) 授勛者 　　Paul Mascarenas 被任命為公司董事會成員，此任命從 2015 年 3 月 4 日起生效。 　　“我們歡迎 Paul Mascarenas 加入 Mentor 董事會，期望 Mascarenas 先生對于汽車行業(yè)的專業(yè)經(jīng)驗(yàn)和淵博知識能讓我們公司獲益良多。汽車行業(yè)對 Mentor Graphics 而言，代表著一個(gè)重大的目標(biāo)市場和業(yè)務(wù)增長機(jī)會，”董事長
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Mentor Graphics收購Tanner EDA

  • Mentor Graphics 公司宣布收購Tanner EDA 的業(yè)務(wù)資產(chǎn)，使得全球有更多的設(shè)計(jì)師可以使用 Tanner 的 AMS 產(chǎn)品。
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MentorGraphics與中國合肥師范學(xué)院合作成立聯(lián)合實(shí)驗(yàn)室

  • 　　Mentor Graphics公司已與中部經(jīng)濟(jì)區(qū)的合肥師范學(xué)院 (HNU) 達(dá)成合作意向，成立電子和集成電路 (IC) 設(shè)計(jì)聯(lián)合實(shí)驗(yàn)室。該實(shí)驗(yàn)室將部署Mentor Graphics提供的印刷電路板、設(shè)計(jì)驗(yàn)證與測試以及IC納米設(shè)計(jì)產(chǎn)品，用于進(jìn)行項(xiàng)目研究和本科生教學(xué)。 　　合肥師范學(xué)院院長吳先良說：“聯(lián)合實(shí)驗(yàn)室的成立是資源共享上的重要里程碑。我們將在創(chuàng)新、研究和教育方面開展合作，以期在電子學(xué)領(lǐng)域取得進(jìn)步，同時(shí)可向安徽省及臨近地區(qū)輸出受過良好培訓(xùn)的人才?！? 　　Mentor Gr
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