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FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步

FPGA實現(xiàn)OFDM水聲通信系統(tǒng)定時同步,引言　　正交頻分復(fù)用(Orthogonal Frequency Division Multiplexing，OFDM)技術(shù)是一種多載波調(diào)制技術(shù)，它將寬帶信道分解為相互正交的一組窄帶子信道，利用各個子信道進行并行數(shù)據(jù)傳輸，因此其頻譜利用率高、抗多徑衰
關(guān)鍵字：系統(tǒng) 定時同步通信水聲實現(xiàn) OFDM FPGA

S2C為Xilinx原型驗證系統(tǒng)提供突破性驗證模塊技術(shù)

S2C 日前宣布其Verification Module技術(shù)（專利申請中）已可用于其基于Xilinx的FPGA原型驗證系統(tǒng)中。V6 TAI Verification Module可以實現(xiàn)在FPGA原型驗證環(huán)境和用戶驗證環(huán)境之間高速海量數(shù)據(jù)傳輸。用戶可以使用Xilinx ChipScope或者第三方調(diào)試環(huán)境，同時查看4個FPGA。另外，V6 TAI Verification Module還可以用于1.3M～4.7M ASIC門的原型設(shè)計。V6 TAI Verification Module具有PCIe G
關(guān)鍵字： S2C Xilinx FPGA

一款用DSP+FPGA實現(xiàn)的數(shù)字相關(guān)器

引　言數(shù)字相關(guān)器作為軟件無線電的典型應(yīng)用，在擴頻通信中成為必不可少的技術(shù)。在傳統(tǒng)的擴頻通信中，采用模擬器件(如：聲表面波器) 來實現(xiàn)解擴單元，而用數(shù)字相關(guān)器可以增加系統(tǒng)的靈活性和穩(wěn)定性，因此，對數(shù)字相關(guān)器
關(guān)鍵字：相關(guān) 數(shù)字實現(xiàn) FPGA DSP

基于FPGA的混合信號驗證流程

基于FPGA的混合信號驗證流程,隨著SoC設(shè)計上的混合信號組件數(shù)量增加了，基本的功能驗證對于硅初期能否成功也愈來愈重要。FPGA在系統(tǒng)整合難題上加入了一個新特點。在核心上，此新范例-可編程系統(tǒng)單芯片(programmable system chip,PSC)整合FPGA電閘
關(guān)鍵字：驗證流程信號混合 FPGA 基于

基于FPGA的檢糾錯邏輯算法的實現(xiàn)

基于FPGA的檢糾錯邏輯算法的實現(xiàn),星載計算機系統(tǒng)中電子器件容易受到空間環(huán)境電磁場的輻射和重粒子的沖擊，從而導(dǎo)致器件運行出錯，特別是存儲器中數(shù)據(jù)容易出現(xiàn)錯誤，需要具有檢糾錯功能的電路模塊對其進行糾正，以免造成嚴(yán)重的后果。基于漢明碼的糾錯
關(guān)鍵字：算法實現(xiàn) 邏輯糾錯 FPGA 基于

音頻編解碼芯片接口的FPGA應(yīng)用

音頻編解碼芯片接口的FPGA應(yīng)用,介紹了音頻編解碼芯片WM8731基于FPGA的接口電路的設(shè)計，包括芯片配置模塊與音頻數(shù)據(jù)接口模塊等，使得控制器只通過寄存器就可以方便地對其進行操作。整個設(shè)計以VHDL和Verilog HDL語言在Max+Plus Ⅱ里實現(xiàn)，并進行了驗
關(guān)鍵字： FPGA 應(yīng)用接口芯片解碼音頻

Altera演示第一款基于模型的FPGA浮點DSP工具

　　Altera公司日前演示了使用FPGA的浮點DSP新設(shè)計流程，這是業(yè)界第一款基于模型的浮點設(shè)計工具，支持在FPGA中實現(xiàn)復(fù)數(shù)浮點DSP算法。伯克萊設(shè)計技術(shù)公司 (Berkeley Design Technology, Inc, BDTI) 進行的獨立分析驗證了能夠在Altera 的Stratix 和Arria FPGA系列中簡單方便的高效實現(xiàn)高性能浮點DSP設(shè)計。　　
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應(yīng)用于除顫器的FPGA解決方案

越來越多的人們認(rèn)識到當(dāng)心臟病患者的心臟驟停時，快速及時的救治能夠帶來很大的好處。這促使更多公共場所和辦...
關(guān)鍵字： FPGA 除顫器

一種基于Spartan3E的DDS優(yōu)化設(shè)計

在高可靠應(yīng)用領(lǐng)域，如果設(shè)計得當(dāng)，將不會存在類似于MCU的復(fù)位不可靠和PC可能跑飛等問題。CPLD/FPGA的高可靠性還...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于ARM和FPGA架構(gòu)的三維圖形加速系統(tǒng)

引言隨著圖形處理的巨額運算量，CPU變得不堪重負(fù)。此時，需要使用特定的硬件設(shè)備來為嵌入式CPU承擔(dān)圖形處...
關(guān)鍵字： FPGA 圖形加速

為參加2011 Digilent Design Contest的中國代表團壯行

??????? 2011年9月12日，中秋月圓之夜，參加 2011 DDC? 德國總決賽的中國代表團整裝待發(fā)，即將登機遠(yuǎn)赴德國慕尼黑參加DDC總決賽，與來自世界各地的16支隊伍進行角逐。讓我們?yōu)樗麄儔研?！預(yù)祝他們?nèi)〉煤贸煽儯? ??????
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基于FPGA的存儲測試系統(tǒng)的設(shè)計

摘要：針對某些特殊的測試試驗要求測試系統(tǒng)高性能、微體積、低功耗，在存儲測試?yán)碚摶A(chǔ)上，進行了動態(tài)存儲測試系統(tǒng)的FPGA設(shè)計。介紹了該系統(tǒng)的組成，對控制模塊進行了詳細(xì)設(shè)計。針對測試環(huán)境的多樣性設(shè)計了采樣策略
關(guān)鍵字： FPGA 存儲測試系統(tǒng)

基于Flash型FPGA的信號源卡設(shè)計

摘要：介紹了一種基于Flash型FPGA的多路模擬重信號源設(shè)計方法，該系統(tǒng)以ACTEL公司的A3P125VQ100芯片為核心，實現(xiàn)了系統(tǒng)的軟硬件結(jié)合。它包括數(shù)模轉(zhuǎn)換單元、電源模塊、多路模擬開關(guān)模塊以及運算放大單元等，實現(xiàn)了電源
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基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

摘要：為了在提高數(shù)據(jù)采集卡的速度的同時降低成本，設(shè)計了一種應(yīng)用流水線存儲技術(shù)的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)應(yīng)用軟件與硬件相結(jié)合的方式來控制實現(xiàn)，通過MAX1308模數(shù)轉(zhuǎn)換器完成ADC的轉(zhuǎn)化過程，采用多片Nandflash流水線
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基于FPGA的SoC驗證平臺實現(xiàn)電路仿真?zhèn)慑e

基于FPGA的SoC驗證平臺實現(xiàn)電路仿真?zhèn)慑e,臺灣工業(yè)技術(shù)研究院提出一種能夠顯著提升客制化FPGA原型板驗證效率的創(chuàng)新方法，自動化現(xiàn)有的電路仿真(in-circuit emulation)偵錯功能，并提供更高的FPGA能見度。這個以FPGA為基礎(chǔ)的SoC驗證平臺對工研院而言是前景看好
關(guān)鍵字：實現(xiàn) 電路仿真平臺驗證 FPGA SoC 基于

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fpga介紹

FPGA是英文Field－Programmable Gate Array的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。 FPGA采用了邏輯單元陣列LCA（Logic Cell Array）這樣一個新概念，內(nèi)部包括可 [ 查看詳細(xì) ]