All Programmable技術(shù)和器件的全球領先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )在西班牙巴塞羅那舉行的2012年電信級以太網(wǎng)世界大會(Carrier Ethernet World Congress 2012)上展示了All Programmable技術(shù)在電信級光學網(wǎng)絡中的優(yōu)勢。
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Xilinx 以太網(wǎng) FPGA
All Programmable技術(shù)和器件的全球領先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )在Intel開發(fā)者論壇(IDF)上首次展示如何通過QuickPath Interconnect(QPI)協(xié)議將現(xiàn)場可編程門陣列(FPGA)與Intel Sandy Bridge Xeon處理器相連。賽靈思的QPI解決方案使開發(fā)人員能夠在賽靈思All Programmable FPGA與Intel Xeon處理器之間建立一個低時延、高性能的鏈路。
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賽靈思 QPI FPGA
概覽無線設備的數(shù)量、通信標準的多樣性，以及調(diào)制方案的復雜度，每一年都在不斷增加。而隨著每一代新技術(shù)的誕生，由于使用傳統(tǒng)技術(shù)測試無線設備，需要大量更復雜的測試設備，其成本也在不斷提高。使用虛擬(軟件)儀器
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LabVIEW FPGA 軟件設計 射頻儀器
摘 要：EDA技術(shù)是現(xiàn)代電子設計技術(shù)的核心，它在現(xiàn)代集成電路設計中占據(jù)重要地位。隨著深亞微米與超深亞微米技術(shù)的迅速發(fā)展，F(xiàn)PGA設計越來越多地采用基于VHDL的設計方法及先進的EDA工具。本文詳細闡述了EDA技術(shù)與FPGA
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FPGA EDA
系統(tǒng)級芯片(SoC)可采用現(xiàn)場可編程門陣列(FPGA)或?qū)Ｓ眉呻娐?ASIC)兩種方式實現(xiàn)。目前業(yè)界通常將處理器、邏輯單元和存儲器等系統(tǒng)嵌入FPGA中構(gòu)成靈活的SoC解決方案，本文以Virtex-II系列Platform FPGA為例，說明采用
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FPGA SoC 數(shù)字顯示 系統(tǒng)設計
隨著雷達技術(shù)的發(fā)展，出現(xiàn)了多種體制的雷達，比如脈沖多普勒雷達、SAR、相控陣雷達先進，雖然這些雷達的功能不同，但是為了提作用距離和距離向上的分辨率，都彩了大時寬積信號。 在雷達信號源設計領域，DDS技術(shù)
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信號源 設計 雷達 體制 FPGA 基于
京微雅格，是世界上除了美國硅谷以外唯一能夠自主開發(fā)FPGA產(chǎn)品的公司。九年前，京微雅格創(chuàng)立，在累計投資3500萬美元之后，先后研發(fā)出7款具有自主知識產(chǎn)權(quán)的集FPGA、CPU、存儲器為一體的可編程系列芯片。京微雅格CEO劉明博士這樣來形容京微雅格在FPGA產(chǎn)業(yè)中的位置，“我們已經(jīng)加入到這個俱樂部，成為了其中的一員”。
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京微雅格 FPGA 201209
摘要：本文介紹了一種自適應平臺直方圖算法對紅外圖像增強處理及該算法在FPGA器件上的實現(xiàn)。該方法是根據(jù)圖像的直方圖，自適應地選擇平臺閾值，實現(xiàn)自適應平臺直方圖均衡化，增強了目標的對比度。
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FPGA 紅外圖像 平臺閾值 201209
美國國家儀器公司(National Instruments, 簡稱 NI)近日發(fā)布8槽NI 9154 MXI-Express RIO擴展機箱和4槽NI 9146以太網(wǎng)RIO擴展機箱，進一步擴大了C系列平臺的規(guī)模，使其能夠連接需要成百上千I/O通道的應用。 通過NI LabVIEW FPGA模塊，工程師可進行自定制在線處理、閉環(huán)控制、同步以及自定義定時和觸發(fā)，由此完全控制兩個機箱內(nèi)的現(xiàn)場可編程門陣列(FPGA)的功能。
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NI RIO FPGA
作為一個菜鳥我很愿意分享下我做的一些小東西，記得一年前好像少幾天吧，看記錄是2009年5月19日我用51單片機做數(shù)字鐘的情景，那個時候用匯編，焦頭爛額，做了三天，還請教了老師。哎，現(xiàn)在都已經(jīng)用C了，而且重心已經(jīng)
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數(shù)字 設計 簡易 FPGA VHDL 語言 基于
汽車在給人們生活帶來便利的同時也帶來了交通事故。其中超速行駛是造成交通事故的重要隱患之一。據(jù)研究表明 ...
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FPGA 圖像傳感器 驅(qū)動
隨著FPGA設計越來越復雜，芯片內(nèi)部的時鐘域也越來越多，使全局復位已不能夠適應FPGA設計的需求，更多的設計趨向于使用局部的復位。本節(jié)將會從FPGA內(nèi)部復位“樹”的結(jié)構(gòu)來分析復位的結(jié)構(gòu)。我們的復位線將會
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FPGA 全局
ASIC是英文的Application Specific Integrated Circuits縮寫，即專用集成電路，是指應特定用戶要求和特定電子系統(tǒng)的需要而設計、制造的集成電路。目前用CPLD(復雜可編程邏輯器件)和FPGA(現(xiàn)場可編程邏輯陣列)來進行AS
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FPGA ASIC 比較
現(xiàn)在的FPGA正變得越來越復雜，向引腳分配信號的任務曾經(jīng)很簡單，現(xiàn)在也變得相當繁復。下面這些用于向多用途引腳指配信號的指導方針有助于設計師根據(jù)最多到最少的約束信號指配原則提前考慮信號指配，并減少反復的次數(shù)
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FPGA 引腳信號 分配
盡管FPGA和CPLD都是可編程器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異，具有各自的特點：1、CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
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FPGA CPLD 比較
fpga-to-asic介紹
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