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EEPW首頁 >> 主題列表 >> fpga-spartan

基于FPGA和ADS7890的高速AD轉換

  • 在雷達設計中，需要對接收到的信號首先進行模數(shù)轉換，其轉換速度和準確性直接決定了之后FFT等運算的準確性，最終影響雷達測量精度。介紹了一種基于FPGA，利用芯片ADS7890實現(xiàn)一種快速14位串行AD轉換，對系統(tǒng)的軟件和硬件做了說明。硬件部分主要為ADS7890的基本外圍電路以及芯片EP2C35F672C與其的控制連接，軟件部分利用Quartus II 8．0編程。
  • 關鍵字： AD轉換  毫米波雷達測距  FPGA  

ISE 12設計套件開啟FPGA生產(chǎn)力新時代

  • 賽靈思公司(Xilinx)最新推出的ISE 12軟件設計套件，實現(xiàn)了具有更高設計生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE設計套件首次利用“智能”時鐘門控技術，將動態(tài)功耗降低多達30%。此外，該新型套件還提供了基于時序的高級設計保存功能、為即插即用設計提供符合AMBA 4 AXI4 規(guī)范的IP支持，同時具備第四代部分重配置功能的直觀設計流程，可降低多種高性能應用的系統(tǒng)成本。
  • 關鍵字： Xilinx  設計套件  FPGA  

基于FPGA步進電機驅動控制系統(tǒng)的設計

  • 通過對步進電機的驅動控制原理的分析，利用Verilog語言進行層次化設計，最后實現(xiàn)了基于FPGA步進電機的驅動控制系統(tǒng)。該系統(tǒng)可以實現(xiàn)步進電機按既定角度和方向轉動及定位控制等功能。仿真和綜合的結果表明，該系統(tǒng)不但可以達到對步進電機的驅動控制，同時也優(yōu)化了傳統(tǒng)的系統(tǒng)結構，提高了系統(tǒng)的抗干擾能力和穩(wěn)定性，可用于工業(yè)自動化、辦公自動化等應用場合。
  • 關鍵字： 步進電機  Verilog  FPGA  

基于FPGA 的二維提升小波變換IP核設計

  • 提出了一種高效并行的二維離散提升小波(DWT)變換結構，該結構只需要7 行數(shù)據(jù)緩存，即可實現(xiàn)行和列方向同時進行濾波變換。
  • 關鍵字： 小波變換  數(shù)據(jù)緩存  FPGA  IP核  

基于FPGA的水聲信號高速采集存儲系統(tǒng)設計

  • 介紹了一種基于FPGA的水聲信號數(shù)據(jù)采集與存儲系統(tǒng)的設計與實現(xiàn)，給出了系統(tǒng)的總體方案，并對各部分硬件和軟件的設計進行了詳細描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心，以存儲容量達2GB的大容量NAND型Flash作為存儲介質。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊和RS～232串行通信模塊組成，具有穩(wěn)定可靠、體積小、功耗低、存儲容量大等特點，實驗證明該系統(tǒng)滿足設計要求。
  • 關鍵字： 水聲信號數(shù)據(jù)采集  NANDFlash  FPGA  

基于FPGA控制的IDE磁盤陣列設計

  • 設計了一種基于FPGA控制的高速數(shù)據(jù)存儲系統(tǒng)。該系統(tǒng)采用FPGA實現(xiàn)了對四個符合ATA-6規(guī)范的、RAID 0配置的IDE磁盤陣列的管理，并配合四個SDRAM實現(xiàn)對數(shù)據(jù)的高速穩(wěn)定存儲。該磁盤陣列同時掛四個IDE硬盤，平均數(shù)據(jù)流達到200MB/s，峰值傳輸速率達到800MB/s，也可以擴展更多硬盤，構成大容量的磁盤陣列。
  • 關鍵字： 高速數(shù)據(jù)存儲  IDE磁盤陣列  FPGA  

基于FPGA的實時數(shù)字化光纖傳輸系統(tǒng)的設計與實現(xiàn)

  • 提出一種實時數(shù)字化光纖傳輸系統(tǒng)，該系統(tǒng)分為發(fā)送端和接收端。發(fā)送端用A／D轉換器將輸入的模擬信號數(shù)字化，再用FPGA對數(shù)據(jù)進行處理，并通過光纖傳輸。同時，F(xiàn)PGA還控制A／D轉換器的工作。接收端用串行收發(fā)器TLK1501對接收數(shù)據(jù)進行解碼處理，還原有效信號。實驗表明，該系統(tǒng)實時性好、信號傳輸誤碼率低、工作性能穩(wěn)定、抗干擾性強，系統(tǒng)具有可行性和有效性。
  • 關鍵字： 光纖通訊  高速數(shù)字信號傳輸  FPGA  

軟件無線電數(shù)字下變頻技術研究及FPGA實現(xiàn)

  • 在數(shù)字下變頻系統(tǒng)實現(xiàn)方案中，輸入的模擬中頻信號經(jīng)過高速A/D采樣數(shù)字化后與數(shù)控振蕩器NCO(Numerically Controlled Osillator)產(chǎn)生的正交本振信號混頻，然后再由抽取濾波模塊進行處理，以輸出低速的低頻或基帶信號。本文以軟件無線電數(shù)字下變頻技術為研究對象，參考GSM系統(tǒng)建立數(shù)字下變頻系統(tǒng)。
  • 關鍵字： 數(shù)字變頻  軟件無線電  FPGA  

基于FPGA的固定倍率圖像縮放的實現(xiàn)

  • 基于FPGA硬件實現(xiàn)固定倍率的圖像縮放，將2維卷積運算分解成2次1維卷積運算，對輸入原始圖像像素先進行行方向的卷積，再進行列方向的卷積，從而得到輸出圖像像素。把圖像縮放過程設計為一個單元體的循環(huán)過程，在單元體內(nèi)部，事先計算出卷積系數(shù)。降低了FPGA設計的復雜性，提高了圖像縮放算法的運算速度，增強了系統(tǒng)的實時性，已經(jīng)應用于某款航空電子產(chǎn)品中，應用效果良好。
  • 關鍵字： 圖像縮放  卷積運算  FPGA  

10Gbps線速轉發(fā)引擎的并行流水線設計與實現(xiàn)

  • 設計了一種基于FPGA平臺的并行處理流水線結構，配合高速查表，可支持10Gbps接口的報文轉發(fā)。該設計已應用在國家863計劃重大課題“可擴展到T比特的高性能IPv4/v6路由器基礎平臺及實驗系統(tǒng)”中,并通過測試。
  • 關鍵字： 并行流水線  高速查表  FPGA  

基于FPGA的雙路可移相任意波形發(fā)生器

  • 本文論述了利用用FPGA來開發(fā)DDS函數(shù)發(fā)生器的總體設計思路，詳細討論了任意波形產(chǎn)生、頻率精確調(diào)整、雙路移相輸出、PWM調(diào)制波產(chǎn)生、D/A轉換與濾波電路、鍵盤與顯示等諸方面軟硬件實現(xiàn)方法。 整個設計
  • 關鍵字： DDS  任意波形發(fā)生器  FPGA  

基于FPGA的同步FIFO在大幅面高速彩色噴繪機噴頭數(shù)據(jù)傳輸中的應用

  • 研究了基于FPGA的同步FIFO和移位寄存器，利用同步FIFO作為大幅面高速彩色噴繪機噴頭與上位機之間數(shù)據(jù)傳輸以及接口數(shù)據(jù)傳輸?shù)木彺婺K。該設計在保證數(shù)據(jù)傳輸實時性的前提下，解決了噴頭和上位機像素數(shù)據(jù)格式方向不一致的問題，并消除了部分數(shù)據(jù)冗余。
  • 關鍵字： 同步FIFO  彩色噴繪機  FPGA  

基于FPGA的電梯控制器的設計與實現(xiàn)

  • 介紹了基于Altera公司EP1K30TC144芯片的電梯控制器設計過程，描述了該控制系統(tǒng)的功能。該設計采用VHDL語言進行編程，以QUARTUSⅡ軟件為開發(fā)平臺，對本設計進行了仿真，并使用JTAG將程序代碼下載到實驗板上進行了硬件驗證。
  • 關鍵字： JTAG  電梯控制器  FPGA  

基于FPGA的水聲信號高速采集存儲系統(tǒng)的設計與實現(xiàn)

  • 介紹了一種基于FPGA的水聲信號數(shù)據(jù)采集與存儲系統(tǒng)的設計與實現(xiàn),給出了系統(tǒng)的總體方案,并對各部分硬件和軟件的設計進行了詳細描述。系統(tǒng)以FPGA作為數(shù)據(jù)的控制處理核心,以存儲容量達2 GB的大容量NAND型Flash作為存儲介質。該系統(tǒng)主要由數(shù)據(jù)采集模塊、數(shù)據(jù)存儲模塊和RS-232串行通信模塊組成,具有穩(wěn)定可靠、體積小、功耗低、存儲容量大等特點,實驗證明該系統(tǒng)滿足設計要求。
  • 關鍵字： 數(shù)據(jù)采集  Flash  FPGA  

基于FPGA的全數(shù)字交流伺服系統(tǒng)信號處理

  • 在交流伺服驅動系統(tǒng)概念的基礎上，提出了基于ACTEL現(xiàn)場可編程邏輯器件APA300的光電編碼器與光柵尺信號處理電路設計原理，該電路由4倍頻細分、辨向電路、計數(shù)電路組成，信號處理模塊通過VHDL語言實現(xiàn)。
  • 關鍵字： 交流伺服系統(tǒng)  VHDL  FPGA  光柵尺信號處理  
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