在LMS算法進行變步長處理的基礎(chǔ)上,結(jié)合馳豫超前流水線技術(shù)和時序重構(gòu)技術(shù)提出了創(chuàng)新結(jié)構(gòu)和改進算法,在FPGA的仿真綜合環(huán)境中設(shè)計實現(xiàn)了該高速自適應(yīng)濾波器,并且在Altera DE2-70開發(fā)板上進行了板級測試。
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FPGA 自適應(yīng)濾波器
基于DSP和FPGA的多波形雷達回波中頻模擬器實現(xiàn),本文論述一種自主產(chǎn)生式的雷達回波模擬器中頻部分的設(shè)計實現(xiàn)方法,該模擬器可產(chǎn)生脈沖單頻、脈沖線性調(diào)頻、步進頻、步進頻+線性調(diào)頻等多種波形的雷達回波信號,并可產(chǎn)生雙目標和參數(shù)可控的帶限高斯白噪聲,可模擬主要
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中頻 模擬器 實現(xiàn) 雷達 波形 DSP FPGA 基于
一臺在未知的土地上行進的自動機器人;一部能夠根據(jù)信號強度改變解壓縮格式的視頻解碼器;一套寬帶電子對抗系統(tǒng);一種用于機動車輛的自適應(yīng)圖像跟蹤算法……這些都屬于大量涌現(xiàn)的隨環(huán)境瞬變做出快速響應(yīng)的新興嵌入式或者關(guān)鍵任務(wù)應(yīng)用。在過去,靜態(tài)決策最壞情況分配曾為嚴格的實時約束提供了解決方案,而現(xiàn)在靈活性也成為一項要求。法國某研究項目建議使用的解決方案是一種分布在 FPGA 資源上,對軟硬件線程進行管理的操作系統(tǒng)。
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賽靈思 FPGA
Altera日前宣布開始發(fā)售世界上第一款具有28-Gbps收發(fā)器的FPGA。Stratix V GT器件是業(yè)界目前為止帶寬最大、性能最好的FPGA。這一業(yè)界領(lǐng)先的創(chuàng)新Stratix V GT FPGA技術(shù)為前沿通信系統(tǒng)設(shè)計人員量身定做,幫助他們盡快實現(xiàn)市場解決方案,以滿足越來越高的網(wǎng)絡(luò)帶寬要求。
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Altera FPGA
Digilent公司很榮幸的宣布:第7屆Digilent電子設(shè)計大賽(DDC)總決賽將于2011年9月14日到15日在德國慕尼黑與FPGA World Conference同期舉行。來自中國、美國、羅馬尼亞、瑞典、墨西哥和印度的16支隊伍共30多位參賽者將會角逐這次Digilent電子設(shè)計大賽的總冠軍。這些隊伍都是各自國家的地區(qū)性設(shè)計大賽的優(yōu)勝者,其中中國選送4支隊伍,他們分別來自北京工業(yè)大學、清華大學、桂林電子科技大學、電信科學技術(shù)研究院。
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Digilent FPGA
基于ARM+FPGA架構(gòu)的三維圖形加速系統(tǒng),引言 隨著圖形處理的巨額運算量,CPU變得不堪重負。此時,需要使用特定的硬件設(shè)備來為嵌入式CPU承擔圖形處理的任務(wù)?! 【哂腥S圖形硬件加速能力的ARM+FPGA架構(gòu)嵌入式圖形系統(tǒng)就是其中一種解決方案。其中,ARM處
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圖形 加速 系統(tǒng) 三維 架構(gòu) ARM FPGA 基于
引言在各型雷達導(dǎo)引頭的研制開發(fā)中,經(jīng)常需要多次試驗以檢驗雷達對目標回波信號的分析處理性能。然而...
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雷達 中頻模擬器 FPGA DSP
摘要:作為高傳輸速率和低設(shè)計成本的傳輸技術(shù),串行傳輸技術(shù)被廣泛應(yīng)用于高速通信領(lǐng)域,并已成為業(yè)界首選。在此基...
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FPGA 高速串行傳輸
隨著軟件無線電的發(fā)展,對于濾波器的處理速度要求越來越高。傳統(tǒng)的FIR濾波器一般采用通用DSP處理器,但是DSP...
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線性相位 濾波器 FPGA
2011年8月25號,北京——Altera公司(NASDAQ: ALTR)今天宣布開始發(fā)售世界上第一款具有28-Gbps收發(fā)器的FPGA。Stratix V GT器件是業(yè)界目前為止帶寬最大、性能最好的FPGA。這一業(yè)界領(lǐng)先的創(chuàng)新Stratix V GT FPGA技術(shù)為前沿通信系統(tǒng)設(shè)計人員量身定做,幫助他們盡快實現(xiàn)市場解決方案,以滿足越來越高的網(wǎng)絡(luò)帶寬要求。
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Altera FPGA
NEC公司推出了基于其C - CyberWorkBench設(shè)計平臺,專用FPGA設(shè)計平臺版本為商業(yè)銷售。
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NEC FPGA
基于CY7C68013A和FPGA的ADSP-TS101擴展USB接口設(shè)計,ADI公司的DSP器件(ADSP-TS101)具有浮點實時處理能力強、并行性好等優(yōu)點,從而廣泛被彈載信號處理系統(tǒng)選用。其作為彈載主處理器,在導(dǎo)彈的系統(tǒng)試驗中,需要利用上位機對其中的大數(shù)據(jù)量的軟件變量進行實時監(jiān)控和記錄,
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USB 接口 設(shè)計 擴展 ADSP-TS101 CY7C68013A FPGA 基于
基于Spartan-6 FPGA的可擴展驅(qū)動控制系統(tǒng),許多情況下驅(qū)動器只是大規(guī)模工藝的一個組件,因此互操作性也是一項關(guān)鍵的設(shè)計要求。而影響這種要求的關(guān)鍵因素是工業(yè)網(wǎng)絡(luò)協(xié)議的寬度(即現(xiàn)場總線)和相關(guān)器件特性,因為它們用來標準化驅(qū)動器在網(wǎng)絡(luò)中的表達?,F(xiàn)場總線(比
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驅(qū)動 控制系統(tǒng) 擴展 FPGA Spartan-6 基于
基于雙FPGA+ARM架構(gòu)的圖像壓縮系統(tǒng),目前的圖像壓縮存儲方案大都無法支持高分辨率圖像。另外,在一些DSP解決方案中,因為DSP接口不靈活以及DSP本身處理能力的限制,很難支持高分辨圖像壓縮。 本設(shè)計開發(fā)出了一套基于雙FPGA+ARM架構(gòu)的高速計算機屏幕圖
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壓縮 系統(tǒng) 圖像 架構(gòu) FPGA ARM 基于
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