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EEPW首頁 >> 主題列表 >> fpga+mpu+mcu

基于FPGA的Viterbi譯碼器設計及實現

  •   卷積碼是廣泛應用于衛(wèi)星通信、無線通信等各種通信系統(tǒng)的信道編碼方式。Viterbi算法是一種最大似然譯碼算法。在碼的約束度較小時,它比其它概率譯碼算法效率更高、速度更快,譯碼器的硬件結構比較簡單。隨著可編程邏輯技術的不斷發(fā)展,其高密度、低功耗、使用靈活、設計快速、成本低廉、現場可編程和反復可編程等特性,使FPGA逐步成為Viterbi譯碼器設計的最佳方法。項目目的是用FPGA實現一個Viterbi譯碼器。   一、譯碼器功能分析   譯碼器是一種具有“翻譯”功能的邏輯電路,這
  • 關鍵字: FPGA  Viterbi  譯碼器  

基于FPGA+DSP遠程監(jiān)控器設計與實現

  •   項目研究的目的和主要研究內容   研究目的   為了遠程對現場進行設備管理和環(huán)境監(jiān)控,并簡化現場監(jiān)控設備,有效地提高整個系統(tǒng)的穩(wěn)定性和安全性。擬開發(fā)一款遠程控制器,簡稱RCM遠控器。該遠控器將集現場數據采集、多種通信協(xié)議轉換、故障告警、應急控制、智能聯動、內嵌WEB配置頁等多項功能。   主要研究內容   1.遠程監(jiān)控系統(tǒng)   遠程監(jiān)控系統(tǒng)總體結構(如圖1所示),其中主要研究內容為RCM遠控器。    ?   圖 1   遠控器通過RJ45與TCP/IP網絡開放式網絡相
  • 關鍵字: FPGA  DSP  RCM  

基于FPGA的脫機手寫體漢字識別系統(tǒng)

  •   1設計摘要   1.1項目背景   漢字作為非字母化、非拼音化的文字,在當今高度信息化的社會里,如何快速高效地將漢字輸入計算機,已成為影響人機交流信息效率的一個重要瓶頸。目前,漢字輸入主要分為人工鍵盤輸入和機器自動識別輸入兩種,其中人工鍵入速度慢且勞動強度大。自動識別輸入分為語音識別和漢字識別兩種,其中漢字識別是將漢字點陣圖形轉換成電信號,然后輸入給數字信號處理器或計算機進行處理,依據一定的分類算法在漢字字符集合中識別出與之相匹配的漢字。因此,研究脫機手寫體漢字識別的目的就是解決漢字信息如何高速輸
  • 關鍵字: FPGA  神經網絡  漢字識別  

基于USB3.0和FPGA的多串口傳輸系統(tǒng)設計

  •   多串口數據通信技術主要研究數據的多串口采集、存儲和處理。由于串口通信技術的廣泛應用,使得多串口采集卡一直是研究的熱點,從早期的基于PCI總線的多串口數據采集卡到后來的基于USB的多串口數據采集卡,以及現在的基于USB3.0的多串口數據采集卡。   PCI采集卡由于使用不方便,逐漸被淘汰,目前USB傳輸系統(tǒng)被廣泛應用。USB2.0理論傳輸速度為480Mb/s,而USB3.0的傳輸速率可高達5Gb/s,且在USB2.0的基礎上又增加了超高速傳輸模式。本文設計的系統(tǒng)中有80個485傳輸通道,每個通道的速率
  • 關鍵字: USB3.0  FPGA  PCI  

2014首屆清華大學TI杯汽車電子創(chuàng)新大賽圓滿落幕

  •   日前,首屆“TI杯”汽車電子創(chuàng)新大賽決賽于10月18日在清華大學舉行。此次大賽由清華大學汽車工程系協(xié)同全球領先的模擬與嵌入式處理領導廠商德州儀器(TI)共同舉辦。從2014年4月發(fā)布大賽信息時至評選結果出爐,歷時半年時間。經過清華大學汽車工程系教授和德州儀器資深工程師組成的專業(yè)評委團隊的遴選,最終由該校王翔宇同學帶領團隊憑借其提交的“分布式驅動小車的安全性設計”摘得桂冠,獲得了本次大賽的一等獎。清華大學汽車工程系的教授李建秋、高大威、楊福源、馬春生、張云
  • 關鍵字: TI  MCU  DSP  

STM32 F7 MCU搶占Cortex-M7內核先機

  •   強大的開發(fā)生態(tài)系統(tǒng)結合多元化的微控制器、傳感器、功率器件和通信產品組合,以及貼心的客戶技術支持服務,讓ST的STM32 F7成為業(yè)界領先的STM32微控制器產品家族的高端產品。
  • 關鍵字: 意法  STM32  MCU  ARM  201411  

專注汽車,Spansion新品擴充Traveo系列

  •   隨著經濟的發(fā)展、汽車產業(yè)的技術不斷革新,各式各樣的小汽車走進了人們的生活。汽車早已經不是代步工具那樣簡單,它已經成為現在人們生活不可獲取的一部分。近日,Spansion 公司宣布推出了Spansion Traveo 微控制器系列最新產品S6J3110,該產品面向汽車儀表系統(tǒng)搭載HMI和嵌入3D圖形引擎技術。   人機接口技術(HMI)   CAN是控制器局域網絡(Controller Area Network, CAN)的簡稱,是由研發(fā)和生產汽車電子產品著稱的德國BOSCH公司開發(fā)了的,并最終成為
  • 關鍵字: Spansion  CAN  MCU  201411  

高云發(fā)布FPGA產品-朝云系列

  •   廣東高云半導體科技股份有限公司(以下簡稱“高云半導體”)今日宣布推出擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云™產品系列。可廣泛用于通信網絡、工業(yè)控制、工業(yè)視頻、服務器、消費電子等領域,幫助用戶降低開發(fā)風險,迅速克服產品上市時間帶來的挑戰(zhàn)。   朝云™產品系列在目前FPGA市場上處于中密度范圍,邏輯單元從18K LUT到100K LUT。其中有兩個家族產品,分別為GW2A和GW3S。前者采用臺積電(TSMC)的55nm工藝,后者采用臺積電的
  • 關鍵字: 高云  FPGA  GW2A  

國產FPGA的“新聲”——高云半導體FPGA系列產品面世

  •   2014年10月29日 上海IC-China訊,廣東高云半導體科技股份有限公司(簡稱高云半導體)今日召開新產品發(fā)布會,宣布推出擁有我國完全自主知識產權的三大產品計劃:    現場可編程門陣列(FPGA)朝云™產品系列;    現場可編程門陣列(FPGA)云源™設計軟件;    基于現場可編程門陣列(FPGA)的IP軟核平臺—星核計劃。    擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云™產品系列。   
  • 關鍵字: FPGA  高云  朝云  

基于FPGA的機載顯示系統(tǒng)架構設計與優(yōu)化

  •   隨著航空電子技術的不斷發(fā)展,現代機載視頻圖形顯示系統(tǒng)對于實時性等性能的要求日益提高。常見的系統(tǒng)架構主要分為三種:   (1)基于GSP+VRAM+ASIC的架構,優(yōu)點是圖形ASIC能夠有效提高圖形顯示質量和速度,缺點是國內復雜ASIC設計成本極高以及工藝還不成熟。   (2)基于DSP+FPGA的架構,優(yōu)點是,充分發(fā)揮DSP對算法分析處理和FPGA對數據流并行執(zhí)行的獨特優(yōu)勢,提高圖形處理的性能;缺點是,上層CPU端將OpenGL繪圖函數封裝后發(fā)給DSP,DSP拆分后再調用FPGA,系統(tǒng)的集成度不高
  • 關鍵字: FPGA  DSP  ASIC  

高云半導體FPGA系列面世 為國產FPGA注入活力

  •   廣東高云半導體科技股份有限公司(簡稱高云半導體)在IC-China上召開新產品發(fā)布會,宣布推出擁有我國完全自主知識產權的現場可編程門陣列(FPGA)朝云?產品系列、現場可編程門陣列(FPGA)云源?設計軟件、基于現場可編程門陣列(FPGA)的IP軟核平臺——“星核計劃”三大產品。   三大系列產品詳細情況如下:   1.擁有完全自主知識產權的現場可編程門陣列(FPGA)朝云?產品系列   朝云?產品系
  • 關鍵字: 高云  FPGA  

新思科技Synopsys與高云半導體就FPGA設計軟件簽署多年OEM協(xié)議

  •   為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產權(IP)及服務的全球性領先供應商新思科技公司日前宣布:已與廣東高云半導體科技股份有限公司(Gowin Semiconductor)就Synopsys SynplifyPro FPGA綜合工具簽署一項多年OEM協(xié)議。該協(xié)議將使高云的客戶能夠改善邏輯綜合運行時間,并為GowinGW2A/3S FPGA系列實現更高質量的時序、面積及功耗設計。高云半導體已與Synopsys合作把Synplify Pro集成到用于其GW2A/3S FPGA系列的GOWINTM設計套件
  • 關鍵字: Synopsys  FPGA  DSP  

FPGA研發(fā)之道(13)-設計不是湊波形(三)RAM

  •   在FPGA內部資源中,RAM是較為常用的一種資源。   通常實例化RAM中,一種使用為BLOCK RAM 也就是塊RAM 。另外資源可以通過寄存器搭,也就是分布式RAM。前者一般用于提供較大的存儲空間,后者則提供小的存儲空間。   在實際應用過程中,一般使用的包括,單端口、雙端口RAM,ROM等形式等不同的形式。 實際應用中FIFO也是利用RAM和邏輯一起實現的。   對于一塊RAM中,其能夠例化的深度是有限的。例如cyclone4的RAM9k中可以例化的資源如下所示:    ?
  • 關鍵字: FPGA  RAM  ROM  

FPGA研發(fā)之道(12)-設計不是湊波形(二)FIFO(下)

  •   FIFO在FPGA設計中除了上篇所介紹的功能之外, 還有以下作為以下功能使用:   (1) 內存申請   在軟件設計中,使用malloc()和free()等函數可以用于內存的申請和釋放。特別是在有操作系統(tǒng)的環(huán)境下,可以保證系統(tǒng)的內存空間被動態(tài)的分配和使用,非常的方便。如果在FPGA內部實現此動態(tài)的內存分配和申請,相對來說較為復雜,例如某些需要外部數據存儲且需動態(tài)改變的應用需求下,需要對FPGA外部DDR(或SRAM等)的存儲空間,進行動態(tài)的分配和釋放。通過使用FIFO作為內存分配器,雖然比不上軟件
  • 關鍵字: FPGA  FIFO  SRAM  

FPGA研發(fā)之道(11)-設計不是湊波形(一)FIFO(上)

  •   FIFO是FPGA內部一種常用的資源,可以通過FPGA廠家的的IP生成工具生成相應的FIFO。FIFO可分為同步FIFO和異步FIFO,其區(qū)別主要是,讀寫的時鐘是否為同一時鐘,如使用一個時鐘則為同步FIFO,讀寫時鐘分開則為異步FIFO。一般來說,較大的FIFO可以選擇使用內部BLOCK RAM資源,而小的FIFO可以使用寄存器資源例化使用。   一般來說,FIFO的主要信號包括:   實際使用中,可編程滿的信號(XILINX 的FIFO)較為常用,ALTERA的FIFO中,可以通過寫深度(即寫入
  • 關鍵字: FPGA  FIFO  RAM  
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fpga+mpu+mcu介紹

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