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英特爾宣布成立全新獨立運營的FPGA公司——Altera

  • 今天，英特爾宣布成立全新獨立運營的FPGA公司——Altera。在FPGA Vision線上研討會期間，首席執(zhí)行官Sandra Rivera和首席運營官Shannon Poulin進行了分享，展示其在超過550億美元的市場中保持領(lǐng)先性的戰(zhàn)略規(guī)劃，強調(diào)將通過打造集成AI功能的FPGA等舉措，進一步豐富公司的產(chǎn)品組合，同時亦表明將持續(xù)助力客戶應(yīng)對不斷增加的挑戰(zhàn)。會上，Altera也作為新公司的品牌正式對外公布。Altera首席執(zhí)行官Sandra Rivera表示，“現(xiàn)階段，客戶正面臨日益復雜的技術(shù)挑戰(zhàn)，而我們
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瑞薩面向具備視覺AI和實時控制功能的下一代機器人 推出功能強大的單芯片RZ/V2H MPU

  • 2024 年 2 月 29 日，中國北京訊 - 全球半導體解決方案供應(yīng)商瑞薩電子（TSE：6723）今日宣布推出一款面向高性能機器人應(yīng)用的新產(chǎn)品——RZ/V2H，進一步擴展其廣受歡迎的RZ產(chǎn)品家族微處理器（MPU）。RZ/V2H打造了產(chǎn)品家族中最高水平性能，可實現(xiàn)視覺AI與實時控制功能。RZ/V2H配備瑞薩新一代專有AI加速器DRP-AI3（動態(tài)可配置處理器-AI3），可帶來10TOPS/W的能效，相比早期型號提高可達10倍之多。此外，DRP-AI3加速器采用的剪枝技術(shù)顯著增強了AI計算效率，將AI推理性
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CPLD/FPGA 內(nèi)部結(jié)構(gòu)與原理

  • 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專用集成電路（ASIC）的基礎(chǔ)上發(fā)展起來的一種新型邏輯器件，是當今數(shù)字系統(tǒng)設(shè)計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設(shè)計工作成為軟件開發(fā)工作，縮短了系統(tǒng)設(shè)計的周期，提高了實現(xiàn)的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規(guī)模
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SPI協(xié)議，MCP2515裸機驅(qū)動詳解，收藏吧用得著

  • SPI概述Serial Peripheral interface 通用串行外圍設(shè)備接口是Motorola首先在其MC68HCXX系列處理器上定義的。SPI接口主要應(yīng)用在 EEPROM，F(xiàn)LASH，實時時鐘，AD轉(zhuǎn)換器，還有數(shù)字信號處理器和數(shù)字信號解碼器之間。SPI，是一種高速的，全雙工，同步的通信總線，并且在芯片的管腳上只占用四根線，節(jié)約了芯片的管腳，同時為PCB的布局上節(jié)省空間。SPI特點采用主-從模式(Master-Slave) 的控制方式SPI 規(guī)定了兩個 SPI 設(shè)備之間通信必須由主設(shè)備 (Mas
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ESP32的功耗如何降低？

  • ESP32 是一款集成了 Wi-Fi 和藍牙功能的低功耗芯片，它可以根據(jù)不同的工作模式和配置選項來調(diào)節(jié)其功耗。根據(jù)我搜索到的信息ESP32 功耗的要點：ESP32 提供了五種可配置的電源模式，分別是活動模式、調(diào)制解調(diào)器睡眠模式、淺睡眠模式、深度睡眠模式和休眠模式。每種電源模式都有其獨特的功能和節(jié)能特性，例如在深度睡眠模式下，ESP32 的功耗可以降低到約 0.15 mA1，而在休眠模式下，ESP32 的功耗可以降低到約 2.5 μA。ESP32 的功耗還受到其時鐘源、CPU 主頻、外圍設(shè)備、Wi-Fi 和
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淺談因電遷移引發(fā)的半導體失效

  • 前言半導體產(chǎn)品老化是一個自然現(xiàn)象，在電子應(yīng)用中，基于環(huán)境、自然等因素，半導體在經(jīng)過一段時間連續(xù)工作之后，其功能會逐漸喪失，這被稱為功能失效。半導體功能失效主要包括：腐蝕、載流子注入、電遷移等。其中，電遷移引發(fā)的失效機理最為突出。技術(shù)型授權(quán)代理商Excelpoint世健的工程師Wolfe Yu在此對這一現(xiàn)象進行了分析。?1、?背景從20世紀初期第一個電子管誕生以來，電子產(chǎn)品與人類的聯(lián)系越來越緊密，特別是進入21世紀以來，隨著集成電路的飛速發(fā)展，人們對電子產(chǎn)品的需求也變得愈加豐富。隨著電子
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2024年FPGA將如何影響AI？

  • 隨著新一年的到來，科技界有一個話題似乎難以避開：人工智能。事實上，各家公司對于人工智能談?wù)摰萌绱酥?，沒有熱度才不正常！在半導體領(lǐng)域，大部分對于AI的關(guān)注都集中在GPU或?qū)Ｓ肁I加速器芯片（如NPU和TPU）上。但事實證明，有相當多的組件可以直接影響甚至運行AI工作負載。FPGA就是其中之一。對于那些了解FPGA靈活性和可編程性的人來說，這并不令人驚訝，但對許多其他人來說，這兩者之間的聯(lián)系可能并不明顯。問題的關(guān)鍵在于通過軟件讓一些經(jīng)典的AI開發(fā)工具（如卷積神經(jīng)網(wǎng)絡(luò)（CNN））針對FPGA支持的可定制電路設(shè)
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Verilog HDL基礎(chǔ)知識9之代碼規(guī)范示例

  • 2.Verilog HDL 代碼規(guī)范 模板示例//******************************************************** // //   Copyright(c)2016, ECBC  //   All rights reserved // //   File name    
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Verilog HDL基礎(chǔ)知識9之代碼規(guī)范

  • 1.RTL CODE 規(guī)范1.1標準的文件頭在每一個版塊的開頭一定要使用統(tǒng)一的文件頭，其中包括作者名，模塊名，創(chuàng)建日期，概要，更改記錄，版權(quán)等必要信息。 統(tǒng)一使用以下的文件頭：其中*為必需的項目//******************************************************** // //   Copyright(c)2016, ECBC  //   All rights&nbs
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詳解CPLD/FPGA架構(gòu)與原理

  • 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專用集成電路（ASIC）的基礎(chǔ)上發(fā)展起來的一種新型邏輯器件，是當今數(shù)字系統(tǒng)設(shè)計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設(shè)計工作成為軟件開發(fā)工作，縮短了系統(tǒng)設(shè)計的周期，提高了實現(xiàn)的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產(chǎn)業(yè)規(guī)模
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MCX A：新的通用MCU和資源豐富的FRDM開發(fā)平臺

  • 恩智浦正式發(fā)布MCX A14x和A15x系列“通用”微控制器。MCX A隸屬于MCX產(chǎn)品組合，基于Arm? Cortex?-M33內(nèi)核平臺。MCX的理念是將主流恩智浦器件的卓越特色與創(chuàng)新功能結(jié)合起來，打造下一代智能邊緣設(shè)備。可擴展性是MCX產(chǎn)品組合的一個重要優(yōu)勢。MCX A系列在該產(chǎn)品組合中發(fā)揮著重要作用，是各類應(yīng)用的基礎(chǔ)。它面向多個市場的廣泛應(yīng)用，包括：?   工業(yè)通信?   智能計量?   自動化與控制?   傳感器?&n
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Verilog HDL基礎(chǔ)知識8之綜合語句

  • 可綜合語句1.要保證Verilog HDL賦值語句的可綜合性，在建模時應(yīng)注意以下要點：2.不使用initial。3.不使用#10。4.不使用循環(huán)次數(shù)不確定的循環(huán)語句，如forever、while等。5.不使用用戶自定義原語（UDP元件）。6.盡量使用同步方式設(shè)計電路。7.除非是關(guān)鍵路徑的設(shè)計，一般不采用調(diào)用門級元件來描述設(shè)計的方法，建議采用行為語句來完成設(shè)計。8.用always過程塊描述組合邏輯，應(yīng)在敏感信號列表中列出所有的輸入信號。9.所有的內(nèi)部寄存器都應(yīng)該能夠被復位，在使用FPGA實現(xiàn)設(shè)計時，應(yīng)盡量使
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Microchip推出低成本PolarFire SoC Discovery工具包 加速RISC-V和FPGA設(shè)計

  • 嵌入式行業(yè)對基于RISC-V?的開源處理器架構(gòu)的需求日益增長，但在商用芯片或硬件方面的選擇仍然有限。為了填補這一空白并推動創(chuàng)新，Microchip Technology Inc.（微芯科技公司）宣布推出PolarFire? SoC Discovery工具包。通過為嵌入式處理和計算加速提供用戶友好、功能豐富的開發(fā)工具包，Microchip可幫助各種水平的工程師采用新興技術(shù)。新發(fā)布的開源開發(fā)工具包具有支持Linux?和實時應(yīng)用的四核 RISC-V 應(yīng)用級處理器、豐富的外設(shè)和95K低功耗高性能FPGA邏輯元件。
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專注關(guān)鍵趨勢領(lǐng)域系統(tǒng)解決方案，推動“贏得項目”整個進程

  • 過去的2023年是半導體發(fā)展充滿不確定性的一年，在這一年時間里很多半導體公司的發(fā)展經(jīng)歷了非常大的不確定性。Microchip Technology總裁兼首席執(zhí)行官Ganesh Moorthy在總結(jié)公司2023年的過程時表示，公司在2023年一開始有很強的業(yè)務(wù)增長勢頭，隨后遇到了宏觀經(jīng)濟的不穩(wěn)定。盡管面臨這些戲劇性變化，但Microchip還是通過一系列戰(zhàn)略有效地應(yīng)對了挑戰(zhàn)，以進一步促進穩(wěn)定性、韌性和長期增長。Microchip對需求預測減少的策略響應(yīng)包括幫助客戶減輕庫存風險，尋找雙贏結(jié)果，同時將大多數(shù)產(chǎn)品
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國產(chǎn)51單片機CA51F4系列的端口配置，以及外部中斷配置操作說明

  • 國產(chǎn)51單片機CA51F412L2是基于IT的51內(nèi)核單片機，內(nèi)置18K的Flash，集成8路的12位ADC采集，串口，段碼屏驅(qū)動，3路PWM，觸摸按鍵功能。廣泛應(yīng)用于帶LCM顯示，觸摸的產(chǎn)品類型，今天繼續(xù)講解端口和外部中斷的配置使用過程。GPIO 主要特性如下：l 可配置為高阻模式l I/O 結(jié)構(gòu)可獨立設(shè)置上拉電阻l 輸出模式可選開漏輸出或推挽輸出l 數(shù)據(jù)輸出鎖存支持讀-修改-寫l 支持 1.8~5.5V 寬電壓范圍一,單片機IO端口說明CA51F4 系列芯片最大封裝有 46 個 I/O 引腳，每個引腳
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