1．引言
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實現(xiàn) FPGA 基于 FPGA
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FPGA 模塊化 雷達接收機 中的應用
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LabVIEW FPGA DAQ 自動
在具有32自由度仿人機器人中，為了每一個關節(jié)動作準確，可以采用分布式控制的體系結構。這里采用基于RS 485總線的TMS320F240DSP作為分布式關節(jié)控制器，非常適合于在機械臂內的狹小空間內安裝，并進行增量碼盤和速度檢測電路的設計以及相應的軟件設計等，完成了6個自由度機械臂分布式關節(jié)控制器設計，能夠滿足仿人機器人技術與系統(tǒng)的運動軌跡的要求。
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控制器 設計 關節(jié) 機器人 DSP 基于
1 設計任務及采用的器件
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系統(tǒng) 設計 傳感器 地面 值守 無人 DSP
軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無...
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FPGA 軟件無線電平臺
基于DSP的實時圖像處理系統(tǒng),引言 本文設計了基于TMS320C6000系列DSP的MPEG-4編碼器。將攝像頭獲取的圖像以MPEG-4標準進行實時壓縮并通過VGA實時顯示，同時把壓縮好的數(shù)據(jù)通過PCI總線傳輸給ARM控制器，經由ARM根據(jù)實際的需要進行視頻數(shù)據(jù)的網
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處理 理系 圖像 實時 DSP 基于 DSP
引言在利用DSP實現(xiàn)視頻實時跟蹤時，需要進行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持...
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FPGA FIFO SDRAM DSP
引言 分頻器在CPLD/FPGA設計中使用頻率比較高,盡管目前大部分設計中采用芯片廠家集成的鎖相環(huán)資源 ,但是對于要求奇數(shù)倍分頻（如3、5等）、小數(shù)倍（如2.5、3.5等）分頻、占空比50%的應用場合卻往往不能滿足要求。
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CPLD FPGA 多功能 分頻器
引 言 整流器作為一種AC／DC變換裝置，其發(fā)展經歷了由不可控整流器(二極管整流)、相控整流器(晶閘管整流)到PWM整流器(門極可關斷功率開關管)的發(fā)展歷程。晶閘管相控整流和二極管不可控整流對電網諧波污染嚴重，且
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技術 研究 整流 PWM DSP TMS320LF2407 基于 DSP
基于DSP和FPGA的調幅廣播信號監(jiān)測系統(tǒng), 引言 隨著通信與廣播電視業(yè)務的發(fā)展，無線電頻譜迅速、大量的被占用，頻道擁擠和相互間干擾日趨嚴重，為了能有效地利用無線電頻譜，減少相互間的干擾，信號監(jiān)測業(yè)務隨之成為必要。調幅廣播信號監(jiān)測系統(tǒng)是用于實
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信號 監(jiān)測 系統(tǒng) 廣播 調幅 DSP FPGA 基于 DSP FPGA
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研究 開關電源 控制 數(shù)字化 基于 電源 DSP
Altera 公司 (NASDAQ: ALTR) 今天宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產權 (IP) 內核。Altera 的串行 RapidIO IP 內核可支持多達四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該 IP 內核專門針對擁有多個嵌入式收發(fā)器的 Stratix® IV FPGA 而優(yōu)化，并得到了Quartus® II 軟件 v9.1 的支持。
RapidIO 2.1 規(guī)范在許多應用中均可實
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Altera RapidIO FPGA Quartus
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