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降噪語音捕獲SoC提升語音辨識度的數(shù)字電路

  • 近年來，智能手機和筆記本電腦等移動/便攜設備市場持續(xù)快速發(fā)展。這些產(chǎn)品在不斷集成更多新功能以增強用戶體驗的同時，在基本語音通信功能的用戶體驗方面仍有充足提升空間，特別是在嘈雜環(huán)境下提升語音清晰度，同時保
  • 關鍵字： 語音  數(shù)字  電路  辨識  SoC  捕獲  降噪  提升  

基于FPGA的汽車視頻和圖形控制系統(tǒng)設計

  • LCD顯示器真是無處不在，在家庭、超市、體育館以及汽車內(nèi)你都可以見到它們的身影。無疑車載LCD顯示系統(tǒng)是增長最快的市場。增長的動力包括：不斷下降的顯示器價格、不斷提升的用戶體驗、更多的產(chǎn)品性能以及車內(nèi)消費類
  • 關鍵字： FPGA  汽車視頻  控制系統(tǒng)設計    

導入靈活的FPGA驗證方法

  • 隨著系統(tǒng)芯片 (SoC) 設計的體積與復雜度持續(xù)升高，驗證作業(yè)變成了瓶頸：占了整個 SoC 研發(fā)過程中 70% 的時間。因此，任何能夠降低驗證成本并能更早實現(xiàn)驗證 sign-off 的方法都是眾人的注目焦點。臺灣工業(yè)技術研究院
  • 關鍵字： FPGA  驗證方法    

基于FPGA與DSP的高速通信接口設計與實現(xiàn)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡家園
  • 關鍵字： DSP  FPGA  高速通信接口  

美國廠商眼中的熱點

  • 存儲器的市場驅動力來自智能、連接和用戶界面(UI)。智能設備主要是處理功能，可以實現(xiàn)節(jié)能、進行預防性的自檢、節(jié)省時間。連接的核心是智能網(wǎng)絡。UI(用戶界面)的核心是人機界面(HMI)的創(chuàng)新。
  • 關鍵字： 存儲器  嵌入式  FPGA  201206  

FPGA進入硅片融合時代

  • FPGA在經(jīng)過了從上世紀90年代到2000年的快速發(fā)展、隨后短期的泡沫破裂、以及近幾年的平穩(wěn)增長的發(fā)展階段，未來將會邁入硅片融合時代。
  • 關鍵字： Altera  FPGA  201206  

新款interAptiv內(nèi)核幫助實現(xiàn)SoC設計中“陰陽”平衡

  • 性能和功耗/面積通常是相互沖突的設計目標，就像 SoC 設計中的“陰”和“陽”。每一代的 SoC 都必須不斷地在這兩個設計目標之間糾結，而就當你覺得終于取得完美的平衡時，新的設計目標又推動著你繼續(xù)向前!
  • 關鍵字： SoC  interAptiv  

基于FPGA的移動通信中卷積碼編碼器設計

  • 摘要：卷積碼是一種性能優(yōu)良的差錯控制編碼。介紹了卷積碼編碼原理，基于FPGA利用VHDL硬件描述語言實現(xiàn)了一個(2，1，9)卷積碼編碼器。給出了仿真結果，并在FPGA器件上驗證實現(xiàn)。仿真及測試結果表明，達到了預期的設計
  • 關鍵字： 設計  編碼器  移動通信  FPGA  基于  

基于FPGA的無線信道模擬器設計

  • 摘要：為了縮短研發(fā)周期，需要在實驗室模擬出無線信道的各種傳播特性，無線信道模擬器設計必不可少。采用基于頻率選擇性信道Jakes仿真器模型，使用Xilinx公司的VIrtex-2p模擬實現(xiàn)了頻率選擇性衰落信道，最后將數(shù)據(jù)通
  • 關鍵字： FPGA  無線  信道模擬器    

FPGA的基本結構

  • 一、FPGA的基本結構FPGA由6部分組成，分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內(nèi)嵌專用硬核等。每個單元簡介如下：1.可編程輸入/輸出單元（I/O單元）目前大
  • 關鍵字： FPGA  基本結構    

FPGA電源需求中三種供電要求解析方案

  • 目前越來越多的家用電器從低速的撥號上網(wǎng)向寬帶互聯(lián)網(wǎng)接入或互聯(lián)網(wǎng)協(xié)議電視(IPTV)轉移，尤其是IPTV有望在中國獲得快速的發(fā)展。比較而言，IPTV的基礎設施成本相當?shù)?，因為這種方法不需要銅軸電纜，而是采用DSL或寬帶鏈
  • 關鍵字： FPGA  電源  供電  方案    

三相嵌入式SOC電表控制器解決方案

  • 方案簡介：該方案采用MSP430F471X7，改芯片帶7路獨立SD16，160Seg，100Pin。方案可實現(xiàn)正、反向有功電能計量，四象限無功電能計量;具有計量分相有功、無功電能;具有分時計量功能，有功、無功電能量按照相應的時段分別
  • 關鍵字： SOC  三相  嵌入式  電表    

基于CPLD的多DSP及FPGA遠程加載設計

  • 摘要：介紹了一種以CPLD為基礎的對多DSP和FPCA芯片實現(xiàn)程序遠程更新、加載的設計方法。詳細分析了軟硬件架構及具體實施方案，對以DSP+FPCA為架構的信號處理模塊實現(xiàn)遠程更新、加載，有重要的使用價值。
    關鍵詞：遠程
  • 關鍵字： CPLD  FPGA  DSP  遠程加載    

基于FPGA的DDS IP核設計

  • 摘要：以Altera公司的QuartusⅡ7．2作為開發(fā)工具，研究了基于FPGA的DDS IP核設計，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件，結合32位嵌入式CPU軟
  • 關鍵字： FPGA  DDS  IP核    

FPGA/CPLD中常見模塊設計精華集錦（一）

  • 一、智能全數(shù)字鎖相環(huán)的設計　　1 引言　　數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學及電力系統(tǒng)自動化等領域中得到了極為廣泛的應用。隨著集成電路技術的發(fā)展，不僅能夠制成頻率較高的單片集成鎖相環(huán)路，而且可以把整
  • 關鍵字： FPGA  CPLD  模塊設計  集錦    
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fpga soc介紹

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